【紫光同创盘古PGX-Lite 7K教程】——(盘古PGX-Lite 7K开发板/PGC7KD-6IMBG256第三章)键控彩灯实验例程

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适用于板卡型号:

紫光同创PGC7KD-6IMBG256开发平台(盘古PGX-Lite 7K)

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一:盘古PGX-Lite 7K开发板简介

PGX-Lite 7K 开发板是一套基于紫光同创 compa 系列 PGC7KD-6IMBG256 芯片为核心的开 发套件,支持主自加载双启动功能,集成板载 jtag 调试接口,支持 Type-C 转串口通信,同 时预留非常丰富的扩展 IO、数码管、按键、led 灯等硬件资源,在提供用户基础的硬件环境 基础上,满足用户更加灵活的需求。

二:实验目的

1、设计 8 种彩灯效果,可通过按键切换。

2、设置 1 个普通按键都作为控制输入,按下一次换一种显示效果,在 8 种效 果中循环。

三:实验要求

1、实验平台:PGX-Lite 7K 开发板;

2、按键输入由 KEY0 输入,LED 输出为 LED1~LED4。

### Pango Design Suite PGX-Lite 7K 环形计数器实现 以下是基于Verilog语言设计的一个环形计数器示例代码,适用于PGX-Lite 7K开发板。该代码实现了加一开关、置零开关以及数码管显示功能。 #### 功能描述 - **加一开关**:当按下时,计数值增加1。 - **置零开关**:当按下时,计数值重置为0。 - **数码管显示**:将当前计数值通过七段数码管显示出来。 #### 示例代码 ```verilog module RingCounter( input wire clk, // 主时钟信号 input wire reset_n, // 异步清零信号(低电平有效) input wire inc_switch, // 加一开关输入 output reg [3:0] count, // 计数值输出 output reg [6:0] seg // 七段数码管驱动信号 ); // 内部寄存器定义 reg [3:0] current_count; always @(posedge clk or negedge reset_n) begin if (!reset_n) begin current_count <= 4'b0000; // 清零操作 end else if (inc_switch) begin current_count <= current_count + 1; // 增加计数值 end end assign count = current_count; // 输出当前计数值 // 数码管编码逻辑 always @(*) begin case(count) 4'd0: seg = 7'b1000000; // '0' 4'd1: seg = 7'b1111001; // '1' 4'd2: seg = 7'b0100100; // '2' 4'd3: seg = 7'b0110000; // '3' 4'd4: seg = 7'b0011001; // '4' 4'd5: seg = 7'b0010010; // '5' 4'd6: seg = 7'b0000010; // '6' 4'd7: seg = 7'b1111000; // '7' 4'd8: seg = 7'b0000000; // '8' 4'd9: seg = 7'b0010000; // '9' default: seg = 7'b1111111; // 默认关闭 endcase end endmodule ``` 此模块的核心部分是一个异步复位的计数器[^1],并通过`seg`端口控制七段数码管的显示内容。计数范围限定在0到9之间循环。 --- ### 设计要点解析 1. **异步复位机制** - 使用`reset_n`作为异步清零信号,在其下降沿触发时立即将计数值清零。 2. **加一逻辑** - 当`inc_switch`被激活时,计数值自动递增1。递增后的值会映射至数码管显示。 3. **七段数码管解码** - 利用`case`语句对不同计数值进行解码并生成对应的七段数码管驱动信号。 --- ###
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