串口uart中断方式和查询方式的选择以及高效实现(循环FIFO)

在PS端对两个axi_uartlite中断的使用 由于项目需要多个UART,所以在用了两个IP核实现UART的功能。 开发板环境:vivado 2017.4 ,开发板型号xc7z020clg400-1,这个工程主要功能是自定义两个axi_uartlite IP核,实现他们的中断接收。 在实验中遇到的问题(PS:在网上查找了很多资料,花了不少时间才填完的坑): 1:两个IP核的中断怎么连接到PS端 2:在Xilinx SDK中如何对axi_uartlite IP核的中断如何进行配置 1:两个IP核的中断怎么连接到PS端: 添加zynq7... 阅读详情

串口uart中断方式和查询方式的选择以及高效实现

1. 中断方式和查询方式的选择

(1) 串口中断方式相比查询方式效率要高。

串口传输速率比较慢。比如对于系统时钟为100MHz的MCU,串口波特率为115200。传输一个字节大概需要10000个时钟周期,所以系统大部分的时间都是在等着收数据或者发数据。如果用中断方式,可以在系统接收和发送数据的间隙去处理一些其他的命令。

(2) 串口中断方式相比查询方式设计要相对复杂,需要更大的堆栈空间和存储空间,例如接收和发送缓存,更大的代码量。

2. 中断方式硬件FIFO接收阈值和发送阈值的设置

(1) 发送FIFO阈值的设置。

这里的发送FIFO阈值指的是当发送FIFO中的数据量小于或者等于该阈值的时候则会产生中断,然后在中断里把需要发送的数据写进FIFO。要想使发送的效率最高,最少的发送时间就是数据的传输时间。这样可以总结出FIFO只要空的时间最少,效率将是最高的。要保证FIFO空的时间最少,阈值就不能设为0,因为当阈值为0的时候,FIFO空的时候才会触发中断,这样就会多出进中断,然后往FIFO里写数的时间。所以阈值要设置为大于0,而且硬件支持的最小值,因为串口发送一个字节的间隙足够把新的数据写进FIFO,这样发送FIFO空的时间将是最少。为什么阈值要设置为大于0硬件支持的最小值呢?因为这样一次进中断将能放进FIFO中更多的数,减少了进中断的次数,提高了效率。

(2) 接收FIFO阈值的设置。

这里接收FIFO阈值指的是当接收FIFO中的数据量达到阈值大小的时候,将会产生中断,然后在中断里把FIFO的数据读出来。当阈值设置为1的时候,每当FIFO有数据,将会触发中断,这样进中断的次数会增多,但是效率并没有降低,因为接受一个字节的数据非常慢,接受数据的间隙足够处理很多命令,总时间还是数据的传输时间。但是进中断次数增多,会不会使得功耗增加,这个有待进一步测试。如果阈值设置的大于1,则会影响接收数据的实效性,而且会增加超时中断的时间。超时中断一般是当接收FIFO中有数,但是连续几个字节传输时间没有读写FIFO,将会产生超时中断。

3. 编程中提高效率的要点

(1) 尽量在发送数据和接收数据的间隙处理其他的一切可以处理的命令。

(2) 数据能分段组包或者分段处理要分段,这样可以在发送数据或者接收数据的间隙去组包或者处理接收的数据,尽量把时间压缩到硬件传输数据的时间。

4. 一种发送接收双FIFO的串口实现模式

(1) 发送数据时把数据写进软件FIFO,并且打开发送中断,然后主程序可以进行其他的程序处理,中断中把软件FIFO的数据取出来写进硬件发送FIFO。软件FIFO为空时关闭发送中断。优点是发送数据可以连续多次发送不用等待,不会阻塞。但是需要开一个buffer占用RAM空间。

(2) 接收数据可以在启动串口的时候就一直中断接收数据到软件FIFO,需要用数据的时候可以直接从软件FIFO中读取数据,实现简单,运用灵活。

(3) FIFO实现可以参考Linux内核的高效实现方法,对于无操作系统的裸板程序,这种实现方法,也解决了读写并发的问题,不用上锁。实现代码参考文章(https://blog.youkuaiyun.com/Linux_Nan87/article/details/80671886)。

【FPGA】UART串口通信---基于FIFO 我们在上一章完成了UART串口通信的收发模块,这一章我们将FIFO引入进来,使用FIFO进行缓存数据,来连接串口通信的收发模块同步FIFO 读和写应用同一个时钟。它的作用一般是做交互数据的一个缓冲,也就是说它的主要作用就是一个buffer1。异步FIFO 读写应用不同的时钟,它有两个主要的作用,一个是实现数据在不同时钟域进行传递,另一个作用就是实现不同数据宽度的数据接口。同步FIFO和异步FIFO略有不同,下面的参数适用于两者。,用参数FIFO_data_size表示,也就是FIFO存储的数据宽度; ,用参 阅读详情

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