zynq板zedboard+vitis设计（二）AXI DMA

最新推荐文章于 2025-10-11 19:07:19 发布
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#fpga开发

前言

本期将AXI DMA的写入与读取的测试，一些工程建立的详细步骤在第一次文章已经详细介绍了，此处不再赘述。

1.vivado中建立Block Design并导出hardware

新建vivado工程并创建block design，添加zynq模块，选用zedboard预设

 双击zynq模块进行编辑，这里勾选S AXI HP0接口

打开中断接口，然后点击确认完成zynq设置

搜索添加DMA模块

 取消S/G模式，其他保持默认

搜索添加FIFO，保持默认设置

添加concat模块，用于将多个接口合并

 

 连续点击两次run connection automation后点击run block automation

 如图连接DMA、concat以及zynq三个模块

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