System Generator 中 Divider Generator 5.1 && DSP48 error 问题

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#matlab #System Generator #Simulink #Xilinx #Vivado

在使用Xilinx 14.7、Vivado 2013.4和MATLAB 2013a进行System Generator开发时，遇到Divider Generator和DSP48组件的仿真错误。错误信息涉及到文件名无效。通过修改系统环境变量TMP和TEMP的路径为C:Temp，可以成功解决该问题，从而避免仿真时的错误。

当我们使用 Xilinx 14.7  和 Vivado 2013.4 以及 MATLAB 2013a 编译环境，利用 Sysytem Generator 里 Divider Generator 、 DSP48 进行建模时候，运行仿真可能会遇到如下错误： 

 "ERROR: [Ipptcl 7-5] XIT evaluation error: Invalid file name: 

c:/Users//AppData/Local/Temp/xlsim5304f571/hdl_netlist/xelab.srcs/sources_1/ip/div_gen_​v5_1_1/div_gen_v5_1_1_ooc.xdc"




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