TDC and ADC implemented inside FPGA

最新推荐文章于 2023-09-25 23:38:42 发布
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CC 4.0 BY-SA版权
原文链接：http://www.cnblogs.com/DeeZeng/archive/2011/11/25/2263812.html
本文详细介绍了如何利用FPGA实现内部ADC的方法，包括相关原理、具体步骤及应用实例，为读者提供深入理解及实践指导。

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时间数字转换器TDC的FPGA方案及核心代码
whm128的博客
07-28 184
摘要：本文介绍了一种基于FPGA的高精度时间数字转换器(TDC)设计方案。方案采用Xilinx UltraScale系列FPGA的Carry8延迟链结构，通过双采样模式将时间分辨率提升至5ps，较传统40nm工艺FPGA的23ps精度提高4倍。针对延时链不均匀和时钟抖动导致的气泡问题，提出了子sub分解延长方法优化线性度。系统包含粗延时计数器模块和细延时链编码模块，通过级联计数器和多级编码器实现高精度时间测量。Verilog代码实现了192抽头的延迟链结构和相应的气泡消除逻辑，为粒子物理等时间分辨应用提供了
基于FPGA的时间数字转换(TDC)设计(二:多相位设计)
sdau2005的博客
12-26 5958
基于FPGA的时间数字转换(TDC)设计，此为第二篇
皮秒级分辨率FPGA的TDC技术研究
02-27
皮秒级分辨率FPGA的TDC技术研究，该文来自知网，感觉讲的很好，所以放上来
ADC In An FPGA
weixin_34006965的博客
11-14 158
http://davidkessner.wordpress.com/2011/05/01/adc-in-an-fpga/   Geek Alert!  What follows is very technical.  It involves ADC’s, FPGA’s, and sophisticated electrical design.  If this doesn’t sound li...
模拟数据采集卡之ADC&TDC 模拟&时间/数字转换器组合应用选型指南
kunchikeji的博客
03-15 1694
产品组合包括一系列多功能时间到数字转换器(TDC)和模数转换器(ADC)。我们的许多客户的应用场景依赖于对飞行时 间(TOF)的测量。该系列产品应用于广泛的科技领域
基于FPGA的TDC(数字时间转换)设计
SLAM_masterFei的博客
04-17 1万+
额，老师让做一个TDC的计时模块用FPGA，那就做呗。。。 首先说一句，我在做的过程中发现有些人说vivado不太可以做TDC的后仿，我自己试着发现是可以的，当然也许我其实是错的 哈哈哈 先不管了。 首先上一张后仿的图 大家不要在意我的傻吊命名。我设置的起始和结束信号之间的差值是21ns，那我最后的结果是多少呢 （5-1）*4+（37+27）*76/1000=20.864ns 我不知...
FPGA TDC 进位链
liuheda的博客
08-11 1万+
CYCLONE IV的LE结构图： 可以看到里面有一个4输入的LUT,有一个3输入的LUT。 LE有两种模式，如果是普通模式，就只用到那个4输入的LUT，用来实现4输入的组合逻辑功能。 如果是算术模式，就是用来实现加法运算。这个时间一般DATA D输入为VCC或其他，反正不用。 DATA C选择使用CIN。4输入的LUT就用来实现DATA,DATAB,CIN的加法运算。3输入的LU...
tdc.rar_TDC FPGA_TDC vhdl_tdc-gp2_thirtyb4u_time-to-digital
07-15
time to digital convertor
皮秒级TDC的设计原理及FPGA实现方法
03-18
文档讲述了TDC的设计原理及FPGA实现方法，个人主页有相关资料
TDC综述(一)——基于FPGA的TDC概述
Arist.
09-26 1万+
1.1 高精度时间数字转换器概述(TDC) TDC常被用于测量时间间隔，广泛应用于物理研究、飞行时间测量领域等。虽然分辨率是一个重要的参数，但TDC非线性将直接影响整个系统的精度。此外，全数字锁相环（PLL）、频率发生器、光检测和测距（激光雷达）系统等应用要求每秒多次测量，以提高其可靠性。因此，在现代TDC体系结构中，不仅要提高TDC的分辨率，而且要提高TDC的线性和采样率。在选择架构时，功耗和资源利用也是重要的因素，因为现代应用领域常常是要求多通道并行测量。目前的竞争市场增加了对较低开发时间和快速原型的
基于FPGA的TDC设计及非线性校正.pdf
07-13
总结来说，本文通过介绍基于FPGA的TDC设计及其非线性校正方法，不仅为相关领域的研究者提供了一种高性能低成本的设计方案，也对TDC的技术细节和应用前景进行了深入的探讨。这项技术在保障高精度时间间隔测量的同时，...
基于FPGA的8通道高精度TDC技术
01-26
高精度脉冲式激光测距的精度与时间数字转换器(TDC)的精度密切相关,基于现场可编程门阵列(FPGA)的多通道TDC可有效降低系统的复杂度、提高测量效率。利用Xilinx Kintex-7系列内的CARRY4模块构造延迟链作为细计数,用25位200 M的系统时钟进行粗计数,采用粗细结合的方式,在FPGA芯片内设计并验证了8通道高精度TDC。针对延迟单元的超前进位特性及其受温度电压影响的非线性时延,利用码密度测试法和在线校准法进行校准。实验结果表明,设计的8通道TDC分辨率小于35 ps,精度为36.8 ps,误差峰峰值为157.2 ps,量程为167.77 ms。
基于皮秒级时间间隔测量的集成电路和系统解决方案----TDC
11-06
TDC原理 　　TDC是ACAM核心的超高精度的时间间隔测量产品，全数字化集成电路，采用标准CMOS工艺制造，对温度和电压的变化采用补偿方式，以便能同时满足高精度、高测量刷新率、低功耗和小体积等方面的要求。具体来讲，TDC是以信号通过内部门电路的传播延迟来进行高精度时间间隔测量的，如下图1显示了这种测量绝对间隔时间TDC的主要框架。芯片上的智能电路结构、冗余电路和特殊的布线方法使得芯片可以精确地记下信号通过门电路的个数，并且能保证每个门电路的延迟时间严格一致。芯片能获得的最高测量精度由信号通过芯片内部门电路的最短传播延迟时间tpd决定。 图1：TDC 核心测量单元 　　测量单元由 S
ADC和DAC基础
05-08
ADC和DAC基础，电子工程师入门基础及概念
基于FPGA的时间数字转换(TDC)设计（五：基于Carry4的高精度TDC设计）
sdau2005的博客
02-15 7890
基于FPGA的时间数字转换(TDC)设计，此为第五篇：基于Carry4的高精度TDC设计。提供工程文件及MATLAB测试分析代码
基于FPGA的时间数字转换(TDC)设计（四: 基于IODELAY的TDC设计）
sdau2005的博客
01-22 5180
基于FPGA的时间数字转换(TDC)设计，此为第四篇
基于FPGA的时间数字转换器（TDC）设计与Verilog实现
最新发布
ZrElixir的博客
09-25 3016
通过定义适当的接口和状态机，我们能够实现一个简单的TDC，并能测量输入信号之间的时间间隔。希望这篇文章对您有所帮助！当接收到开始触发信号时，TDC将开始计时，当接收到停止触发信号时，TDC将停止计时并输出时间间隔。当接收到停止触发信号时，TDC返回状态0，并将计数器的值输出到时间输出端口（time）。在上述代码中，我们使用了一个时钟信号（clk）和一个复位信号（reset）来控制TDC的行为。要使用该TDC设计，我们需要在FPGA开发板上实例化这个模块，并将输入信号和时钟信号连接到适当的引脚。
基于FPGA的时间数字转换(TDC)设计（三:多相位验证）
sdau2005的博客
01-15 2822
基于FPGA的时间数字转换(TDC)设计，此为第三篇
基于FPGA的TDC延时设计
热门推荐
sinat_39724439的博客
03-23 1万+
1、参考‘ https://cas.tudelft.nl/fpga_tdc/TDC_basic.html 2、原理 采用FPGA的CARRY4进位单元，每个CARRY4的COUT连接到下一个CARRY4的CIN，这样级联起来，形成延时链；每个COUT做为抽头输出到触发器，通过本地时钟进行数据采样。假定每个延时链的延时是固定的（最后需要标定），可通过采样值大致估算所测信号与本地时钟上升沿之间的间隔，当得到适当的标定后，可获得较高的精度。 3、当前测试的芯片是XC7K325TFFG900 -2 仿真中的carr
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