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RSS订阅原创 VHDL加法
上面一行综合后会报错，意思是右边是12bit数，左边是10bit数（说明：peak_pn_0 ->10bit; dout_xor_0-> 1bit）;但是将xor加扩位的结构提前算好给进去就不会报错请问这是为什么...
2019-06-12 19:40:39
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原创 VHDL状态机三段式出错
用VHDL语言写了一个三段式状态机，仿真时没有任何的问题，但是上板以后发现状态机对下一个状态判断并没有等待达到设置的条件进行，而是自动往下跳转。最终状态机没有办法使用。后面改正一段式状态机就没有问题了，下板也可以正常工作。总结：一段式状态机虽然体量大，不易读，但是确实要比三段式状态机更加的稳定。问题：大部分的VHDL/Verilog书都会推荐三段式状态机，但是这次写代码发现在第二段状态...
2019-06-11 11:07:03
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原创 通信基础知识总结
（持续盖楼）MSK：最小频移键控。是调制系数为0.5的连续相位的FSK。最大频移为比特率的1/4.GMSK：是在MSK调制之前加高斯低通滤波器
2019-03-20 15:37:26
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原创 vhdl 程序思路总结
（方便随时记忆，长时间更新）FIFO:1.注意避免出现亚稳态； =>格雷码做地址2.空时不能读，满时不能写2019.4.30vhdl计算的时候做了截位处理，所以会和simulink的浮点计算存在一定的误差。根据截位的情况，误差可能不是关于0点对称，可能是偏向某一个方向。浮点数介绍：https://www.cnblogs.com/icmzn/p/50...
2019-03-20 12:05:26
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原创 matlab 小知识自我总结合集（持续更新）
（这些小知识在笔记本中写下可能过段时间就忘记了，所以在这里持续性盖楼）sin(2*pi)在matlab中是一个很接近但不为0的数。因为pi是无限不循环小数，而matlab浮点数精度有限，所以只是接近。cos(pi/2)同理。sin(0)和cos(0)不受影响【关于取整】1. fix朝零方向取整，如fix(-1.3)=-1; fix(1.3)=1;2. floor，顾名思义，就是地板，...
2019-02-21 16:36:40
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空空如也
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