独占内存访问指令LDXR/STXR

一、原子操作的介绍

在计算机领域里,如果要在多线程的情况下要保持数据的同步,需要引入称作Load-Link(LL)和Store-Conditional(SC)的操作,通常简称为LL/SC。

LL操作返回一个内存地址上当前存储的值,并且处理器会监控这个内存地址, 看其他处理器是否修改该内存地址,后面的SC操作,会向这个内存地址写入一个新值。但是,只有在这个内存地址上存储的值,从上个LL操作开始直到现在都没有发生改变的情况下,写入操作才能成功,否则就会失败。这个操作非常重要,是很多平台实现基本原子操作的基础。 对于ARM平台来说,也在硬件层面上提供了对LL/SC的支持,LL操作用的是LDREX指令,SC操作用的是STREX指令。

一个原子的 LL/SC 操作就是通过 LL 读取值, 进行一些计算, 最后通过 SC 来写回。 如果 SC 失败,那么重新开始整个操作。 LL/SC 常常用于实现无锁算法与“读-修改-回写” 原子操作。很多 RISC体系结构实现了这种 LL/SC 机制,对于ARM平台来说,也在硬件层面上提供了对LL/SC的支持,LL操作用的是LDREX指令,SC操作用的是STREX指令。

二、LDXR 与 STXR 指令

LDXR 指令是内存独占加载指令,它从内存中以独占方式加载内存地址的值到通用寄存器里。
以下是 LDXR 指令的原型,它把 Xn 或者 SP 地址的值原子地加载到 Xt 寄存器里。

ldxr <xt>, [xn | sp]

 STXR 指令是内存独占存储指令,它把Xt寄存器的值原子地存储到到Xn或者SP地址里,执行的结果反映到Ws寄存器中。若Ws寄存器为0, 说明ldxr和stxr指令执行完成;如果结果不为0,说明执行错误,需要重新跳到ldxr处重新执行原子加载和原子存储。

stxr <ws>, <xt>, [xn, sp]

LDXP和STXP是多字节独占内存访问指令,一条指令可以独占地加载和存储16字节,也就是说这两条指令能够实现两个数据的同时操作。

ldxp <xt1>, <xt2>, [xn|sp]
stxp <ws>, <xt1>, <xt2>, [<xn|sp>]

应用场景: ldxr和stxr指令可以和加载-获取,存储-释放内存屏障原语结合使用。构成一个类似临界区的内存屏障。在一些自旋锁的实现场景下非常有用。 

使用

 void atomic_add(int i, atomic_t *v)
 {
 unsigned long tmp;
 int result;

 asm volatile("// atomic_add\n"
 "1: ldxr%w0, [%2]\n"
 " add%w0, %w0, %w3\n"
 " stxr%w1, %w0, [%2]\n"
 " cbnz%w1, 1b"
 : "=&r" (result), "=&r" (tmp)
 : "r" (&v->counter), "Ir" (i)
 : "cc");
 }

// 其中 atomic_t 变量的定义如下。
typedef struct {
int counter;
} atomic_t;

 

 参考:

独占访问指令与内存管理:局部与全局监视器-优快云博客

https://zhuanlan.zhihu.com/p/692422838


 

 

 

 

<think>好的,用户现在想了解ARMv8中的独占访问(exclusive)机制。之前他问过可共享内存,现在这个问题也是内存管理的一部分,但更偏向于同步机制。首先,我需要确认用户的需求。他可能是在多核编程或者需要处理并发时遇到了问题,比如如何保证原子操作,避免数据竞争。 用户可能已经知道可共享内存的概念,现在想知道ARMv8如何实现独占访问来确保数据一致性。需要解释清楚LDXRSTXR指令的工作原理,以及它们如何配合使用来实现原子操作。同时,用户可能对独占监视器(Exclusive Monitor)不太了解,需要详细说明其作用,比如跟踪独占访问的状态。 还要注意用户的应用场景,比如是在操作系统开发、驱动编写还是应用层多线程编程。不同的场景可能需要不同的细节。例如,操作系统开发者可能更关心监视器的状态管理和上下文切换的影响,而应用开发者可能更关注如何使用这些指令实现锁或原子变量。 需要对比其他架构,比如x86的CAS指令,帮助用户理解ARMv8的不同之处。此外,用户可能想知道实际使用中的注意事项,比如循环重试、内存屏障的使用,以及缓存一致性对独占访问的影响。还要提到异常处理时监视器状态的失效情况,避免潜在的竞态条件。 最后,确保回答结构清晰,分步骤讲解,可能用代码示例说明LDXRSTXR的使用,强调独占访问在实现锁、无锁数据结构中的重要性。同时,检查是否有遗漏点,比如监视器的硬件实现细节,或者在不同ARMv8处理器中的行为差异,确保信息准确可靠。</think>--- ### ARMv8 独占访问(Exclusive Access)机制详解 在ARMv8架构中,独占访问(Exclusive Access)是实现**原子操作**和**无锁同步**的核心机制,通过`LDXR`(Load Exclusive Register)和`STXR`(Store Exclusive Register)指令实现。以下是其工作原理与应用场景的逐步解析: --- ### 一、独占访问的核心目标 - **原子性**:确保对内存的“读-修改-写”操作在多核/多线程环境中不可分割。 - **无锁同步**:避免传统锁(如自旋锁)的开销,提升并发性能。 --- ### 二、关键组件:独占监视器(Exclusive Monitor) ARMv8为每个核维护一个**独占监视器**,跟踪独占访问状态: 1. **本地独占监视器**(Local Monitor) - 每个核独立维护,标记当前核的独占访问状态。 2. **全局独占监视器**(Global Monitor) - 针对特定内存地址的全局状态(仅在多核系统中存在)。 --- ### 三、独占访问指令流程 #### 1. **加载独占LDXR)** - **操作**:从内存地址读取值到寄存器,并标记该地址为“独占访问状态”。 - **示例**: ```assembly LDXR X0, [X1] // 从X1指向的地址加载值到X0,并激活独占监视器 ``` #### 2. **修改数据** - 在本地寄存器中执行计算(如递增、位操作)。 ```assembly ADD X0, X0, #1 // 对X0的值加1 ``` #### 3. **存储独占STXR)** - **操作**:尝试将寄存器值写回内存地址。 - 若监视器状态有效(期间无其他核修改该地址),则写入成功,返回`0`。 - 若监视器失效(其他核已修改地址),则写入失败,返回`1`。 - **示例**: ```assembly STXR W2, X0, [X1] // 尝试将X0写入[X1],结果状态存入W2 ``` #### 4. **重试机制** - 若`STXR`失败(W2≠0),需重新执行`LDXR→修改→STXR`流程。 ```assembly retry_loop: LDXR X0, [X1] ADD X0, X0, #1 STXR W2, X0, [X1] CBNZ W2, retry_loop // 若失败则重试 ``` --- ### 四、独占访问的特性 1. **地址粒度** - 独占监视器以**自然对齐的地址块**(通常为缓存行大小,如64字节)为单位跟踪状态。 - 若同一块内任一地址被修改,监视器均会失效。 2. **上下文切换影响** - 进程切换或异常(如中断)会导致独占监视器状态**被清除**,需重新尝试。 3. **多核一致性** - 全局独占监视器通过缓存一致性协议(如MESI)维护多核间的状态同步。 --- ### 五、应用场景 #### 1. 原子变量操作 - 实现原子计数器、标志位等: ```c // C内联汇编实现原子递增 void atomic_inc(uint64_t *addr) { uint32_t status; do { asm volatile("ldxr x0, [%1]\n" "add x0, x0, #1\n" "stxr %w0, x0, [%1]" : "=r"(status) : "r"(addr) : "x0", "memory"); } while (status != 0); } ``` #### 2. 自旋锁(Spinlock) - 基于独占访问实现轻量级锁: ```assembly acquire_lock: LDXR X0, [X1] // 加载锁状态 CBNZ X0, acquire_lock // 若锁被占用则重试 MOV X0, #1 STXR W2, X0, [X1] // 尝试获取锁 CBNZ W2, acquire_lock RET release_lock: STLR XZR, [X1] // 使用Store-Release指令释放锁 RET ``` #### 3. 无锁数据结构 - 实现无锁队列、栈等,避免锁争用。 --- ### 六、与x86架构对比 | 特性 | ARMv8 (LDXR/STXR) | x86 (CMPXCHG) | |---------------------|-----------------------------|----------------------------| | **实现方式** | 独占监视器 + 重试循环 | 锁总线或缓存锁 | | **粒度** | 地址块(如缓存行) | 单个内存地址 | | **性能优化** | 冲突少时效率高 | 高竞争时可能更优 | | **指令扩展** | LDAXR/STLXR(Acquire/Release语义) | LOCK前缀指令 | --- ### 七、关键注意事项 1. **内存屏障** - 使用`LDAR`(Load-Acquire)和`STLR`(Store-Release)保证内存顺序。 - 示例:释放锁时需确保之前的写操作对其他核可见。 ```assembly STLR X0, [X1] // Store-Release语义 ``` 2. **缓存对齐** - 独占访问地址应缓存对齐,避免伪共享(False Sharing)。 3. **短临界区** - 独占访问适合轻量级操作,长时间占用会导致重试开销增加。 --- ### 八、总结 ARMv8的独占访问机制通过硬件级监视器和`LDXR/STXR`指令,为多核环境提供了高效的原子操作支持。其核心优势在于: - **低开销**:无需锁总线,减少争用。 - **灵活性**:适用于自旋锁、无锁算法等多种场景。 - **可扩展性**:结合内存屏障指令,支持复杂的内存顺序模型。
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