关于Makefile

     第一次编译使用Makefiel编译hello.c,犯了一个很低级的错误,而且还在这个错误上徘徊了好几天,浪费了很多时间。起原因是开始对Makefile理解不够,把指向内核Makefile的目录理解成hello.c文件所在的目录。可笑吧! 是的,只看视频很多东西不实际操作就是不行。

所出现的问题: 

一,编译时显示:no rule to make target   "modules"  ,stop

二,改动之后,输入make后又出现:

make[134]: *** [all] Interrupt
make[133]: *** [all] Interrupt
make[132]: *** [all] Interrupt
make[131]: *** [all] Interrupt
make[130]: *** [all] Interrupt
make[129]: *** [all] Interrupt
make[128]: *** [all] Interrupt
make[127]: *** [all] Interrupt
make[126]: *** [all] Interrupt
make[125]: *** [all] Interrupt

进入死循环的状况。

把目录改成功后

其成功代码如下:

ifneq ($(KERNELRELEASE),)


obj-m := hello.o


else

KDIR := /usr/src/linux-headers-2.6.32-38-generic
all:
make -C $(KDIR) M=$(PWD) modules 
clean:
rm -f *.ko *.o *.mod.o *.mod.c *.symvers


endif

在输入make,编译出hello.c   hello.mod.c  hello.o   modules.orderhello.ko  hello.mod.o  Makefile  Module.symvers   几个文件,证明成功。



Makefile 是一种简单的文本文件,它用来描述程序的构建过程,也就是编译、链接等步骤。编写 Makefile 的目的是为了自动化软件开发流程,提高效率并保证一致性。下面是创建一个基础 Makefile 的步骤及一些关键元素: 1. **顶部注释**:可以包含项目信息、作者和版本等。 ```makefile # Project Name Makefile ``` 2. **变量定义**:声明常量如源文件、目标文件和编译器等。 ```makefile CC = gcc SOURCES = source1.c source2.c OBJECTS = source1.o source2.o EXECUTABLE = program ``` 3. **规则**(Rules):这部分定义了如何从源文件生成目标文件或最终可执行文件。 ```makefile %.o: %.c $(CC) -c $< -o $@ all: $(EXECUTABLE) ``` - `%` 代表任意字符串,`.` 表示匹配规则的剩余部分。 - `$(SOURCES:.c=.o)` 是替换语法,将 `.c` 替换为 `.o` 来生成目标文件名列表。 4. **目标规则**(Target Rules):这里定义 "all" 目标,即默认动作。 ```makefile $(EXECUTABLE): $(OBJECTS) $(CC) $(OBJECTS) -o $@ ``` 5. **清理规则**(Clean Rule):如果需要,你可以定义一个 "clean" 或者 "distclean" 目标来删除中间产物。 ```makefile .PHONY: clean clean: rm -f $(OBJECTS) $(EXECUTABLE) ``` 6. **保存 Makefile**:最后将文件保存为 `Makefile`。 以上是一个基本的 Makefile 示例。实际应用中,可能会根据项目需求增加更多的规则、变量和条件判断。要执行 Makefile,只需在项目目录下输入 `make`(或其他指定的 make 命令)即可。
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