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若连续运行位（控制寄存器位3）置1且主计数器使能位保持置1，则无论中断是否清除，主计数器将重新开始计数；当模式选择位（控制寄存器位1）清零时，核心处于定时器模式。主计数器使能位（控制寄存器位2）置1后，主计数器开始递增。当模式选择位（控制寄存器位1）置1时，核心处于PWM模式。若主计数器使能位（控制寄存器位2）和PWM输出使能位（控制寄存器位4）均置1，端口。输出保持当前状态，直到主计数器使能位重新置1或通过外部复位/主计数器复位位（控制寄存器位7）复位计数器逻辑。写入0至控制寄存器位5可清除中断。
2025-03-26 23:58:18
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原创 FWFT FIFO
FWFT（First-Word Fall-Through） 是一种特殊的 FIFO 工作模式，其核心特点数据提前暴露：FIFO 非空时，第一个有效数据自动出现在输出端口
2025-03-26 22:41:18
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原创 基于FPGA数字式竞赛抢答器（完整版）
FPGA课程设计报告1、报告首页2、题目及要求的功能、技术指标、硬件平台、软件工具3、课程设计目的4、系统方案设计（1）锁存鉴定模块（2）记分模块（3）动态扫描分数显示模块1）动态扫描2）译码部分（4）led灯和蜂鸣器控制模块5、FPGA总体设计（1）锁存鉴定模块（2）记分模块（3）动态扫描分数显示模块1）动态扫描2）译码部分（4）led灯和蜂鸣器控制模块6、验证方案及仿真结果（1）锁存鉴定模块（2）记分模块（3）动态扫描分数显示模块1）动态扫描2）译码部分（4）led灯和蜂鸣器控制模块顶层模块的仿真验证7
2025-03-22 21:07:54
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原创 EDA技术实验综合报告（抢答器）
前面的题目要求，设计思路，功能仿真，可以看上一篇https://blog.youkuaiyun.com/qq_45082737/article/details/106515582本来说是要做CRC的老师突然说用fpga课设的也可以（苦瓜脸，CRC的都做好了）目录一、电路综合1、使用综合工具DC，给出DC综合脚本（脚本要有必要的注释）2、给出综合报告（要有必要的分析说明）二、静态时序分析1、给出PT静态时序分析脚本（脚本要有必要的注释）。2、给出静态时序分析报告（要有必要的分析说明）。三、电路形式化验证1、给出形式化
2025-03-22 21:06:49
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原创 EDA技术实验综合报告（抢答器）
前面的题目要求，设计思路，功能仿真，可以看上一篇https://blog.youkuaiyun.com/qq_45082737/article/details/106515582本来说是要做CRC的老师突然说用fpga课设的也可以（苦瓜脸，CRC的都做好了）目录一、电路综合1、使用综合工具DC，给出DC综合脚本（脚本要有必要的注释）2、给出综合报告（要有必要的分析说明）二、静态时序分析1、给出PT静态时序分析脚本（脚本要有必要的注释）。2、给出静态时序分析报告（要有必要的分析说明）。三、电路形式化验证1、给出形式化
2025-03-22 21:05:07
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qidaqii_top_1.zip
2020-05-30
空空如也
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