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RSS订阅原创 Vivado生成edif网表及其使用
介绍如何在Vivado中将模块设为顶层，并生成相应的网表文件（Verilog文件和edif文件），该过程适用于需要将一个模块作为顶层设计进行综合，并生成用于其他工程中的网表文件的情况。
2025-02-13 17:58:59
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原创 Vivado Implementation Strategy（实现策略）
在Vivado中，Implementation Strategy（实现策略）提供了多种预设配置，以满足不同的设计目标，如性能、布线拥塞、资源利用率、功耗和运行时间等。
2025-02-12 17:15:35
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原创 Vivado Synthesis Strategy（综合策略）
在 Vivado 中Synthesis Strategy是指 Vivado 综合工具在将 RTL代码转换为门级网表时所采用的优化方法和配置，不同的综合策略会影响设计的性能、资源利用率和综合时间。
2025-02-12 12:20:32
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原创 CAN-(04)CRC循环冗余校验
CRC（Cyclic Redundancy Check，循环冗余校验）实际上是一种 在原始数据后附加校验码 的技术，生成一个新的数据块，并通过特定的生成多项式来进行校验。
2024-11-29 18:18:00
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原创 CAN-(02)CAN总线的帧结构
在CAN（Controller Area Network）协议中，帧的类型主要分为数据帧、远程帧、错误帧和过载帧，每种帧都有其特定的功能和用途。
2024-11-29 08:55:17
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原创 CAN-(03)CAN总线中的ACK
在CAN协议中，ACK字段由两位组成，1位为ACK槽（ack slot）+1位ACK界定符，发送节点在发送数据帧之后，会通过ACK槽来确认是否有接收节点成功接收到该数据。具体来说，发送节点检查的是数据帧的ACK字段，这个字段位于帧的末尾，紧跟在CRC校验字段之后，发送节点通过检查该字段的状态来判断数据是否成功传输。
2024-11-28 17:39:30
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原创 SDRAM （Synchronous Dynamic Random Access Memory）
SDRAM 的基本概念、数据存储原理、存储容量、操作命令的简单介绍。
2024-04-19 16:19:29
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原创 Tap(抽头点)
在IIR滤波器中，抽头点通常指的是延迟线上的一个采样点，这些延迟元素构成了滤波器的反馈路径或者前馈路径。与FIR滤波器不同，IIR滤波器的结构是递归的，因此输出不仅依赖于当前和过去的输入信号，还依赖于过去的输出信号。在实际应用中，抽头点的位置和对应的加权系数对滤波器的性能和响应特性有着重要的影响。在某些情况下，抽头点也可以表示信号处理系统中的一个特定的采样点，而不仅仅是滤波器中的一个延迟元素。总的来说，抽头点表示在信号处理系统中的一个特定位置上的采样点或者延迟元素，它对于系统的整体性能和行为具有重要作用。
2024-04-17 16:09:41
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原创 SRAM（静态随机存取存储器）
是计算机中用于临时存储数据和程序的一种主要类型的内存。RAM是一种易失性存储器，意味着当电源关闭时，其中存储的数据会丢失。RAM与计算机的处理器之间以及计算机的其他部件之间通过总线进行通信。）和DRAM是常见的内存类型，通常用于主存储器。它的主要优点是成本较低，但速度相对较慢。相比之下，SRAM速度更快，但成本更高，因此通常用于缓存和高性能应用中。RAM的容量通常以（例如，GB、MB）表示，它影响着计算机系统的性能和多任务处理能力。
2024-03-29 09:39:02
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空空如也
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