modelsim仿真ISE工程时出现# ** Error: (vlog-19) Failed to access library 'rtl_work' at "rtl_work"

最新推荐文章于 2023-11-15 16:34:51 发布
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当在modelsim中先后仿真ISE和quartus ii工程时，可能会遇到# ** Error: (vlog-19) Failed to access library 'rtl_work'的错误。解决方法包括删除modelsim界面的work(unavailable) library rtl_work或修改modelsim.ini文件，注释掉'work = rtl_work'行。每次仿真quartus ii后，记得执行此操作以避免错误。

    通常情况下一台电脑上即装有ISE，又装有quartus ii且二者的仿真库都在modelsim里编译好，在用modelsim仿真过quartus ii工程之后再用modelsim仿真ISE工程就会出现如题所示错误：Error: (vlog-19) Failed to access library 'rtl_work' at "rtl_work"，

1.此时在modelsim界面的library栏处找到work(unavailable) library rtl_work,将其删除，（这是我在网上找到的办法，不行）

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10-04 2441
2.进行相关设置，值得一提的是最后的Output directory 的目录就是simulation里面的qsim。1.先打开上方任务栏 TOOLS-点击Launch Simulation Library Compiler。然后点击该页面最底下的的Start Compilation后再返回方针页面尝试。这是我在配置过程中遇到的问题并已经成功解决，希望能同样帮助到你，祝你好运。3.如果依旧不能成功，返回点击Tools-Options。你需要确保Modelsim的路径已经配置。
modelsim仿真ISE工程时出现# ** Error: (vlog-19) Failed to access library 'rtl_work' at "rtl_work
文鸿开源工作室
12-27 8160
今天在使用ISE调用Modelsim的时候，遇到下面图1的错误： 图1 Modelsim出现的错误 找了半天解决方法，找到了下面的解答（http://blog.sina.com.cn/s/blog_6e394a3d0101722o.html）。 通常情况下一台电脑上即装有ISE，又装有quartus ii且二者的仿真库都在modelsim里编译好，在用modelsim仿真过q...
# ** Error: (vsim-19) Failed to access library ‘./rtl_work‘ at “./rtl_work“.# # No such file or di
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11-15 727
# ** Error: (vsim-19) Failed to access library './rtl_work' at "./rtl_work". # # No such file or directory. (errno = ENOENT)
# Refreshing C:/altera/13.1/simulation/qsim/work.half_adder_vlg_sample_tst # Loading work.half_adder_vig_sample_tst #** Error: (vsim-19) Failed to access library 'cycloneiv_ver' at "cycloneiv_ver"#No such file or directory. (errno = ENOENT) #** Error: (vsim-19) Failed to access library 'altera_ver' at "altera_ver" #t # No such file or directory, (errmo = ENOENT) #** Error: (vsim-19) Failed to access library 'altera_mf_ver' at "altera_mf_ver".# # No such file or directory. (errna = ENOENT) # ** Error: (vsim-19) Failed to access library '220model_ver' at "220model_ver"* * No such file or directory. (errna ENOENT) #** Error: (vsim-19) Failed to access library 'sgate' at "sgate". # No such file or directory. (errno = ENOENT # Refreshing C:/altera/1 .1/ simulation /qsim/workchalf_adder_vig_check_tst # Loading work.half_adder_vig_check_tst # Error loading design
11-27
针对您在仿真时遇到的vsim-19错误："Failed to access library"，以下是系统性的解决方案： ### 错误原因分析 该错误是由于ModelSim/QuestaSim无法定位以下关键库文件： 1. `cycloneiv_ver` - Cyclone IV FPGA专用...
vsim -t 1ps -L altera_ver -L lpm_ver -L sgate_ver -L altera_mf_ver -L altera_lnsim_ver -L cycloneive_ver -L rtl_work -L work -voptargs=""+acc"" CNT_CTRL_LED_tb # Start time: 14:55:14 on Aug 28,2025 # ** Note: (vsim-3812) Design is being optimized... # ** Error: (vopt-13130) Failed to find design unit CNT_CTRL_LED_tb. # Searched libraries: # altera_ver # lpm_ver # sgate_ver # altera_mf_ver # altera_lnsim_ver # cycloneive_ver # rtl_work # work # work # Optimization failed # ** Note: (vsim-12126) Error and warning message counts have been restored: Errors=1, Warnings=0. # Error loading design # Error: Error loading design # Pausing macro execution # MACRO ./CNT_CTRL_LED_run_msim_rtl_verilog.do PAUSED at line 39
08-29
你必须先使用 `vlog` 或 `vcom`（或 ModelSim 的 `compile` 命令）将你的 Verilog/VHDL 文件编译到某个库中（如 `work` 或 `rtl_work`），然后才能运行仿真。 示例（Verilog）： ```bash vlog -work work CNT_CTRL...
vsim -t 1ps -L altera_ver -L lpm_ver -L sgate_ver -L altera_mf_ver -L altera_lnsim_ver -L cycloneive_ver -L rtl_work -L work -voptargs=""+acc"" b_code_1_tb # Start time: 14:49:08 on Jun 09,2025 # ** Note: (vsim-3812) Design is being optimized... # ** Error: (vopt-13130) Failed to find design unit b_code_1_tb. # Searched libraries: # altera_ver # lpm_ver # sgate_ver # altera_mf_ver # altera_lnsim_ver # cycloneive_ver # rtl_work # work # work # Optimization failed # ** Note: (vsim-12126) Error and warning message counts have been restored: Errors=1, Warnings=0.什么意思
06-11
基于您遇到的 `vsim` 报错 **“vopt-13130 Failed to find design unit `b_code_1_tb`”**，结合引用内容和常见仿真环境配置经验，以下是系统化的排查与解决方案： --- ### **问题核心原因分析** 此错误表明仿真器...
do Waveform.vwf.do # Model Technology ModelSim ALTERA vlog 10.1d Compiler 2012.11 Nov 2 2012 # ** Error: (vlog-1902) Option "-c" is either unknown, requires an argument, or was given with a bad argument. # # Use the -help option for complete vlog usage. # ** Error: E:/FPGA/modelsim/modelsim_ase/win32aloem/vlog failed. # Error in macro ./Waveform.vwf.do line 1 # E:/FPGA/modelsim/modelsim_ase/win32aloem/vlog failed. # while executing # "vlog -work work Waveform.vwf.vtvsim -novopt -c -t 1ps -L cycloneive_ver -L altera_ver -L altera_mf_ver -L 220model_ver -L sgate work.top_vlg_vec_tst -..."
最新发布
12-14
若提示`Failed to access library 'rtl_work'`（引用[5]）： - 在ModelSim中执行： ```tcl vdel -lib rtl_work -all ;# 删除冲突库 vlib rtl_work ;# 重建库 vmap work rtl_work ;# 重新映射 ``` ##### 5. *...
xilinx ISE 软件仿真时出现 Error: (vlog-19) Failed to access library 'rtl_work' at "rtl_work"解决办法
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通常情况下一台电脑上即装有ISE，又装有quartus ii且二者的仿真库都在modelsim里编译好，在用modelsim仿真过quartus ii工程之后再用modelsim仿真ISE工程就会出现如题所示错误：Error: (vlog-19) Failed to access library 'rtl_work' at "rtl_work"，此时在modelsim界面的library栏处找到w
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