题目大串烧 循环串 香!

统计数字
描述

输出在范围[a,b]以内(a<=b<=1000000)的个位数字是6,且能被3整除的数共有多少个?

输入

一行两个数,以[a,b]的形式给出

输出

一个数

#include<iostream> 
#include<cstdio>  	
using namespace std;	
int main()		
{int a,b,i,c=0; 
scanf("[%d,%d]",&a,&b);
for(int i=a;i<=b;i++){
	if((i%10==6)&&(i%3==0)){
		
		c++;
	}
	
}
	
	cout <<c;
			
    return 0;	
}

奇数求和
描述

计算非负整数 m 到 n(包括m 和 n )之间的所有奇数的和,其中,m 不大于 n,且n 不大于300。例如 m=3, n=12, 其和则为:3+5+7+9+11=35。

输入

两个数 m 和 n,两个数以一个空格分开,其中 0 <= m <= n <= 300 。

输出

输出一行,包含一个整数,表示m 到 n(包括m 和 n )之间的所有奇数的和

输入样例 1

7 15
输出样例 1

55

#include<stdio.h>
 
int main()
{
 
    int m,n,a=0;
    
    scanf("%d %d",&m,&n);
 
    for(int i=m;i<=n;i++){
        if (i%2==1) a=a+i;
    }
 
    printf("%d\n",a);
 
	return 0;
}

整数的个数
描述

给定k(1<k<100)个正整数,其中每个数都是大于等于1,小于等于10的数。写程序计算给定的k个正整数中,1,5和10出现的次数。

输入

输入有两行:第一行包含一个正整数k,第二行包含k个正整数,每两个正整数用一个空格分开。

输出

输出有三行,第一行为1出现的次数,,第二行为5出现的次数,第三行为10出现的次数。

输入样例 1

5
1 5 8 10 5
输出样例 1

1
2
1


#include <stdio.h>
int main()
{
int i, k, x, a1, a5, a10;
a1 = a5 = a10 = 0;
scanf("%d", &k);
for (i = 1;i <= k;++i)
{
scanf("%d", &x);
if (x == 1) ++a1;
if (x == 5) ++a5;
if (x == 10) ++ a10;
}
printf("%d\n%d\n%d\n", a1, a5, a10);
}

满足条件的数累加
描述

将正整数 m 和 n 之间(包括 m 和 n)能被 17 整除的数累加。其中,0 < m < n < 1000。

输入

一行,包含两个整数m和n,其间,以一个空格间隔。

输出

输出一行,包行一个整数,表示累加的结果。

#include<iostream>
using namespace std;
int main()
{
	int m,n,i,s=0;
	cin>>m>>n;
	for(i=m;i<=n;i++)
	{
		if(i%17==0){s=s+i;
		}
		
	}
	cout<<s<<endl;
	return 0;
}

乘方计算
描述

给出一个整数a和一个正整数n,求乘方image.png。

输入

一行,包含两个整数a和n。-1000000 <= a <= 1000000,1 <= n <= 10000。

输出

一个整数,即乘方结果。题目保证最终结果的绝对值不超过1000000。

#include<stdio.h>
#include<math.h>
int main()
{
    int m,n;
    int i,j=1;
    scanf("%d %d",&m,&n);
    for(i=1;i<=n;i++)
    {
        j*=m;
    }
        printf("%d",j);
    return 0;
}

谢谢观看

### 多FPGA板通信烧解决方案 在多FPGA板之间的通信中,烧问题通常是指由于信号传输延迟、时钟同步问题或据完整性问题导致的通信失败或错误。为了解决这些问题,可以采用以下几种方案: #### 1. 据传输协议优化 为了确保据在多FPGA板之间的可靠传输,可以使用更高级的据传输协议。例如,以太网协议可以通过包格式传输据,这种方式比简单的字节传输更具鲁棒性[^2]。通过定义明确的帧结构和校验机制,能够显著减少据传输中的错误。 #### 2. 时钟同步机制 在多FPGA板通信中,时钟同步是一个关键问题。如果各FPGA板的时钟源不同步,可能会导致据采样错误。一种常见的解决方案是使用全局时钟分发网络(Global Clock Distribution Network),或者通过差分时钟信号将主FPGA板的时钟传递到其他从属FPGA板上。此外,还可以利用锁相环(PLL)技术来实现精确的时钟同步[^1]。 #### 3. 高速接口选择 在多FPGA板通信中,可以选择高速行接口(如PCIe、USB3.0、SATA等)或并行接口(如LVDS)。对于长距离通信,推荐使用高速行接口,因为它们具有更好的抗干扰能力和更高的带宽。例如,Cypress USB3.0通信方案可以作为多FPGA板之间通信的一种高效选择[^1]。 #### 4. 据完整性校验 为了确保据在多FPGA板之间的正确传输,可以在发送端添加CRC(循环冗余校验)或其他形式的校验码,并在接收端进行验证。如果检测到据错误,则可以触发重传机制或丢弃错误据包。 #### 5. 硬件设计优化 在硬件设计阶段,应特别注意信号完整性和电磁兼容性(EMC)。合理布局PCB板上的走线,避免信号反射和扰。同时,使用适当的终端电阻匹配策略,以减少信号失真。 ```python # 示例代码:CRC校验生成与验证 def generate_crc(data): crc = 0xFFFF for byte in data: crc ^= byte for _ in range(8): if crc & 0x0001: crc >>= 1 crc ^= 0xA001 else: crc >>= 1 return crc def verify_crc(data, received_crc): calculated_crc = generate_crc(data) return calculated_crc == received_crc ``` #### 6. 软件驱动与固件支持 开发可靠的软件驱动程序和固件也是解决多FPGA板通信烧问题的重要手段。通过编写高效的驱动程序,可以更好地控制硬件资源,提高通信效率。同时,利用FPGA原语和IP核可以加速开发过程,降低复杂度。
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