Verilog
风静雪冷
这个作者很懒,什么都没留下…
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历史状态机
历史状态机能辅助系统进行进行决策,系统可以根据当前状态和历史状态(记录)进行决策和执行相应的行为。原创 2023-06-06 21:05:28 · 559 阅读 · 0 评论 -
一种基于优先级轮询调度负载均衡的crossbar结构
基于轮询调度策略的crossbar,输入和输出都进行优先轮询,端口数可配置。原创 2022-01-17 11:23:36 · 834 阅读 · 1 评论 -
独热码转二进制
独热码转二进制码原创 2021-12-28 13:39:13 · 3014 阅读 · 0 评论 -
二进制码转独热码
二进制码转独热码原创 2021-12-28 13:20:07 · 3894 阅读 · 1 评论 -
一种轮询优先级的仲裁器设计
仲裁器设计原创 2021-12-20 15:27:28 · 1793 阅读 · 0 评论 -
独热码转二进制码
独热码转二进制代码原创 2021-12-20 13:26:04 · 2594 阅读 · 2 评论 -
一种异步类型FTFW FIFO的实现
FTFW FIFO原创 2021-12-17 17:00:59 · 808 阅读 · 0 评论 -
Improving timing for FIFO by adding registers
Every now and then we find that the design's FIFO signals in the critical paths. There are several reasons why a FIFO may be involved:The FIFO's rd_en signal is used in combinatorical logic within the FIFO, which calculates the next read address, which m原创 2021-12-17 15:25:31 · 494 阅读 · 0 评论 -
一种异步类型标准FIFO的实现
一种标准FIFO实现原创 2021-12-17 13:45:25 · 290 阅读 · 0 评论 -
FWFT FIFO的读写操作
FWFT:First Word Fall Through的缩写,是Xilinx的说法,Altera对应的概念是Show-ahead synchronous(SASO)。即数据在rdreq有效之前就有效。需要注意的是当rdreq连续时,容易多读一个数据,所以读时需要对将空(almost_empty)进行判读,在FIFO BFM的代码读任务里有如下代码:if(fifo_rden==1'b1) fifo_rden<=~fifo_alempty;else fifo_rden<=...原创 2021-11-12 18:56:44 · 4465 阅读 · 0 评论 -
状态机的输出寄存-试分析
组合逻辑输出:module data_send_combine( input clk, input reset_n, input reg_enable, //发送使能 input[15:0] path_addr, //包头地址 input[7:0] packet_length, //包长度(单位) input[15:0] packet_sn, //包序号serial number input[15:0] pkt_numb原创 2021-06-25 10:27:38 · 440 阅读 · 0 评论 -
测试`ifdef `endif(可行)
`timescale 1ns / 1ps`define clk_en 1module def_test(`ifdef clk_eninput clk,input rst,output reg[3:0] dout,`endifinput c,input b,input a,output reg[2:0] decoder );wire[2...原创 2019-04-23 18:30:36 · 253 阅读 · 0 评论
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