异步FIFO的深度计算问题

转载 已于 2023-10-09 11:14:05 修改 · 86 阅读 · 0
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#fpga开发 #硬件工程

于 2023-10-09 11:12:17 首次发布
博客提供了一个B站视频链接，未提及视频具体内容，但标签包含fpga开发和硬件工程，推测视频与FPGA开发的硬件工程相关。

摘要生成于 C知道 ，由 DeepSeek-R1 满血版支持， 前往体验 >

原文链接：https://www.bilibili.com/video/BV1Ni4y1S7wJ/?spm_id_from=333.788&vd_source=65d675e934e31cf0001bbefb24e41a65

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FIFO深度计算问题
weixin_47349046的博客
12-26 93
每100个cycle可以写入80个数据，我们考虑最坏的情况，背靠背模式，空20个时钟，剩下80个时钟写80个数据，再用80个时钟写80个数据，空20个时钟，这样的结果就是连着写了160个数据，共用了200个时钟，突发数据个数是160。答：可以看出，B的时钟要大于A的时钟，如果B为读时钟，那么A为写时钟，那就是读时钟大于写时钟，读的比写的快，那么不会溢出了，所以B应该是写时钟，A为读时钟。对于同步fifo，每100个cycle可以写入80个数据，每10个cycle可以读出8个数据，fifo的深度至少为？
异步fifo深度 设计地址格雷码_对FIFO的学习，主要是异步FIFO的设计和FIFO深度计算...
weixin_42508290的博客
01-16 517
FIFO定义：Firstinfirstout先进先出，本质是一种存储结构(RAM)，外部看不到读写地址。传统的按序执行方法，先进入的指令先完成并引退，接着执行第二条命令。优缺点：使用简单，只能顺序读写数据，数据地址由内部读写指针自动加1，不能像普通存储器那样由地址线决定读取或写入固定地址。用途：不同时钟域之间的数据传输一 参数写时钟：写操作所遵循的时钟，每个时钟沿来临时写数据写数据写使能写指针：指...
异步fifo深度的计算
qq_47723149的博客
11-13 366
fifo的写时钟是wr_clk和读时钟是rd_clk，wr_clk = 200M，rd_clk= 8M。wr_clk时钟域中在写使能有效的情况下连续写入2000000个32bit的数据，在写使能无效，无数据输入。fifo的最小深度：5x2000000/125=80000。
异步fifo最小深度计算
chengding0389的博客
03-21 681
再考虑更复杂场景，如果写入数据流在一定周期内不均匀（例如，每100个写时钟周期写80个数，那么就涉及到最恶劣的情况就是，两个100时钟周期的80个数连在一起写入，也就是160个数据100M的写入时钟同时写入fifo），这时引入wr_burst（例中wr_burst =160）;写时钟100M，每100个写周期写80个数，读时钟80M，每个时钟周期都往外读数据，求异步fifo的最小深度。fifo深度_min =写入数据量 / 写时钟频率 * （写时钟频率 - 读时钟频率）；写入速度 = 写时钟频率；
FIFO(四)：异步FIFO的最小深度计算
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风中少年的博客
05-31 3万+
目录 1. 异步FIFO最小深度计算 1.1异步FIFO最小深度计算原理 1.2 异步FIFO最小深度常用计算公式 1. 2.1假如读写FIFO是同时进行的 1.2.2 读写FIFO不是同时进行的情况 2. 异步FIFO最小深度计算实例 2.1 用于SDRAM中的读写FIFO 2.2异步时钟数据接口 3.FIFO实例 1. 异步FIFO最小深度计算 计算FIF...
异步FIFO最小深度的计算
qq_40268672的博客
03-04 3398
异步FIFO通常用于在两个时钟域间传输数据，并且通常情况下，写数据的速率是要比读数据的速率快的，因此，就存在FIFO最小深度的一个问题，以防止在数据传输时发生溢出，造成数据的丢失。 在计算FIFO最小深度时，我们一般考虑极端情况，即在一段时间内写速率达到最大，此时由于读数据慢于写数据，因此需要设置一个FIFO的最小深度，来保证数据不丢失。 CASE1 写速率fA=80MHzf_A = 80MHzfA​=80MHz 读速率fB=50MHzf_B = 50MHzfB​=50MHz 突发长度BurstLength
异步fifo深度计算
weixin_44072819的博客
03-17 321
转https://www.cnblogs.com/lgy-gdeu/p/12891678.html
【数字IC前端】异步FIFO深度计算
ultra777的博客
06-15 1809
以下内容搬运自公众号：硅农，原文链接附下：原文连接 Case-1：fA > fB 读写之间没有空闲周期Case-2：fA > fB 在两个连续读写之间有一个周期的延迟Case--3：fA > fB读写都有空闲周期（IDLE Cycles）Case-4：fA > fB并给出了读写使能的百分比Case-5：fA < fB 读写操作无空闲周期（每两个连续读写之间有一个周期延迟）Case-6：fA < fB 读写操作有空闲周期（读写使能占得百分比问题）Case-7：fA = f
异步fifo深度 设计地址格雷码_异步FIFO设计
weixin_35996612的博客
01-16 586
概述前面提及到同步FIFO的设计，同步FIFO。但是在大规模的数字电路设计中，多时钟域往往是不可避免的，这样就会产生了跨时钟域传输等问题，为了解决跨时钟域问题，我们常常采取的方法是握手协议和异步FIFO做数据缓冲区，异步FIFO既可以使相异时钟域数据传输的时序要求变得宽松，也提高了它们之间的传输效率。设计思路如上图中所示，左边是写时钟域中的信号，右边则是读时钟域中的信号，中间存在两个同步...
异步FIFO最小深度计算方法及原理分析
yundanfengqing_nuc的专栏
03-30 4325
计算FIFO深度是设计FIFO中常遇到的问题。常识告诉我们，当读速率慢于写速率时，FIFO便可被用作系统中的缓冲元件或队列。因此FIFO的大小基本上暗示了所需缓存数据的容量，该容量取决于读写数据的速率。据统计，系统的数据速率取决于系统的负载能力。因此为了保证FIFO的大小，我们需要考虑FIFO传输的最坏情况下。所谓最坏的情况就是使得写速率最大，读速率最小；通常是考虑突发传输。 一、异步FIFO最小深度计算原理 如果数据流连续不断则FIFO深度无论多少，只要读写时钟不同源同频则都会丢数； FI...
异步FIFO深度 计算模型以及详细推导.docx
07-28
"异步FIFO深度计算模型详解" 在数字电路设计中，异步FIFO（First-In-First-Out）是一种常用的数据缓冲器结构，它可以解决时钟域-crossing问题，即在异步时钟域之间传输数据时，防止数据丢失或错误。但是在异步FIFO...
fifo.rar_FIFO 深度_FIFO深度计算_fifo_fifo 深度计算
09-19
在面试中，FIFO深度计算是衡量候选人对数字逻辑和系统级设计理解的一个常见问题。它不仅涉及到基本的数学计算，还涵盖了系统设计的原理和实践经验。因此，对这个主题的深入理解将使你在求职过程中更具竞争力。通过...
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06-05
We need to employ an asynchronous FIFO between two modules working at different clock domains when some amount of data has to be transmitted from one module to the other to avoid the data loss. FIFO ...
异步fifo深度计算例题的波形图
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读100m，每3拍来一个数据，写40m，每拍都往外读
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