学习记录(持续学习中):阻塞和非阻赛赋值,和使用原则

本文介绍了阻塞式和非阻塞式赋值在数字逻辑设计中的特点和应用场景。阻塞式赋值特点是立即执行且会阻塞其他同类赋值,常用于建立组合逻辑;而非阻塞赋值则不阻塞其他语句,适用于时序电路建模和在同一always过程中的混合使用。理解这两种赋值方式对于VHDL或Verilog编程至关重要。

阻塞式赋值
1.特点:
a.当前语句执行完后才会执行下一条语句。赋值是立即发生的(无指定延时)
b.执行过程中其他同类赋值语句必须停止工作。
2.赋值方式:
a.未指定延时赋值:目标变量名 = 驱动表达式;
b.指定延时赋值方式有两种:

C = #2 A+B;
#2 C = A+B;

非阻塞赋值
1.特点:
a.语句执行不会影响同一过程块中其他语句执行(不会阻塞)。
b.多条非阻塞是同步赋值操作,具有并行执行的特点。
2.赋值方式
a.未指定延时: 目标变量名 <= 驱动表达式 ;
b.指定延时赋值方式有两种:

C <= #2 A+B;
#2 C <= A+B;

阻塞非阻塞使用原则
1.时序电路建模使用非阻塞赋值。
2.always 过程预计建立组合逻辑采用阻塞赋值
3.同一个always 过程语句建立时序和组合逻辑电路时用非阻塞
4.同一个always 不能采用非阻塞又采用阻塞

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