CesiumJS【Pro】- #14 标签避让

本文探讨了Cesium中的标签避让效果,这是一种在可视化系统中常见的视觉优化技术。内容涉及源代码的介绍。

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标签避让

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标签避让是可视化系统中常见的效果。

1. 源代码

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 * @Author: alan.lau
 * @Date: 2023-11
### 详解 在 **Allegro PCB Designer** 中进行布线是完成电路板设计的关键步骤,主要包括交互式布线、差分对布线、等长布线和自动布线等功能。以下是标准操作流程与技巧: --- #### 1. 布线前准备 - ✅ 完成元件布局(Placement) - ✅ 设置好 **Layer Stackup**(层堆叠) - ✅ 配置 **Design Rules**(电气与物理规则,如线宽、间距、差分布线等) - ✅ 检查网络连接性(Connectivity)是否完整 路径:`Setup > Constraints > Physical / Spacing` --- #### 2. 启动交互式布线 使用命令: ``` Route > Connect ``` 或快捷键 `X` 进入布线模式。 点击一个焊盘(Pin),软件会高亮显示飞线(Ratsnest),提示需连接的下一个目标点。 --- #### 3. 实时布线控制 - 📏 **动态长度显示**:布线时显示当前走线长度,便于控制等长。 - ⚙️ **Hug & Push**:智能避让已有走线与过孔,支持推挤布线。 - 🔁 **Smooth 功能**:自动优化走线拐角平滑度。 可通过右侧选项面板设置: - `Routing Style`:选择预设线宽与过孔组合 - `Rounding`:设置拐角角度(建议 $45^\circ$ 或圆弧) --- #### 4. 添加过孔(Via) - 在布线过程中按 `V` 可手动插入过孔切换层; - 确保 **Via Type** 已定义并在规则中允许使用; - 若提示 “No available via”,请检查层堆叠与规则限制。 --- #### 5. 差分对布线(Differential Pairs) 启用命令: ``` Route > Differential Pairs ``` - 需提前在约束管理器中定义差分网络; - 使用专用规则控制差分阻抗、线距(Gap)、耦合方式; - 支持 $90^\circ$ 弯曲补偿(Mitered Corner)。 --- #### 6. 等长布线(Length Tuning) 使用: ``` Route > Delay Tuning ``` - 调整走线长度以满足时序要求(如DDR信号); - 目标长度可在约束管理器中设定; - 支持蛇形走线(Meander)自动生成。 --- #### 7. 自动布线(Auto Router) 可外接 **Allegro Auto Router** 或导入第三方工具(如 SPECCTRA): - 设置好约束后运行全局布线; - 推荐仅用于非关键信号; - 关键信号仍建议手动布线。 --- #### 8. 布线完成后的检查 - 运行 **DRC(Design Rule Check)** - 执行 **Unconnected Pin Check** 确保无悬空网络 - 查看 **Electrical Rules Report** --- ### 知识点 - **交互式布线机制**:通过实时反馈引导用户完成精确走线,支持推挤、绕行与自动避让功能。 - **约束驱动布线(Constraint-Driven Routing)**:布线行为受预先设定的物理与电气规则控制,确保信号完整性。 - **差分对与时延匹配**:用于高速信号传输,需保持等长、等距与恒定阻抗,防止信号失真。
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10-25
您提供的内容属于对“Allegro PCB如何布线”的详细技术解答,符合**普通文本型**问题类型。 以下是对该内容的优化补充与结构化整理,便于实际工程应用: --- ### Allegro PCB 布线完整指南 #### ✅ 一、布线核心流程概览 | 步骤 | 操作内容 | |------|----------| | 1. 准备阶段 | 完成布局、层堆叠、规则设置 | | 2. 启动布线 | 使用 `Route > Connect` 或快捷键 `X` | | 3. 手动布线 | 沿飞线连接引脚,支持推挤和避让 | | 4. 特殊网络处理 | 差分对、等长、电源走线单独优化 | | 5. 后期检查 | DRC、未连接点、时序验证 | --- #### ✅ 二、关键操作技巧 ##### 1. 快捷键速查表 | 功能 | 快捷键 | |------|--------| | 开始布线 | `X` | | 切换层并打过孔 | `V` | | 修改线宽 | 右侧面板实时调整或按 `Ctrl+W` | | 放弃当前走线 | `Esc` | | 平滑走线 | `Route > Slide` 或 `F9` | | 查看长度 | 布线时右下角动态显示总长 | > 提示:可自定义快捷键路径为 `Setup > User Preferences > pcb_editor > scripting` --- ##### 2. 走线模式说明 - **Hug Mode(贴合)**:紧贴障碍物边缘绕行; - **Push Mode(推挤)**:推动已有走线以腾出空间; - **Walkaround Mode(绕行)**:自动寻找绕行路径; - **Smooth Mode(平滑)**:布线结束后自动优化拐角。 可通过右侧 Options 面板切换模式。 --- ##### 3. 线宽与过孔组合管理 在 `Constraints > Physical Constraints Set` 中定义: ```text Name: DEFAULT Line Width: 0.15mm (6mil) Via Size: 0.3mm outer / 0.15mm drill ``` 对于高速信号(如USB、DDR),需单独建立规则集。 --- ##### 4. 层切换与过孔策略 - 每次按 `V` 插入一个过孔,软件自动识别可用 Via 类型; - 若无法打孔,请检查: - 当前层是否允许布线; - 是否处于禁布区(Keepout Zone); - Via Type 是否被禁用(`Manufacture > NC Parameters`)。 --- ##### 5. 高速信号专项布线 ###### 🔹 差分对布线(Differential Pairs) 1. 在约束管理器中创建差分对: `Setup > Electrical > Net Classes > Add Differential Pair` 2. 使用命令:`Route > EtherNet / Differential Pair` 3. 设置差分阻抗(如 $100\Omega \pm 10\%$)、线距(Gap)、耦合方式(Edge-Coupled) > 支持 $45^\circ$ 拐角与 Miter 补偿,减少反射。 ###### 🔹 等长调谐(Delay Tuning) 使用命令:`Route > Delay Tuning` - 目标长度可在 `Constraints > Model Assignment` 中设定; - 软件自动生成蛇形线(Meander),可调节幅度与节距; - 支持锁定现有走线区域避免干扰。 --- #### ✅ 三、常见问题与解决 | 问题 | 原因 | 解决方案 | |------|------|-----------| | 无法开始布线 | 网络未激活或飞线未生成 | 执行 `Add Connect` 或刷新网络 | | 提示“No available via” | 层堆叠错误或规则限制 | 检查 Layer Stackup 与 Via 规则 | | 走线不推挤 | Push/Hug 功能关闭 | 在 Options 中启用 Push 或 Walkaround | | 自动删除走线段 | 存在短路风险 | 检查相邻网络间距与 DRC 设置 | --- #### ✅ 四、布线完成后的必要检查 1. **运行 DRC** `Tools > Verify Design` → Check Constraints 2. **确认所有网络连通** `Display > Show Ratsnest` 查看是否有残留飞线 3. **电气规则报告** `Reports > Electrical Rules Report` 检查短路、开路 4. **输出光绘文件前** 执行 `Database Check` 确保数据一致性 --- ### 知识点 - **交互式布线机制**:通过实时反馈引导用户完成精确走线,支持推挤、绕行与自动避让功能。 - **约束驱动布线(Constraint-Driven Routing)**:布线行为受预先设定的物理与电气规则控制,确保信号完整性。 - **差分对与时延匹配**:用于高速信号传输,需保持等长、等距与恒定阻抗,防止信号失真。
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