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RSS订阅原创 RISC-V设计之Decoder的封装与函数(二)
RISC-V设计中的封装与函数优化 本文介绍了RISC-V处理器设计中使用SystemVerilog封装和函数替代传统宏定义的方法。通过创建opcodes包封装指令解析功能，文章还对比了不同场景下的最佳实践：枚举类型用typedef enum，模块常量用localparam，跨模块常量用package+localparam，仅条件编译保留宏定义。
2025-07-02 04:10:18
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原创 RISC-V 开发笔记分享
本文分享RISC-V开发笔记，重点解析RV32I指令集架构。主要内容包括：主流芯片架构对比表，RV32I的6种指令格式（R/I/S/SB/U/UJ）及其位域分布，5级流水线结构（Fetch-Decode-Execute-Memory-WriteBack），以及关键设计实现要点。笔记将持续更新，预计2025年9月逐步开源完整设计。
2025-06-26 20:03:05
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空空如也
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