Quartus Internal Error subsystem /..../...../amerge amerge_merger_op.cpp line:911

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#FPGA #VHDL #quartus #nios #Verilog

在使用Quartus 10.0进行FPGA设计时，遇到在Analysis & Synthesis阶段末尾报内部错误，具体为AMERGE子系统amerge_merger_op.cpp的第911行。尽管单独编译VHDL或Verilog模块无误，但在综合阶段出现问题。网上找到的解决方案大多针对AMERGE子系统在amerge_kpt_op.cpp的第220行错误。

公司用Quartus 10.0。编译单个模块的vhdl或者verilog没有错误。偏偏在第一部Analysis & Synthesis的最后一点（大概97%）处，弹出一个错误对话框，大致内容是：

Quartus Internal Error subsystem /..../...../amerge amerge_merger_op.cpp line:911


搜罗了一下网上的解决方法，大部分的针对的问题都是：

Internal Error: Sub-system: AMERGE, File: /quartus/atm/amerge/amerge_kpt_op.cpp, Line: 220

Quartus官网正解是：
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具体的一张错误如下图： 可能你的错误不是这样的，但是会出现Fatal Error。 具体解决方法： intel官网解释： Internal Error: Sub-system: RVD, File: /quartus/rtlv/rvd/rvd_netlist_component.cpp, Line: 9067 Description Due to a problem in the Quartus® II software version 13.0 Web Edition, y...
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每周把一些很实用的工作日志保存下来，以便于后面的查用。如果同时能给大家带来点帮助，那我也就心满意足啦。 如果你喜欢本文，欢迎转载，但请注明出处。本文出自：http://blog.csdn.net/ok_wolf/article/details/7487416   2012-4-13 1、编译radar_signal_gen工程时出错了： 错误信息如下： Internal Error:
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