淡淡的雪2005-优快云博客

原创时序约束——flatten sdc继承规则

get_pins—— 一般是ip内部pll/phy的时钟，需要从db的genclk关系中，找到rootclk，并定义上。get_ports—— 来自topcgu，可以继承，基于该port，找到所有的时钟来源。1.3set_output_delay—— ip级接口延时无意义。1.2set_input_delay—— ip级接口延时无意义。1.1set_max_delay—— 单独交付一份文件。

2025-01-16 17:04:43 229

原创 fm工具——lib 中存在 short 导致不等

ip netlist 输出的2个信号sig1和sig2，在lib里会short到一起。fm比较的时候，如果吃了ip的黑盒子，工具认为没有undriven ,从而报不等。emma认为short会导致不等，undriven是我们看错了，这点没理解。注释lib里的short,重新生成db，fm pass。

2024-12-25 17:32:18 132

原创时序分析——sram冲突/组合逻辑不做clockgate检查

组合逻辑 set_disable_clkgate_check。对于没有读写冲突的sram, 可以增加前2段约束。

2024-12-25 17:25:55 214

原创 pt命令——项目实践中交付文件的生成方式

生成dont touch list。生成memory list。

2024-12-25 17:20:36 201

原创 pt 消除 check_timing 报告里 not constrained for maximum delay

pt 消除 check_timing 报告里 not constrained for maximum delay。或者尝试方法2 将dft信号 false path。设置input delay。

2024-12-25 16:00:43 159

原创【vcs zero delay loop 排故记录】

vcs zero delay loop

2022-11-10 11:12:04 1305

空空如也

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原创 时序约束——flatten sdc继承规则

原创 fm工具——lib 中存在 short 导致不等

原创 时序分析——sram冲突/组合逻辑不做clockgate检查

原创 pt命令——项目实践中交付文件的生成方式

原创 pt 消除 check_timing 报告里 not constrained for maximum delay

原创 【vcs zero delay loop 排故记录】

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原创时序约束——flatten sdc继承规则

原创时序分析——sram冲突/组合逻辑不做clockgate检查

原创【vcs zero delay loop 排故记录】