FPGA中边沿触发和电平触发

最新推荐文章于 2024-09-06 11:18:02 发布
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原文链接：http://www.cnblogs.com/shaonianpi/p/9325526.html
本文详细介绍了触发器和锁存器的工作原理及其主要区别。触发器在时钟信号的边沿触发下读取输入信号并锁存，而锁存器则在使能信号处于特定电平时跟随输入信号变化，直到使能信号改变状态。此外，文章还通过单片机引脚输入中断的例子进一步说明了两者之间的不同。

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边沿触发和电平触发基本就是触发器和锁存器的区别：

触发器是边沿触发，只有当时钟上升（或下降）的一瞬间，触发器会读取并锁存输入信号。输出信号仅在时钟信号上升（或下降）的一瞬间会发生变化。
 
锁存器是电平触发，只要使能（enable）信号处于高电平（或低电平），输出就会随着输入信号变化，直到使能信号变为低电平（或高电平）时，输出才会锁存，不再随输入变化。

 

本质上锁存器并不能叫触发，叫使能更合适些，这样就不会混淆了

 

以单片机引脚输入中断为例:

边沿触发，只会在电平变化时出现一次中断。
电平触发，只要电平为触发电平，会一直触发中断，即使清零了，还会再次进入。

 

转载于:https://www.cnblogs.com/shaonianpi/p/9325526.html

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