Dun_呀-优快云博客

原创【shift_ram IP core的使用】

Shift_rom IP core的使用

2022-09-27 21:36:38 1461 1

原创 FPGA时序分析中的建立时间与保持时间(看完就懂)

FPGA时序分析中的建立时间与保持时间

2022-09-27 10:35:53 4420 2

原创【基于FPGA的运动目标实时跟踪检测】

基于FPGA运动目标实时跟踪

2022-09-13 20:38:45 3620 8

原创 FPGA实现灰度转换：RGB转YCBCR

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2022-09-01 16:32:50 2963 1

原创【同步FIFO Verilog&IC】详解

同步FIFO Verilog&IC

2022-07-28 15:04:43 718

原创【序列信号发生器(IC)】

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2022-07-19 16:03:26 4997

原创 Verilog分频器

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2022-07-18 20:07:10 4831 2

原创超前进位加法器(Verilog&数字IC)

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2022-07-15 21:34:02 3218

原创 Verilog取信号的上升沿与下降沿

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2022-07-08 17:46:10 5195

原创 Verilog状态机常见三种写法

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2022-07-02 21:29:14 11833

原创【Modelsim仿真让状态机波形显示状态名字】

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2022-06-30 16:40:17 1743

原创 Verilog的顺序和并行浅谈

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2022-06-21 10:55:43 4624 1

原创 HDLBits-circuit系列

HDLBits-circuit系列解析

2022-06-20 17:31:41 234

原创 HDLBits-Exams/review2015 fancytimer

HDLBits-Exams/review2015 fancytimer解析

2022-06-15 19:56:38 551

原创 HDLBits-Exams/review2015 fsm

HDLBits-Exams/review2015 fsm状态图代码解析

2022-06-15 17:52:39 520

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