实现一个简单的UART驱动程序

FPGA驱动程序实现UART外设接收功能 起始位指示数据的开始,停止位指示数据的结束,数据位包含实际传输的数据,校验位用于检测数据传输中的错误。实现FPGA驱动程序来接收UART外设的数据是一项常见的任务。在本文中,我们将介绍如何使用Verilog HDL编写FPGA驱动程序,以实现UART外设的接收功能,并提供相应的源代码示例。为了实现UART外设的接收功能,我们需要使用FPGA开发板上的IO引脚来连接UART外设,并编写相应的驱动程序来处理接收到的数据。为了实现UART外设的接收功能,我们需要编写一个FPGA驱动程序。 阅读详情

在DragonOS中,为了方便调试,实现了一个简单的UART驱动程序。

https://github.com/fslongjin/DragonOS/tree/master/kernel/driver/uarticon-default.png?t=M3K6https://github.com/fslongjin/DragonOS/tree/master/kernel/driver/uart

原理不难,就简单讲讲吧。

uart驱动程序工作的原理就是往指定的io端口写入数据,每次传送8个bit。

其中,io端口与com口的对应关系如下:

COM端口号IO端口基地址
10x3f8
20x2f8
30x3e8
40x2e8
50x5f8
60x4f8
70x5e8
80x4e8

每个COM口有8个寄存器,功能如下:

UART Registers
Base AddressDLABI/O AccessAbbrv.Register Name
+00WriteTHRTransmitter Holding Buffer
+00ReadRBRReceiver Buffer
+01Read/WriteDLLDivisor Latch Low Byte
+10Read/WriteIERInterrupt Enable Register
+11Read/WriteDLHDivisor Latch High Byte
+2xReadIIRInterrupt Identification Register
+2xWriteFCRFIFO Control Register
+3xRead/WriteLCRLine Control Register
+4xRead/WriteMCRModem Control Register
+5xReadLSRLine Status Register
+6xReadMSRModem Status Register
+7xRead/WriteSRScratch Register

The “x” in the DLAB column means that the status of the DLAB has no effect on what register is going to be accessed for that offset range. Notice also that some registers are Read only. If you attempt to write data to them, you may end up with either some problems with the modem (worst case), or the data will simply be ignored (typically the result). As mentioned earlier, some registers share a Port I/O address where one register will be used when you write data to it and another register will be used to retrieve data from the same address.

1.1.1. 设置波特率

波特率的设置是通过设置divisor来实现的,

1.1.2. 发送与接收数据

操作就是先读取标志位,确认是否端口处于忙的状态,然后从DATA_REG读取数据。

在写UART驱动程序的过程中,参考了资料:https://github.com/fslongjin/DragonOS/tree/master/kernel/driver/uart

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灯珑
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