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RSS订阅原创 systemverilog如何用一行code输出两个队列在可变范围内的对比结果
使用 SystemVerilog 的 and() 方法，并通过 with 子句来对比 array1 和 array2 的前几个元素。这个方法相对简洁，通过 and() 结合条件表达式来完成对比工作。
2024-09-08 16:06:22
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原创 systemverilog 之 disable fork
disable fork 用来终止这些并行进程。然而，直接使用 disable fork 会杀死当前作用范围内所有的并行进程，影响过于广泛。为了避免这种情况，可以使用以下两种方法来限制 fork 的范围：为 fork 加别名，或使用 guard fork。
2024-09-08 15:54:42
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原创 systemverilog中，多层for循环如何跳出某一层
嵌套的 for 循环结构，并在某个条件下通过 disable 语句来终止一个特定的循环块
2024-09-08 15:49:36
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原创 在 SystemVerilog 中，sort() 方法可以对动态数组进行排序，并且支持使用 with 子句来指定排序的依据字段。通过这种方式，排序不仅会改变排序字段的顺序，还会同步更改其他与之相关的字
在 SystemVerilog 中，sort() 方法可以对动态数组进行排序，并且支持使用 with 子句来指定排序的依据字段。通过这种方式，排序不仅会改变排序字段的顺序，还会同步更改其他与之相关的字段，即整个结构体或数组元素保持对应关系。
2024-09-06 21:02:39
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原创 systemverilog & UVM 日常杂记
打印 class 中所有变量，并且希望某些变量以十进制格式显示，可以在定义和注册变量时使用。1、在 UVM 中，如果需要通过。
2024-09-06 20:52:13
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原创 systemverilog & uvm & class 定义所有模块通用变量值
systemverilog & uvm & class 定义所有模块通用变量值
2024-08-31 09:56:35
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原创 systemVerilog assertion 中variable delay的使用，##[variable]，带变量的延时(可变延时)
systemVerilog assertion 中variable delay的使用，##[variable]，带变量的延时(可变延时)
2023-05-13 11:10:04
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原创 学习和工程中常用的matlab代码
1、求取曲线的斜率和切线a = [47 21; 46 20; 45 19; 44 19;43 18; 42 19;41 20;42 21;43 22].';sp = spline(1:size(a,2),a);dsp = fnder(sp);d = fnval(dsp, 5);k = d(2)/d(1);ai = fnval(sp, linspace(1, size(a, 2)));plot(a(1,:), a(2,:),'r+')line(ai(1,:), ai(2,.
2020-08-03 13:42:58
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原创 利用MATLAB对ad准换的16进制数据进行转换为模拟电压信号\数据解算
1、说明由于本ad为12位ad，故计算方法为：采集值为0x7FFF，则对应电压值=0x7FFF*20/2^16。2、利用MATLAB的具体处理过程将16进制的8位数据分成低4位和高4位，然后将相连的3个4位数据项连接，构成12位数据，注意：由于串口是先从低位传输，然后从高位传输，所以编写应该注意。% function：用于对陀螺1_HYM51陀螺仪进行解算的代码% author ：Mr Peng% time ：2019年11月11日16:49:33raw_dat
2020-06-06 11:26:11
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原创 xilinx USB Cable 无法找到，ise低版本下载程序出错
当在ise中通过jtag下载程序时（本人电脑windows 10 ，64位），出现如下错误：GUI --- Auto connect to cable...INFO:iMPACT - Digilent Plugin: Plugin Version: 2.4.4INFO:iMPACT - Digilent Plugin: no JTAG device was found.AutoDetecting cable. Please wait.*** WARNING ***: When port is s
2020-05-26 22:57:00
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原创 如何利用matlab循环读取文件夹中的文件
第一步：创建数据文件夹在桌面创建一个名为《如何利用matlab循环读取文件夹中的文件》的文件夹，在再这个文件夹里面创建几个子文件夹，如下图所示；第二步：在每个文件夹里面放好数据文件，我这里以.txt文件为列子。具体的如下图所示：对于上面的文件，为了能当输入文件的顺序时能读取文件中的数据，故编写了如下的代码：clcclearclose all;%% 读取各个文件夹...
2019-12-18 23:45:27
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对于在工业探伤领域中，由于焊接过程出现的各种问题，导致焊缝中含有气孔和裂纹等缺陷进行检测识别
2018-05-06
在FPGA开发平台上，通过按键控制一个弹球小游戏。输出VGA显示信号输送到显示器上显示。
2018-05-02
采用切线逼近方法求解IEEE14节点电力系统多目标的无功优化问题，目标为发电机无功总出力和网损。
2018-05-06
systemverilog的svlib资料，在原来的基础上新增两个关于字符串/int和objec按照数组注册的宏定义
2024-09-04
SDPT3版本4.0:MATLAB/Octave软件，用于半定积分二次线性规划
2020-05-24
自动售货机模拟程序，UML图并实现该程序
2020-06-06
DDR3的控制器（并带有Testbench），可烧录到FPGA中对内存进行读写，相关技术人员可在该代码上修改用于其他场合
2019-10-04
研究生数学建模.txt
2019-09-11
hostlink 通信基于LAbview和omronPLC1111
2019-10-04
空空如也
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