sumblime + icarus Verilog 数字电路仿真

最新推荐文章于 2025-07-13 15:41:34 发布
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分类专栏： verilog 文章标签： sublime
本文介绍如何使用Sublime Text 3配合Icarus Verilog编译器进行前端开发工作，包括设置编译环境、利用gtkwave查看波形图等操作步骤。文中还提供了具体的数据选择器功能函数示例。

摘要生成于 C知道 ，由 DeepSeek-R1 满血版支持， 前往体验 >

sublime text3 前端

icarus Verilog编译器(内含gtkwave波形显示)

数据选择器功能函数：


激励函数：


仿真测试：


主要用到的语法高亮，REPL等Packages_Sublime可点击下载，粘帖到sumblime的Preference -> browse packages里，重启sublime即可

在编译时需要将Tools -> Build System切换为Verilog 按ctrl+B即可编译

在REPL中输入vvp a.out可生成波形图文件(*.vcd，名字为激励函数中的命名)

接着输入gtkwave ff.vcd，点击所需要查看的数据，插入 即可得到波形图如下


可以看到当S = 0时，输出等于D0，当S = 1时，输出等于D1。

以后有空再写详细一点。

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