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RSS订阅原创 【HDLbits刷题】Building Larger Circuits（待续）
笔者开始对照一些书籍上的代码，让自己的代码风格做出改进，具体上是编码方式与命名上的改进。。。
2024-11-17 22:18:16
204
原创 虚拟机设置共享文件夹的一般方法
此教程并不详细，只是大致概括，需要配合网上其他教程食用，看了老多教程都没解决，直到https://zhuanlan.zhihu.com/p/650638983。-o allow_other 表示普通用户也能访问共享目录。/mnt/hgfs/ 是挂载点，我们也可以修改为其它挂载点。
2024-11-15 18:29:04
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原创 【HDLbits刷题】有限状态机FSM(十二）
考虑下面所示的状态图所描述的FSM：该FSM充当仲裁器电路，其控制三个请求设备对某种类型的资源的访问。每个设备通过设置信号r[i]= 1来请求资源，其中r[i]是r[1]、r[2]或r[3]。每个r[i]都是FSM的输入信号，代表三个器件之一。只要没有请求，FSM就保持在状态A。当一个或多个请求发生时，FSM决定哪个设备接收到使用资源的授权，并改变为将该设备的g[i]信号设置为1的状态。每个g[i]都是FSM的输出。存在优先级系统，其中设备1具有比设备2更高的优先级，并且设备3具有最低的优先级。
2024-11-07 21:17:37
574
原创 【HDLbits刷题】有限状态机FSM(十一）：Q3a/b/c，Q6b\c\*,Q2b
观察可得，该时序图描述的是对输入不灵敏的，即输出仅与当前状态有关，有滞后性。可以设计一个计数器，再B状态时记录w， z的输出仅与计数器有关。这里设置4个状态代码参考了https://github.com/Shengrong-LSR/HDLBits-Solutions-Verilog/blob/master/3_Circuits/2_Sequential%20Logic/5_Finite%20State%20Machines/142_FSM.v，其重要注意对cnt的处理。
2024-11-07 19:23:42
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原创 【HDLbits刷题】有限状态机FSM(十）：Moore FSM and Mealy FSM
Mealy 状态机：输出依赖当前状态和当前输入。Moore 状态机：输出仅依赖当前状态，与输入无关。状态转换图参考博客：https://blog.youkuaiyun.com/weixin_66492206/article/details/140778180?Mealy 状态机。。优点：响应速度较快，因为输出可以根据输入立即改变。缺点：输出对输入敏感，可能导致时序问题（如短暂的毛刺输出）。例子：输出在当前状态和输入都满足一定条件时立即改变。Moore 状态机。。
2024-10-31 10:10:33
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原创 *【HDLbits刷题】有限状态机FSM(九）：Q8:Design a Mealy FSM
Mealy 状态机输出依赖：当前状态和当前输入。特点：当输入发生变化时，输出可以立即更新，不需要等待下一个时钟周期。优点：响应速度较快，因为输出可以根据输入立即改变。缺点：输出对输入敏感，可能导致时序问题（如短暂的毛刺输出）。例子：输出在当前状态和输入都满足一定条件时立即改变。Moore 状态机输出依赖：仅依赖当前状态，与输入无关。特点：输出只有在状态改变时才会变化，输入的变化不会立即影响输出。优点：输出稳定，不会因为输入的短暂变化导致输出毛刺。
2024-10-30 21:42:51
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2原创 【HDLbits刷题】有限状态机FSM(七）：Fsm serial
设置4个状态IDLE:空闲状态START: 接收数据状态STOP: 成功接收到结束位状态WAIT:等待结束位状态注意：1.有错误会被丢弃，或参考https://github.com/Shengrong-LSR/HDLBits-Solutions-Verilog/blob/master/3_Circuits/2_Sequential Logic/5_Finite State Machines/135_Serial receiver.v。
2024-10-29 22:20:46
430
原创 *【HDLbits刷题】有限状态机FSM(五)单热编码One-Hot Encoding
单热编码是一种在数字逻辑和计算机科学中常用的方法，用于表示有限个状态或项目的方式。在单热编码中，使用一个比特数组来表示状态，数组中只有一个位是1，其余的都是0。这个为1的位指示了当前的状态或激活的项目。
2024-10-22 19:46:36
399
原创 *【HDLbits刷题】有限状态机FSM（四）：Lemmings3和4
【代码】*【HDLbits刷题】有限状态机FSM（四）：Lemmings3和4。
2024-10-17 21:28:27
315
原创 【HDLbits刷题】有限状态机FSM（三）：Lemmings1和2（待续）
*部分翻译：**Lemmings时一个游戏，很简单，我们来用无限状态机去模拟它。在L的2D世界，L可以行动二选一：向左走或向右走。如果 L 撞到一个障碍，L将改变方向。如果L被bump_left，L将向右走。如果L被bump_right，L将向左走。如果L被bump_right&&bump_right，他将左右乱走（左右都变）。。。（看电路图）
2024-10-13 16:46:46
297
原创 (*)【HDLbits刷题】有限状态机FSM（二）:Exams/ece241 2013 q4
【代码】*【HDLbits刷题】有限状态机FSM（二）:Exams/ece241 2013 q4。
2024-10-13 15:09:56
788
原创 【HDLbits刷题】更多电路
规则90是一种具有有趣特性的单维元胞自动机。规则很简单。系统由一个一维的单元数组（开或关）组成。在每个时间步，每个单元的下一个状态是该单元当前的两个邻居的异或（XOR）。更详细的描述如下表，其中一个单元的下一个状态是自身和其两个邻居的函数：（“规则90”的名称来源于读取“下一个状态”列的二进制值：01011010，即十进制的90。在这个电路中，创建一个512个单元的系统（q[511:0]），并在每个时钟周期推进一个时间步。load 输入指示系统的状态应该加载为 data[511:0]。
2024-10-11 11:27:11
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原创 【HDLbits刷题】移位寄存器（三）
考虑一个n位的移位寄存器如下图所示为这个移位寄存器写一个顶层的verilog模块，假设n=4。实例化4片MUXDFF，你将实施这个回路在一个DE2板子上。借鉴的别的博主，我都代码与他的思路一样，不知为何不能过。
2024-10-10 11:40:17
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原创 【HDLbits刷题】移位寄存器（二）
写时序电路代码（其他模块随便命名，除了top-module）。你将要在DE1-SoC开发板上实现一个电路。把R输入到SW开关，时钟连接到KEY【0】，L连接到KEY【1】.Q输出连接到红色LED指示灯（LEDR）。
2024-10-09 09:54:15
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原创 Typora and Markdown 初体验~
一边看使用Typora编写Markdown你真的会了吗 - deeround - 博客园 (cnblogs.com)一边做的记录!!!绝非原创哇!前面一大段没记录,直接看末尾链接跳转学习文章目录前面一大段没记录,直接看末尾链接跳转学习分割线由单独一行的,3个以上的 ***** / **-** / **_** 标记脚注有序列表无序列表任务列表引用图片链接网址链接锚点代码行内代码代码块围栏代码块表格表情符号高亮上标下标转义目录好复杂先学到这,搁置用着(借鉴)前面一大段没记录,直接看末尾链接跳转学习分割线由
2022-04-05 21:27:09
352
空空如也
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