内存映射文件初步学习

 HANDLE hFile = NULL;
 HANDLE hFileMaping = NULL; 
 SYSTEM_INFO sysInfo;
 GetSystemInfo(&sysInfo);
 DWORD dwPageSize = sysInfo.dwAllocationGranularity;

 do
 {
  hFile = CreateFileW(L"D://pfsvoddata.bbv", GENERIC_READ,
       FILE_SHARE_READ, NULL, OPEN_ALWAYS,
       FILE_ATTRIBUTE_NORMAL, NULL);

  if (INVALID_HANDLE_VALUE == hFile)
  {
   break;
  }

  hFileMaping = CreateFileMappingW(hFile, NULL, PAGE_READONLY, 0, 0,
           L"jyytest");
  if (NULL == hFileMaping)
  {
   break;
  }
  CloseHandle(hFile);
  hFile = NULL;

  DWORD dwFileHight = 0;;
  __int64 n64FileSize = GetFileSize(hFile, &dwFileHight);
  n64FileSize += ((__int64) dwFileHight) << 32;
  __int64 n64FileMapOffSet = 0;

  do
  {
   DWORD dwMapSize = dwPageSize;
   if (dwMapSize > n64FileSize)
   {
    dwMapSize = (DWORD) n64FileSize;
   }

   DWORD dwOffsetLow =(DWORD) (n64FileMapOffSet & 0x00000000FFFFFFFF);
   DWORD dwOffsetHight = (DWORD) ((n64FileMapOffSet & 0xFFFFFFFF00000000) >> 32);

   int *pValue = (int *) MapViewOfFile(hFileMaping, FILE_SHARE_READ,
            dwOffsetHight, dwOffsetLow, dwMapSize);  //特别要注意一次的 偏移为64K的整数倍
   if (NULL == pValue)
   {
    UnmapViewOfFile(pValue);

    break;
   }

   n64FileMapOffSet += dwMapSize;
   n64FileSize -= dwMapSize;

   UnmapViewOfFile(pValue);

  } while (n64FileSize > 0);

 } while (0);

 getchar();

内容概要:本文详细介绍了基于FPGA的144输出通道可切换电压源系统的设计与实现,涵盖系统总体架构、FPGA硬件设计、上位机软件设计以及系统集成方案。系统由上位机控制软件(PC端)、FPGA控制核心和高压输出模块(144通道)三部分组成。FPGA硬件设计部分详细描述了Verilog代码实现,包括PWM生成模块、UART通信模块和温度监控模块。硬件设计说明中提及了FPGA选型、PWM生成方式、通信接口、高压输出模块和保护电路的设计要点。上位机软件采用Python编写,实现了设备连接、命令发送、序列控制等功能,并提供了一个图形用户界面(GUI)用于方便的操作和配置。 适合人群:具备一定硬件设计和编程基础的电子工程师、FPGA开发者及科研人员。 使用场景及目标:①适用于需要精确控制多通道电压输出的实验环境或工业应用场景;②帮助用户理解和掌握FPGA在复杂控制系统中的应用,包括PWM控制、UART通信及多通道信号处理;③为研究人员提供一个可扩展的平台,用于测试和验证不同的电压源控制算法和策略。 阅读建议:由于涉及硬件和软件两方面的内容,建议读者先熟悉FPGA基础知识和Verilog语言,同时具备一定的Python编程经验。在阅读过程中,应结合硬件电路图和代码注释,逐步理解系统的各个组成部分及其相互关系。此外,实际动手搭建和调试该系统将有助于加深对整个设计的理解。
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