使用modelsim仿真时出现“vopt returned success but vsim could not find a design to simulate!”错误

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#仿真器 #verilog

本文讲述了在使用ModelSim进行仿真时遇到的'找不到设计'错误，解决过程包括禁用仿真优化、修改VoptFlow参数，最终发现问题是由于安装路径包含空格。解决方案是重新安装到不含空格的路径下。

使用modelsim仿真时出现“vopt returned success but vsim could not find a design to simulate!”错误


使用modelsim仿真时出现错误
** Note: (vsim-3812) Design is being optimized…
** INTERNAL ERROR: vopt returned success but vsim could not find a design to simulate!
首先依照http://bbs.eetop.cn/thread-267821-1-1.html尝试禁用仿真优化，结果无效。
后根据https://ask.youkuaiyun.com/questions/755122尝试修改modelsim.ini中的VoptFlow参数，结果依然无效。
最后发现问题出在我把modelsim安装在“E:\Program Files\modelsim”，其中路径有空格。卸载重装在“E:\modelsim\”目录下，问题解决。

Modelsim（1）
qq_65054077的博客
05-15 221
Please contact customer support for further assistance.在破解过程中****\Modelsim\win64下的mgls.dll和mgls64.dll都需要取消只读属性（不确定）。在运行完patch_dll.bat后会弹出LICENSE.TXT，在这里我是另存的，因为不确定到底生成在哪里，且****\Modelsim下不带后缀的LICESE不是我们所需要的。名称参考上面的文章。以上分别是verilog，.v文件和testbench，.vt文件。
Modelsim10.7仿真报错
qq_45776815的博客
04-23 4193
不要使用-novopt，10.7之前的版本可以这样，但10.7似乎不行。为了避免模块端口被优化掉，使用vsim -voptargs=+acc就可以了。把之前老版本的modelsim换掉了，新的装好仿真发现有点小毛病，记录以下。显然并不是这里的问题，后来看到有说是由于软件安装路径中存在空格，尝试修改。使用modelsim10.7仿真时出现错误，编译通过但报以下错误。重新仿真，修改优化选项，信号显示出来可以查看仿真。重新仿真，端口被优化掉了，看不到波形。导致的，就取消了仿真优化。取消后出现了新的错误。
2021-10-31
weixin_38342120的博客
10-31 2661
这里写自定义目录标关于题欢迎使用Markdown编辑器新的改变功能快捷键合理的创建标题，有助于目录的生成如何改变文本的样式插入链接与图片如何插入一段漂亮的代码片生成一个适合你的列表创建一个表格设定内容居中、居左、居右SmartyPants创建一个自定义列表如何创建一个注脚注释也是必不可少的KaTeX数学公式新的甘特图功能，丰富你的文章UML 图表FLowchart流程图导出与导入导出导入 欢迎使用Markdown编辑器 你好！ 这是你第一次使用 Markdown编辑器 所展示的欢迎页。如果你想学习如何使用M
【Verilog之Generate for用法注意事项】
zwt154451的博客
07-29 1114
Verilog之Generate for用法注意事项
modelsim vopt
u010170039的博客
01-25 4232
model sim学习笔记 运行ModelSim SE 6.5e,选择菜单Help->SE Documentation - PDF Bookcase，在出来的pdf文档中，选择ModelSim SE Tutorial，作为学习ModelSim的第一站。 Tutorial学习笔记： Chapter1: Introduction介绍 1,假定：熟悉操作系统，懂一种设计语言（verilog,V
ModelSim 使用笔记1
weixin_33884611的博客
03-22 352
 ModelSim提供了简单仿真方式，还有一种要建立project，目前这种方式暂时够我用了。总结了以下，做了一个简单的《modelsim quick start》。  简单方针模式下面，操作步骤如下（黄色字符部分为每个操作对应的script指令,打开modelsim软件，在script窗口输入这些指令即可）：1.新建library。“file->new->library"。选择lib...
modelsim基本命令
crjmail的博客
11-11 1万+
以前在使用ModelSim进行仿真的时候，一直是使用其GUI进行操作的，但是这样很繁琐也很费时。故希望学习其自动化仿真do文件，下面是学习的一些总结。 一、编写基本的do文件 下面按照实际仿真的步骤来说明do文件中需要用到的各个tcl命令。 1、quit -sim ---- 退出原来的仿真工程； 2、cd ---- 设置工作目录的路径，就是仿真工程路径； 3、vlib work ---- 在工作目录下建立一个work目录，请注意不要用操作系统直接新建一个work的文件夹，因为用操作系统建立的work文件夹并
Fatal: Internal Error - vopt returned success but vsim could not find a design to simulate!. Please contact customer support for further assistance. # Error loading design在modelsim中出现此中问题怎么办
最新发布
09-23
虽然提供的引用中未直接提及“Fatal: Internal Error - vopt returned success but vsim could not find a design to simulate!. Please contact customer support for further assistance. # Error loading design...
# vsim -t 1ps -L altera_ver -L lpm_ver -L sgate_ver -L altera_mf_ver -L altera_lnsim_ver -L cycloneive_ver -L rtl_work -L work -voptargs=""+acc"" tb_led # Start time: 14:40:21 on Jul 15,2025 # ** Note: (vsim-3812) Design is being optimized... # ** Fatal: Internal Error - vopt returned success but vsim could not find a design to simulate!. Please contact customer support for further assistance. # Error loading design # Error: Error loading design # Pausing macro execution # MACRO ./led_run_msim_rtl_verilog.do PAUSED at line 40
07-16
在ModelSim仿真中，遇到错误提示 `vsim error: vopt returned success but vsim could not find a design to simulate cycloneive_ver` 通常表明仿真工具无法找到需要仿真的设计模块。以下是一些可能的原因和解决...
ModelSim SE仿真Altera库的常见仿真错误问题合集
08-03
当在ModelSim SE中仿真Altera库时，用户可能会遇到一些常见的错误。本文将详细探讨这些错误的常见原因以及如何解决这些问题。 在使用ModelSim SE仿真Altera库时，用户首先需要确保正确调用Altera的库文件。通常，...
【Modelsim常见问题】Error: (vsim-3170) Could not find
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**Error: (vsim-3170) Could not find '……simulation/modelsim/rtl_work.HEX4_tb'. Error loading design 问题原因 testbench文件名与其中module 后紧跟的名称不匹配，如下图文件名为HEX4_tb，而实际文件中的module名为HEX_tb： 而在设置testbench链...
解决modelsim出现Error: (vish-4014) No objects found matching ‘sim:/test/tb_top/xxx/xxx/xxx‘.
摸鱼宗宗主的博客
11-03 3542
这个问题的出现主要是添加波形上面。也就是我们在修改代码之前添加了一些波形，并保存在了仿真脚本里面，也就是后缀为.do的文件当中，当我们的测试架构发生改变之后，有些信号相对也发生了改变，这个时候就会报错，提示匹配不到单引号里面的信号。 最简单的解决办法就是重新生成一个do文件。或者打开do文件，把添加波形的部分代码删掉即可。 对应的添加波形部分的代码举例如下： add wave -position insertpoint \ sim:/test/tb_top/xxx/xxx/xxx \ sim:/test/
Modelsim 使用教程（2）——Basic Simulation
apple_53311083的博客
11-01 2225
在本文中，我们详细介绍了Modelsim仿真的一个基本流程，并做出了详细的步骤指导。包括有Create the Working Design Library（创建工具库） Compile the Design Units（编译设计单元） Optimize the Design（优化设计） Load the Design（加载设计） Run the Simulation（运行仿真）
modelsim独立仿真教程
u013749478的博客
03-26 3683
一．GUI界面的仿真步骤 1.首先把你需要仿真的设计文本和仿真文本全部放在同一个文件夹下面，注意，文件夹路径不能包含中文。 我的设计文件：counter.v `timescale 1ns / 1ns module counter (count, clk, reset); output [7:0] count; input clk, reset; reg [7:0] count; parameter tpd_reset_to_count = 3; parameter tpd_clk_to_count =
Modelsim编译、仿真报告关于novopt的错误（vlog-12110）
lijun1217815的博客
11-27 6158
做FPGA项目开发，编写完成的代码或新搭建的工程一般都会先放到Modelsim中仿真，测试功能是否满足要求。之前因为FPGA开发软件版本的原因，仿真时用到的Modelsim版本也一直是10.6e。在对Modelsim破解时，只需要将modelsim.ini中的VoptFlow参数从1改为0，后续就可以正常使用。最近有项目用到Xilinx的芯片，开发软件也统一到了Vivado 2021.2，恰好又有一些对Xilinx官方ip的仿真需求。
quartus调用modelsim仿真时弹出“voptk.exe已停止工作”的解决办法
老吕的博客
03-12 2016
首先需要确认的是你的verilog设计能编译通过，在Quartus ii 里面也就是能完成“Analyse&Synthesis”，然后再确认你的testbench无语法及逻辑错误，一般调用Modelsim，假如.v源文件或者.v测试文件有语法错误，console中会有错误提示，请先修正语法错误。 　　如果源文件语法没有错误，但是仍然会弹出”voptk.exe已停止工作“，如果观察到Mode...
quartus ||13.0联合modelsim altera se 10.1.d仿真，出现自动退出问题
我欲乘风归去
04-23 3161
卸载爱奇艺。     本来是好的，两天后再来用，发现出现仿真自动退出，好不容易看到了提示代码：exiting with code211，然后就各种找原因，试过重装，破解，环境变量，重启，一开始都以为是licenses问题，后面看到一个贴吧回答，卸载爱奇艺，这跟爱奇艺也有关系？？？但是我中间是装了一个爱奇艺，死马当活马医，试试，还真可以了。我可是花了一天的时间各种找问题啊，原来是你个鬼爱
报错：internal command error 的解决办法
2301_80317247的博客
11-08 3566
如果上面那个办法成功不了，或者说你的服务案件根本就是失灵的，那就是你的供电电流不够检查一下你的电源电路，最重要的是跟三伏三接地电源相关，也就是芯片的供电电流。相关的电阻电容是否赋值符合预期设计的原理图大小。第1种办法是1+2的复位键点击下载，等一段时间再松开复位机就可以100%下载成功。
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