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原创 tsmc 5nm lvs之 short难搞的类型
2、M1, M2由于cell 内部出pin,且pin的位置非常近的情况,且dengsity也很高的情况下。可以利用删除附近的buf,但是得注意buf的类别,已经关于该buf相关的path是否有timing margin,不然也不能删除,然后再去处理short问题。1、M3层以上的层次发生的short,dengsity很高的情况下,两根信号net导致的short,删除其中一根然后ecoRoute fix不掉的情况下,该怎么办,可以尝试去cut 周围或者上方的power。
2025-08-03 15:05:03
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原创 redHawk环境搭建
初始化目录结构designn_data相关数据准备主要配置的文件top.gsr 左边的是配置完的文件,右边的是参考模板这两段可以注释 需要再配置这几个选项自己根据项目情况来跑完查看相应的报告主要看两点:功耗以及drop值
2024-01-22 18:20:30
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原创 star脚本
有关star.cmd 里面 要修改下面的1. 修改 BLOCK : bp_top 这个为 TOP_DEF_FILE : your_final_top.def.gz2. 修改 MILKYWAY_DATABASE : xxxx 为 LEF_FILE : ./all_lef/tech.lef ./all_lef/stdcell.lef ./all_lef/macro.lef ( 也就是你所有的lef file 列表,用 空格空下 ,第一个是tech l
2024-01-11 17:19:13
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原创 实际项目cts之cdb
一般插入了很多cdb类型的cell说明是为了将tree做平导致tree太长了解决方案将对应module的pin 都设置成ignore
2023-11-15 17:17:39
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原创 innovus 出gds
如果导出的gds发现少了某个ip模块 ,需要确认对应的gds和lef文件种的design name是否相同。其中list的第一gds是streamOut出来的gds。一、需要准备gds文件和mapfile文件。
2023-07-27 17:40:08
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原创 innovus pad摆放相关技巧
bottom:第一个就是bottom最左边的那个位置。right:第一个就是right最下边的那个位置。left:第一个就是left最下边的那个位置。top:第一个就是top最左边的那个位置。
2023-06-16 14:03:29
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原创 数字后端抽取lib
这样工具就会在pt/etm目录下生成两个lib文件,一个是cortexa7core wc.lib用于setup分析,一个是cortexa7core bc.lib用于hold分析。这样工具就会在data目录下生成两个lib文件,一个是cortexa7core wc.lib用于setup分析,一个是cortexa7core bc.lib用于hold分析。
2023-06-09 12:38:21
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原创 calibre跑drc、lvs、插dummy
用 ll -lrtF 可以看到有个 svdb目录 ,calibredrv -m gds文件 -rve svdb 可以查看open的情况。(1)Input database 下的LAYOUT PATH 和 LAYOUT PRIMARY。(1)Input database 下的LAYOUT PATH 和 LAYOUT PRIMARY。2、编写merge BEOL.gds(产生的dummy gds)和之前准备的gds。产生的 .db文件可以查看short。1、修改rule文件。1、修改rule文件。
2023-05-18 21:37:36
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空空如也
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