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RSS订阅原创 System Generator的FIR Compiler 7.2 1滤波器使用与增益修正
本文主要介绍了基于基于System Generator的FIR Compiler 7.2 1的原理与使用方法,之后再详细介绍如何修正fir滤波器的输出,使得增益为1,最后说明如何实现抽样滤波器。使用的软件是System Generator 2018.3(基于vivado 2018.3)与matlab2018a。
2025-02-26 09:43:28
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原创 System Generator的CIC Compiler 4.0使用方法
本文主要介绍了基于基于System Generator的CIC Compiler 4.0的原理与使用方法。使用的软件是System Generator 2017.4(基于vivado 2017.4)与matlab2016b。
2024-07-31 09:58:49
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原创 基于FPGA的PS2键盘识别
本实验以通用的 PS2键盘为输入,设计一个能够识别PS2键盘输入编码的电路,,当按下 Shift 键时,可以实现大小写的切换显示。
2024-06-21 15:32:25
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原创 基于FPGA的VGA小霸王游戏机(附源码)
设计并实现基于FPGA的硬件平台，兼容小霸王游戏机的经典游戏。支持VGA接口，能够将游戏画面输出到现代显示器上。
2024-06-12 22:24:35
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原创 基于FPGA的VGA图像显示
本文主要介绍了基于FPGA的VGA图像显示原理及操作过程。使用的软件是Quartus Ⅱ，该实验使用fpga芯片为cyclone IV EP4CE115F29C7。
2024-03-26 10:15:44
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原创 基于FPGA的flash读写操作-S29GL064N-DE2-115
利用FPGA板及flash外设，编写代码实现按键按下写入flash,并且断电验证是否写入成功,读出的数据显示在lcd1602显示屏上,并且可以实现擦除数据功能。FPGA内板载flash芯片没有使用spi-flash进行操作,而是单纯使用S29GL064N的flash芯片,所有引脚直接连接到fpga板块。
2023-12-04 23:33:09
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原创 基于FPGA的rs232串口通信
串口接发送,设计实现接收PC机发送的信息,并发送信息给PC机FPGA接收到hello后,回复ni,hao给PC机
2023-11-11 17:19:10
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原创 基于FPGA的模块化多功能数字钟
本文主要介绍了模块化数字钟设计的过程及代码,有五个功能,包括:时间显示功能,夜光模式功能,计时功能,闹钟功能,调时功能,
2023-10-20 14:54:08
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原创 基于c语言-高中生信息管理系统
-->高中生信息管理系统 该设计要求学生以学生管理业务为背景，对“学生信息管理系统”软件进行分析和设计。 将学生信息管理系统划分为：学生基本资料管理、成绩管理、统计查询管理、系统设置等。
2023-04-17 00:41:15
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原创 基于MATLAB的数字通信系统仿真设计
% 基于matlab的数字通信系统仿真主要模块：信源、信源编码、信道编码，调制；信道；解调制、信道译码、信源译码、信宿；
2022-07-14 13:53:02
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原创 EDA实验(Quartus Ⅱ+fpga) (六)--基于FPGA的LPM定制波形信号发生器
LPM定制信号发生器：（1）数字化波形数据存在ROM中，ROM用LPM进行设计；（2）正弦波或方波、锯齿波波形可选并数码管显示所选波形种类；（3）信号频率、幅度可调并用数码管显示频率和幅值；（4）用SignalTap逻辑仪器观察信号波形。
2022-02-06 19:38:51
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原创 EDA实验(Quartus Ⅱ+fpga) (四)---交通灯设计
前言：本文主要介绍了EDA原理与应用这门课程的相关实验及代码。使用的软件是Quartus Ⅱ，该实验使用fpga芯片为cycloneⅤ 5CSEMA5F31C6。（一）实验目的（1）熟悉交通灯控制器的工作原理；（2）了解设计中的优化方案；（3）进一步掌握状态机的设计；（4）学习较复杂数字系统设计。（二）设计要求实现一个由一条主干道和一条乡间公路形成的十字路口的交通灯控制器功能：（1）有MR（主红）、MY（主黄）、MG（主绿）、CR（乡红）、CY（乡黄）、CG（乡绿）六盏交通灯需要控制；（
2022-01-23 21:12:43
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原创 EDA实验(Quartus Ⅱ+fpga) (三)---状态机的设计-序列发生和检测器设计
前言：本文主要介绍了EDA原理与应用这门课程的相关实验及代码。使用的软件是Quartus Ⅱ，该实验使用fpga芯片为cycloneⅤ 5CSEMA5F31C6。（一）实验目的掌握序列发生和检测的工作原理；掌握时序电路中状态机的应用；掌握用Verilog语言实现复杂时序电路的设计过程。（二）实验要求设计序列发生和检测器：（1）先实现串行序列发生器的设计，产生序列0111010011011010；再设计检测器，若检测到串行序列11010则输出为“1”，否则输出为“0”，并对其进行仿真和硬件测试
2022-01-23 21:01:58
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原创 EDA实验(Quartus Ⅱ+fpga) (二)---时序电路的设计-模可变计数器设计
前言：本文主要介绍了EDA原理与应用这门课程的相关实验及代码。使用的软件是Quartus Ⅱ，该实验使用fpga芯片为cycloneⅤ 5CSEMA5F31C6。（一）实验目的（1）进一步熟悉EDA开发板和QuartusⅡ软件的使用方法。（2）学习静态数码管的使用和7段数码显示译码器设计；（3）掌握时钟在时序电路中的作用；（4）掌握分频电路的实现方法。（二）实验要求设计模可变计数器，可任选模的大小（例模15、模115），实验要求：（1）设置一位控制位M，要求M=0：模X计数；M=1：模Y计
2022-01-23 20:50:45
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原创 EDA实验(Quartus Ⅱ+fpga) (一)---层次法设计组合电路-四位全加器的设计
前言：本文主要介绍了EDA原理与应用这门课程的相关实验及代码。使用的软件是Quartus Ⅱ，该实验使用fpga芯片为cycloneⅤ 5CSEMA5F31C6。（一）实验目的（1）掌握基本组合逻辑电路的 FPGA实现；（2）学习 Verilog HDL 的多层次设计方法；（3）熟练应用 Quartus II 进行 FPGA开发。（二）实验要求以4位二进制全加器为例：（1）先用Verilog HDL文本实现一位全加器，再在原理图环境中调用一位全加器完成4位全加器的设计，熟悉层次设计概念；（
2022-01-23 19:45:45
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