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原创 FPGA实现k- means

终于撺出来了。

2024-12-16 19:01:37 88

原创【vivado】vivado2018.3 can not generate ddr3 example , top module is invalid ?

解决：生成前需要重新 Generate IP Output Products，再生成example例程。问题：对配置好的mig核生成example工程时，生成的工程没有顶层文件。

2024-12-07 17:29:31 196

空空如也

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