software_base-compile_debug-makefile

本文详细介绍了如何使用makefile、configure.in、automake和autoconf等自动化工具,完成从源码到可执行文件的构建过程,包括配置、生成Makefile、编译和安装等步骤。同时,解释了如何针对不同CPU类型进行配置优化,以及如何使用这些工具构建发布软件包。

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====make file
使用autoscan把目录中的所有源码文件生成一个configure.scan。
mv configure.scan configure.in
sublime configure.in #修改其中内容
aclocal  #create m4
autoconf #create configure using m4
创建Makefile.am,并加入内容。
automake --add-missing #create Makefile.in from am
./configure #create Makefile
make #make
./hellomake #run it


===configure.in内容说明(抄录)
AC_INIT(FILE)
这个宏用来检查源代码所在的路径。


AM_INIT_AUTOMAKE(PACKAGE, VERSION) 
这个宏是必须的,它描述了我们将要生成的软件包的名字及其版本号:PACKAGE 是软件包的名字,VERSION 是版本号。当你使用make dist 命令时,它会给你生成一个类似helloworld-1.0.tar.gz 的软件发行包,其中就有对应的软件包的名字和版本号。


AC_PROG_CC
这个宏将检查系统所用的C 编译器。


AC_OUTPUT(FILE)
这个宏是我们要输出的Makefile 的名字。


===Makefile.am内容说明(抄录)
AUTOMAKE_OPTIONS
这个是automake 的选项。在执行automake 时,它会检查目录下是否存在标准GNU 软件包中应具备的各种文件,例如AUTHORS 、ChangeLog 、NEWS 等文件。我们将其设置成foreign 时,automake 会改用一般软件包的标准来检查。


bin_PROGRAMS
这个是指定我们所要产生的可执行文件的文件名。如果你要产生多个可执行文件,那么在各个名字间用空格隔开。


helloworld_SOURCES
这个是指定产生“helloworld” 时所需要的源代码。如果它用到了多个源文件,那么请使用空格符号将它们隔开。比如需要 helloworld.h ,helloworld.c 那么请写成helloworld_SOURCES= helloworld.h helloworld.c 。


如果你在bin_PROGRAMS 定义了多个可执行文件,则对应每个可执行文件都要定义相对的filename_SOURCES 。


===更多命令(抄录)
make install
将编译成功的可执行文件安装到系统目录中,一般为/usr/local/bin 目录。


make dist
产生发布软件包文件(即distribution package )。这个命令将会将可执行文件及相关文件打包成一个tar.gz 压缩的文件用来作为发布软件的软件包。


它会在当前目录下生成一个名字类似“PACKAGE-VERSION.tar.gz” 的文件。PACKAGE 和VERSION ,是我们在configure.in 中定义的AM_INIT_AUTOMAKE(PACKAGE, VERSION) 。


make distcheck
生成发布软件包并对其进行测试检查,以确定发布包的正确性。这个操作将自动把压缩包文件解开,然后执行configure 命令,并且执行make ,来确认编译不出现错误,最后提示你软件包已经准备好,可以发布了。


====configure支持arm指令集或cpu类型的配置
类比有配置优化的configure.in。
推导发散:
不一定是configure.in,不一定都通过这个来生成configure,比如也可能为configure.ac。
ffmpeg(ios)的configrue.in?--not found
https://autotools.io/autoconf/arguments.html




====install autoconf and automake(抄录)
curl -O http://mirrors.kernel.org/gnu/m4/m4-1.4.13.tar.gz
tar -xzvf m4-1.4.13.tar.gz
cd m4-1.4.13
./configure --prefix=/usr/local
make
sudo make install
cd ..
curl -O http://mirrors.kernel.org/gnu/autoconf/autoconf-2.65.tar.gz
tar -xzvf autoconf-2.65.tar.gz
cd autoconf-2.65
./configure --prefix=/usr/local # ironic, isn't it?
make
sudo make install
cd ..
# here you might want to restart your terminal session, to ensure the new autoconf is picked up and used in the rest of the script
curl -O http://mirrors.kernel.org/gnu/automake/automake-1.11.tar.gz
tar xzvf automake-1.11.tar.gz
cd automake-1.11
./configure --prefix=/usr/local
make
sudo make install
cd ..
curl -O http://mirrors.kernel.org/gnu/libtool/libtool-2.2.6b.tar.gz
tar xzvf libtool-2.2.6b.tar.gz
cd libtool-2.2.6b
./configure --prefix=/usr/local
make
sudo make install
<think>我们正在讨论的是逻辑综合中的compile_ultra命令及其选项。根据用户查询,用户希望了解如何使用compile_ultra命令并配合选项-no_autoungroup, -gate_clock, -scan, -retime进行逻辑综合与优化。 首先,我们需要明确这些选项的含义: - `-no_autoungroup`: 禁用自动取消组(autoungroup)功能。默认情况下,compile_ultra会自动取消组层次结构以进行跨边界优化。使用此选项可以保留层次结构。 - `-gate_clock`: 启用时钟门控(clock gating)优化。这有助于减少动态功耗。 - `-scan`: 启用扫描链(scan chain)插入。这用于可测试性设计(DFT)。 - `-retime`: 启用时序重定时(retiming)优化。这可以在不改变功能的情况下移动寄存器以改善时序。 接下来,我们考虑如何编写命令。在Design Compiler中,compile_ultra是进行高级综合的命令。结合这些选项,命令可以写成: ```tcl compile_ultra -no_autoungroup -gate_clock -scan -retime ``` 但需要注意的是,有些选项可能需要额外的设置。例如: - 使用`-scan`选项前,通常需要设置DFT相关变量(如`set_scan_configuration`等)以定义扫描链结构。 - `-gate_clock`选项可能需要事先定义时钟门控单元(例如使用`set_clock_gating_style`命令)。 此外,为了确保综合过程正确,我们还需要设置其他综合环境,例如: - 设置目标库(target library)和链接库(link library) - 设置操作条件(operating conditions) - 定义时钟(使用`create_clock`命令)和输入输出延迟(使用`set_input_delay`和`set_output_delay`) 下面是一个简单的示例脚本框架: ```tcl # 设置库文件 set target_library "your_target_library.db" set link_library "* $target_library" # 读取设计 read_verilog your_design.v current_design your_top_module link # 设置时钟(假设时钟端口为clk,周期为10ns) create_clock -name clk -period 10 [get_ports clk] # 设置输入输出延迟(示例) set_input_delay -clock clk 2 [all_inputs] set_output_delay -clock clk 3 [all_outputs] # 设置扫描配置(如果使用-scan) set_scan_configuration -style multiplexed_flip_flop # 设置时钟门控风格(如果使用-gate_clock) set_clock_gating_style -positive_edge_logic integrated # 执行compile_ultra compile_ultra -no_autoungroup -gate_clock -scan -retime # 保存结果 write -format verilog -hierarchy -output synthesized_design.v ``` 注意事项: 1. 选项`-scan`和`-gate_clock`可能会相互影响,需要确保设计规则检查(DRC)通过。 2. 使用`-retime`时,设计中的寄存器可能会被移动,因此需要确保设计中没有不允许重定时的部分(例如多周期路径或异步逻辑)。 3. 由于`-no_autoungroup`保留了层次结构,可能会影响优化效果,但有利于后续的模块化流程。 用户可能需要根据具体的设计和需求调整这些设置。同时,建议在综合后运行报告命令(如`report_timing`,`report_area`,`report_power`)来评估结果。 最后,关于引用,我们参考了之前提供的引用内容,特别是引用[4]中关于`create_clock`命令的说明。在设置时钟时,我们使用了类似的语法。 相关问题: 1. 如何验证使用这些选项后的综合结果是否满足时序要求? 2. 在综合过程中如何处理多时钟域? 3. 使用`-scan`选项时,如何避免测试模式下的时序违规?</think>### 逻辑综合中的 `compile_ultra` 命令详解 在逻辑综合流程中,`compile_ultra` 是 Synopsys Design Compiler 的高阶优化命令。结合选项 `-no_autoungroup -gate_clock -scan -retime` 可实现特定优化目标: ```tcl compile_ultra -no_autoungroup -gate_clock -scan -retime ``` #### 选项功能解析 1. **`-no_autoungroup`** - 禁用自动层次结构扁平化,保留原始设计层次。 - **作用**:便于后续模块化分析和增量优化,避免跨层次优化导致的调试困难。 2. **`-gate_clock`** - 启用时钟门控(Clock Gating)优化。 - **原理**:自动插入门控单元(如 ICG 单元),在时钟无效时关闭寄存器时钟端,降低动态功耗。 - **功耗公式**:动态功耗 $P_{\text{dyn}} \propto f \cdot C \cdot V^2$,门控后有效降低开关活动因子。 3. **`-scan`** - 插入扫描链(Scan Chain)结构。 - **DFT 要求**:需提前配置扫描链参数: ```tcl set_scan_configuration -style multiplexed_flip_flop set test_default_delay 0 ``` - **输出**:生成带扫描使能(SE)、扫描输入(SI)、扫描输出(SO)端口的网表。 4. **`-retime`** - 启用时序重定时(Retiming)优化。 - **机制**:跨组合逻辑移动寄存器位置,平衡关键路径延迟。 - **约束**:需满足 $T_{\text{clk}} > T_{\text{comb\_max}}$,否则可能违反时序。 #### 关键依赖配置 - **时钟定义**(引用[4]): 必须正确定义时钟周期和波形: ```tcl create_clock -name CLK -period 10 -waveform {0 5} [get_ports clk] ``` - **输入延迟约束**(引用[2]): ```tcl set_input_delay -clock CLK 1.5 [all_inputs] ``` - **编译选项**(引用[3]): 若需 C++11 支持(如 SystemC 模型): ```tcl add_compile_options -std=c++11 # 需注意跨语言兼容性 ``` #### 执行流程示例 ```tcl # 1. 基础设置 set target_library "slow.db" set link_library "* $target_library" # 2. 时钟与约束(引用[4][2]) create_clock -period 10 [get_ports clk] set_input_delay 2 -clock clk [all_inputs] # 3. DFT 预配置 set_scan_configuration -chain_count 1 # 4. 执行综合 compile_ultra -no_autoungroup -gate_clock -scan -retime # 5. 结果输出 write -format verilog -hierarchy -output design_scan.v report_power > power.rpt ``` #### 注意事项 1. **`-gate_clock` 与工艺库**:需工艺库提供门控单元(ICG),否则优化无效。 2. **`-scan` 冲突**:若设计已包含扫描链,需先移除冗余扫描单元。 3. **`-retime` 风险**:可能改变初始状态行为,需验证复位序列。 4. **层次保留**:`-no_autoungroup` 可能降低优化程度,需权衡调试需求与 QoR。 ---
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