failed parsing /data/system/wallpaper_info.xml java.io.FileNotFoundException

本文探讨了在Android系统中遇到的桌面背景设置错误,特别是由于移除启动动画导致的壁纸信息文件丢失问题。通过分析wallpaper_info.xml文件内容,解释了其作用并提供了修复方法,最终成功解决了桌面背景显示为黑色的问题。

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出现这个I/SystemServer(  167): Wallpaper Service

W/WallpaperService(  167): failed parsing /data/system/wallpaper_info.xml java.io.FileNotFoundException: /data/system/wallpaper_info.xml: open failed: ENOENT (No such file or directory)

就会直接出现进入launcher后,发现桌面背景全是黑色的。

这个wallpaper_info.xml的内容如下:

<?xml version='1.0' encoding='utf-8' standalone='yes' ?>
<wp width="1024" height="1024" name="" />

就这短短2行。

哎。这个问题是我去掉开关机动画造成的。可是加上就没有了。。。

[Common 17-165] Too many positional options when parsing 'data_proc/data_proc_tdi/line_fifo_gen[4].line_fifo/xpm_fifo_base_inst/gen_sdpram.xpm_memory_base_inst/gen_wr_a.gen_word_narrow.mem_reg data_proc/data_proc_tdi/line_fifo_gen[4].line_fifo/xpm_fifo_base_inst/FSM_sequential_gen_fwft.curr_fwft_state_reg[1] data_proc/data_proc_tdi/line_fifo_gen[4].line_fifo/xpm_fifo_base_inst/gen_fwft.empty_fwft_i_reg data_proc/data_proc_tdi/line_fifo_gen[4].line_fifo/xpm_fifo_base_inst/gen_pntr_flags_cc.ram_empty_i_reg data_proc/data_proc_tdi/line_fifo_gen[4].line_fifo/xpm_fifo_base_inst/gen_pntr_flags_cc.ngen_full_rst_val.ram_full_i_reg data_proc/data_proc_tdi/line_fifo_gen[4].line_fifo/xpm_fifo_base_inst/FSM_sequential_gen_fwft.curr_fwft_state_reg[0] data_proc/data_proc_tdi/line_fifo_gen[5].line_fifo/xpm_fifo_base_inst/rdp_inst/count_value_i_reg[1] data_proc/data_proc_tdi/line_fifo_gen[5].line_fifo/xpm_fifo_base_inst/rdp_inst/count_value_i_reg[3] data_proc/data_proc_tdi/line_fifo_gen[5].line_fifo/xpm_fifo_base_inst/rdp_inst/count_value_i_reg[5] data_proc/data_proc_tdi/line_fifo_gen[5].line_fifo/xpm_fifo_base_inst/rdp_inst/count_value_i_reg[2] data_proc/data_proc_tdi/line_fifo_gen[5].line_fifo/xpm_fifo_base_inst/rdp_inst/count_value_i_reg[4] data_proc/data_proc_tdi/line_fifo_gen[5].line_fifo/xpm_fifo_base_inst/rdp_inst/count_value_i_reg[6] data_proc/data_proc_tdi/line_fifo_gen[5].line_fifo/xpm_fifo_base_inst/rdp_inst/count_value_i_reg[7] data_proc/data_proc_tdi/line_fifo_gen[5].line_fifo/xpm_fifo_base_inst/rdp_inst/count_value_i_reg[8] data_proc/data_proc_tdi/line_fifo_gen[5].line_fifo/xpm_fifo_base_inst/rdp_inst/count_value_i_reg[0] data_proc/data_proc_tdi/line_fifo_gen[5].line_fifo/xpm_fifo_base_inst/wrp_inst/count_value_i_reg[1] data_proc/data_proc_tdi/line_fifo_gen[5].line_fifo/xpm_fifo_base_inst/wrp_inst/count_value_i_reg[4] data_proc/data_proc_tdi/line_fifo_gen[5].line_fifo/xpm_fifo_base_inst/wrp_inst/count_value_i_reg[0] data_proc/data_proc_tdi/line_fifo_gen[5].line_fifo/x
03-11
<think>好的,我现在需要解决用户在XPM FIFO模块中遇到的“Too many positional options”错误,特别是涉及`line_fifo_gen`和`xpm_fifo_base_inst`组件的问题。这个问题通常出现在VHDL或Verilog代码中,当实例化模块时位置参数的数量超过了模块定义所允许的数量。 首先,我应该回忆一下XPM库的使用方法。XPM(Xilinx Parameterized Macros)是Xilinx提供的参数化宏模块,允许用户通过参数配置来生成不同的硬件模块。在实例化这些模块时,如果使用位置参数(即按顺序传递参数),参数数量不匹配就会导致错误。 用户提到的错误信息“Too many positional options”提示可能存在两种可能性:一种是实例化时传递了过多的位置参数,另一种是模块定义中的参数列表发生了变化,导致位置参数数量不匹配。例如,Xilinx可能在更新XPM库后调整了某些模块的参数顺序或数量,导致旧代码不再兼容。 接下来,我需要考虑如何指导用户解决这个问题。首先,检查代码中的实例化部分,确认传递的参数数量是否与模块定义一致。如果用户使用的是位置参数,建议改用命名参数关联(named parameter association),这样可以避免参数顺序或数量变化带来的问题。例如,在Verilog中,实例化模块时应该明确指定每个参数的名称,而不是依赖位置顺序。 然后,查阅Xilinx官方文档,确认`xpm_fifo_base`模块的参数列表,确保用户代码中的参数名称和数量与最新文档一致。例如,`xpm_fifo_base`可能有一些必需的参数,如`FIFO_WRITE_DEPTH`、`READ_MODE`等,用户需要正确配置这些参数。 此外,用户可能在使用`line_fifo_gen`脚本或工具生成FIFO代码时,没有正确设置参数,导致生成的实例化代码包含过多的位置参数。这时候需要检查生成脚本或工具的配置选项,确保生成的代码符合当前XPM版本的要求。 另外,参考用户提供的错误链接,其中提到关于位置参数过多的问题,可能需要检查代码中实例化语句的格式。例如,在VHDL中,如果使用类似`port map (signal1, signal2, ...)`的位置映射方式,而模块的端口数量或顺序有变化,就会出错。改用名称映射如`port map (port1 => signal1, port2 => signal2, ...)`可以避免这个问题。 最后,建议用户更新开发工具和XPM库到最新版本,以确保兼容性,并查阅官方文档或社区资源,寻找类似问题的解决方案。如果问题依旧存在,可能需要逐步调试,注释掉部分参数,确定具体是哪个参数引起的错误,或者联系Xilinx技术支持获取帮助。</think>针对XPM FIFO模块中出现的“Too many positional options”错误,以下是分步解决方案: --- ### **问题原因分析** 该错误通常由以下原因引起: 1. **参数传递方式错误**:在实例化`xpm_fifo_base`模块时,使用位置参数(positional association)而非命名参数(named association),导致参数数量或顺序与模块定义不匹配[^1]。 2. **版本兼容性问题**:不同版本的XPM库可能修改了模块参数列表,旧代码未适配新版本。 3. **生成脚本配置错误**:使用`line_fifo_gen`工具生成代码时,参数配置与目标模块不匹配。 --- ### **解决方法** #### **步骤1:检查实例化语法** 在Verilog/VHDL中,**避免使用位置参数**,改用命名参数关联: ```verilog // 错误示例(位置参数易导致数量不匹配) xpm_fifo_base #(1024, 1, 32, 0) xpm_fifo_base_inst (clk, rst, wr_en, din, rd_en, dout); // 正确示例(命名参数明确关联) xpm_fifo_base #( .FIFO_WRITE_DEPTH(1024), // 写入深度 .READ_MODE("fwft"), // 读取模式 .FIFO_READ_LATENCY(1), // 读取延迟 .WRITE_DATA_WIDTH(32) // 数据位宽 ) xpm_fifo_base_inst ( .rst(rst), .wr_clk(clk), .wr_en(wr_en), .din(din), .rd_en(rd_en), .dout(dout) ); ``` #### **步骤2:核对XPM模块参数** 查阅[Xilinx官方文档](https://docs.xilinx.com/r/en-US/ug974-vivado-ultrascale-libraries/XPM-FIFO-BASE)确认`xpm_fifo_base`的参数列表,重点关注: - 必需参数(如`FIFO_WRITE_DEPTH`) - 可选参数的默认值(如`READ_MODE`默认为`std`) - 参数顺序是否变动(不同版本可能调整顺序) #### **步骤3:更新生成脚本配置** 若使用`line_fifo_gen`生成FIFO代码: 1. 检查脚本参数是否与目标XPM版本匹配。 2. 确保输出代码使用**命名参数关联**而非位置参数。 3. 若脚本版本过旧,尝试升级到最新版本。 #### **步骤4:验证工具版本兼容性** - 确认Vivado版本与XPM库版本一致。 - 若从旧项目迁移代码,需重新生成IP核并更新XPM实例化代码。 --- ### **示例修正对比** | 错误代码(位置参数) | 修正后代码(命名参数) | |----------------------|------------------------| | `xpm_fifo_base #(1024, 1, 32, 0) inst (...);` | `xpm_fifo_base #(.FIFO_WRITE_DEPTH(1024), .READ_MODE("fwft")) inst (...);` | --- ### **相关问题** 1. **如何验证XPM FIFO的参数配置是否正确?** 答:通过Vivado的RTL仿真或综合后的网表检查参数是否生效。 2. **XPM FIFO的`READ_MODE`设置为`fwft`和`std`有何区别?** 答:`fwft`(First-Word Fall-Through)模式在`rd_en`有效前预取数据,减少延迟;`std`模式需`rd_en`有效后输出数据。 3. **如何避免XPM模块的版本兼容性问题?** 答:定期更新开发工具,使用脚本自动化生成代码而非手动编写[^2]。 --- ### **引用** : Xilinx XPM FIFO文档: https://docs.xilinx.com/r/en-US/ug974-vivado-ultrascale-libraries/XPM-FIFO-BASE : 脚本错误解决方法参考: https://blog.csdn.net/weixin_43178406/article/details/131840370
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