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RSS订阅原创 改写xilinx自动生成的AXI4-LITE-SLAVE代码
摘要：本文针对Vivado生成的AXI4-Lite接口代码仅支持AW和W通道同时触发的限制，按照AXI4规范要求进行了修改，支持三种写时序场景（AW先、W先、同时）。通过状态机实现写操作的地址和数据通道分离处理，并添加了相应的锁存机制。Verilog代码实现了4个32位寄存器的读写接口，仿真测试验证了三种写时序的正确性。修改后的设计符合AXI4协议灵活性要求，解决了原代码的时序限制问题。（150字）
2025-08-07 13:32:33
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原创 CIC梳状滤波器的matlab仿真
本文通过MATLAB仿真对比了CIC滤波器与直接抽取/插值的效果。实验采用7倍和40倍的抽取/插值因子，分别测试了随机信号和双频信号(20Hz+900Hz)处理效果。结果显示：直接抽取会导致高频信号(900Hz)完全混叠，而CIC抽取能有效抑制高频分量；直接插值会产生明显镜像，CIC插值则能显著抑制镜像成分。仿真验证了CIC滤波器在分数采样率转换中的抗混叠和镜像抑制优势。
2025-07-29 17:29:36
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原创 信道化(多相滤波)的matlab仿真
摘要：本文通过MATLAB仿真实现了信道化(多相滤波)处理。首先设计了一个255阶低通滤波器，并生成了包含8个不同频率分量的测试信号。采用两种算法实现信道化：传统算法通过FFT移频后进行滤波和抽取；优化算法则先进行抽取滤波再进行FFT变换。实验对比了两种算法在各子信道中的频谱输出效果，验证了多相滤波在信道化处理中的有效性。代码中包含了信号生成、滤波处理、抽取操作和频谱分析等完整流程，为信道化技术的实现提供了参考范例。
2025-06-17 10:06:26
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原创 nobel恒等式的matlab仿真
本文通过Matlab仿真验证了Nobel恒等式在多速率信号处理中的应用，主要包括三个核心实验：(1)信号和滤波器同时插零等同于结果直接插零；(2)滤波器插零后等效于信号分路并行处理；(3)信号插零与滤波器抽取的等效关系。实验表明，通过合理设计插值和抽取方式，可以保持系统输出不变，验证了恒等式"先插值后滤波=先滤波后插值"的正确性。文中还包含滤波器卷积可视化代码，直观展示了信号处理过程。这些结果为多速率系统设计提供了理论依据和实现参考。
2025-06-17 10:00:48
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原创 [2,1,7]卷积码的编码与维特比译码matlab仿真
branch里存储了路径的所有信息，包括寄存器状态、编码输入状态、编码结果、汉明距离，理解起来很方便。熟悉了之后，branch里可以作一些精简。
2024-02-22 10:16:44
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空空如也
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