VerilogHDL正弦信号发生器

最新推荐文章于 2025-03-20 13:36:30 发布
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版权

Verilog HDL正弦信号发生器

思路
😊1、计数器 （寻址）2、正弦波数据存储ROM 3 、8位AD
😊ROM只读 要新建ROM初始化文件（HEX文件&MIF文件）
😊用数据生成器，设置相关参数。（位宽8、10、12为多）
😊记事本录入数据
步骤
1、新建文件夹sint&建立一个新的工程
2、使用数据生成器生成数据，将生成的数据保存到sint文件夹中，用txt文件。
在这里插入图片描述
3打开新建好的quartus file open 刚刚存好数据的txt文件 将其save as 一下（命名sint.hex）文件类型还是txt。再次open打开这个文件sint.hex
在这里插入图片描述
还有方法二 有点big 麻烦
在这里插入图片描述
这个可以新建一下，一个个保存也可以 too too troublesome 将

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