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RSS订阅原创 FPGA学习历程_3
本次学习decoder_3_8,其核心是靠3个输入信号（可以为0或1），如此可以组合成8个可能，用8种组合表示8种输出方式。这样只要在always中放三个输入信号，一旦变化就会重新执行always语块中的代码，改变输出信号。//case语句跟C中的switch语句基本相似，记得要写default语句。//’b表示二进制，‘d表示十进制，’o表示8进制，'h表示十六进制。//新语法，[n:0]表示是一个n+1位的数据。，当这些信号中的任何一个发生变化时，就会执行。敏感于括号中列出的所有信号的变化。
2025-09-16 12:17:53
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原创 FPGA学习历程_2
1.首先我要设置时间规模，`timescale 1ns/1ns //意为步进为1ns，精度也是1ns。textbench可以理解为在一个工作台上，将自己设计的仪器进行接线，输入激励信号，输出响应信号。wire out //wire可以理解为仅仅是一条导线，一般用于对于响应信号的声明。//a前的.意为要对a进行例化，后面的赋值意为接线。....//reg是对寄存器操作，在仿真中可以看作对激励信号的声明，//#后加数字表示延迟这个数字个单位时间（单位时间由自己设置）)//把自己设置的模块放过来。
2025-09-13 21:49:01
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原创 FPGA学习历程_1
我打算学习FPGA，从B站上找了小梅哥的视频进行学习。计划写一系列blog，记录学习历程。9月11日初步了解FPGA开发流程：设计输入->分析综合->模拟仿真。看完了二选一多路器的视频，计划9月12复现二选一多路器的代码，综合，仿真。GUM2（a,b,sel,out）//其中GUM2是对该模块的命名，a,b,sel,out是输入输出信号。回顾：FPGA是用的是Verilog语言，其中是由module与endmodule分别为首尾的模块组成。//out是输出信号。//实现二选一多路器的代码。
2025-09-11 22:50:47
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空空如也
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