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RSS订阅原创 【小知识】关于时钟的MMCME_ADV原语的探讨
我们这些菜鸟都是使用IP配参生成调用文件，只有高手级别才会使用时钟MMCM原语，就像自己玩linux用GUI,高手玩linux自己搭环境。xilinx时钟IP使用参考官方文档http://www.xilinx.com/support/documentation/ip_documentation/clk_wiz/v6_0/pg065-clk-wiz.pdfhttp://www.xilinx.com/support/documentation/ip_documentation/clk_wiz/v6_0/pg
2022-03-18 12:25:51
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原创 xilinx基础篇Ⅱ（13）Prj9 芯片驱动：TLC549的使用
1.芯片简介：TLC549是一种低价位、高性能的8位 A/D转换器，采用了CMOS工艺，它以8位开关电容逐次逼近的方法实现 A/D转换，可与通用微处理器、控制器通过CLK、CS、DATAOUT三条口线进行串行接口。具有4MHz片内系统时钟和软、硬件控制电路，转换时间最长17μs，TLC549为40000次/s。总失调误差最大为±0.5LSB，典型功耗值为6mW。片内系统时钟与I/O CLOCK是独立工作的，无须特殊的速度或相位匹配。采用差分参考电压高阻输入，抗干扰，可按比例量程校准转换范围，VREF-接
2022-02-20 22:32:12
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原创 xilinx基础篇Ⅱ（12）Prj8 芯片驱动：TLC5620的使用
1.芯片简介：TLC5620是一个内部具备4个独立 8位电压输出型数字-模拟转换器，每个DAC转换器都拥有一个带缓冲（高输入阻抗）的参考电压输入端口。每个DAC可以输出Vref x1或者Vref x2的参考电压与GND之间的电压值。资料详见：https://www.ti.com.cn/cn/lit/ds/symlink/tlc5620.pdf?ts=1645167716540&ref_url=https%253A%252F%252Fwww.ti.com.cn%252Fproduct%252F
2022-02-19 11:25:13
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原创 xilinx基础篇Ⅱ（11）Prj7 XADC的IP使用
IP配置：DRP接口，Continuous Sequence 连续序列模式，100MHz驱动时钟，只监测内核电压温度IP端口：IP实例化：//----------- Begin Cut here for INSTANTIATION Template ---// INST_TAGxadc_wiz your_instance_name ( .di_in(di_in), // input.
2022-02-16 16:17:04
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原创 xilinx基础篇Ⅱ（10）Prj6 Block Memory的IP的使用（BMG IP）
RAM的IP在vivado中有很多种，此处以BMG（全称Block Memory Generator，即块 RAM生成器 ）为例生成的Block器件如下所示，有时钟clka、地址addra、数据输入端dina、数据输出端douta、器件使能端ena和器件写入使能端wea；该端口被称为PORTA，即ena就是PORTA端口的总开关。RAM的使用，就是找到地址，并在该地址进行读/写操作； //读RAM操作 always@(posedge sys_clk o...
2021-12-12 18:23:12
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原创 xilinx基础篇Ⅱ（9）Prj5 ILA的使用
本例使用PLL产生多个时钟，通过ila观察所产生的各时钟频率是否符合设计；仿真是理想化的模型，将程序加载到IC中通过ila监测实际状况会更贴切实际应用。这里使用时钟信号完成ila监测试验，除了“懒”，还有常犯的错——飚车虽然嗨，超速总被拍...1.设置PLL输出的多时钟Vivado的官方IP查找操作一致，此处忽略，通过PLL生成多个不同频率时钟，各时钟概况如下：2.ILA配置3.ILA接入电路//// clk_gen.v//...
2021-12-04 00:02:19
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原创 xilinx基础篇Ⅱ（8）Prj4 按键控制LED闪烁效果
1.目的本节实验目的是按键键入次数切换闪烁模式；2.FPGA芯片型号xc7z020clg400-2//// key_led.v//module key_led( input sys_clk , input sys_rst_n , input key , output reg [1:0] led);reg [24:0] clk_cnt;reg [1:0]
2021-12-02 23:27:25
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原创 xilinx基础篇Ⅱ（7）Prj3 LED闪烁效果
1.目的时钟分频电路，使用led闪烁直观表现2.FPGA芯片型号xc7z020clg400-2//// clk_div.v////时钟分频module clk_div ( input clk_i, input rstn_i, output clk_o ); parameter CLK_IN_FREQ = 50000000; //单位 Hz, 例如50MHz parameter CLK_OUT_FREQ
2021-12-02 22:54:39
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原创 xilinx基础篇Ⅰ（9）PLL应用
1.PLL调用2.PLL配置3.生成的可调用文件和可调用的例化PLL例化如下//----------- Begin Cut here for INSTANTIATION Template ---// INST_TAG clock_wized instance_name (// Clock in ports .CLK_IN1(CLK_IN1), // IN // Clock out ports ...
2021-12-01 08:50:45
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原创 xilinx基础篇Ⅱ（6）Prj2 LED呼吸灯效果
1.目的本节实验目的是板上的LED0由亮渐暗，再由暗渐亮的呼吸灯效果；其原理是根据电压驱动上实际是平均电压的大小，脉冲的不同占空比能达到该效果。2.FPGA芯片型号XC7A35TFGG4843.硬件设计4.软件设计`timescale 1ns / 1psmodule prj_top ( input sys_clk , //时钟50Mhz input sys_rst_n , //复位信号 outpu...
2021-11-21 17:08:27
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原创 xilinx基础篇Ⅱ（5）Prj1 触摸键驱动LED
实验任务本节实验任务是板上的触摸键的检测，并驱动LED灯。FPGA芯片型号XC7A35TFGG484硬件设计AR101的使用（https://www.docin.com/p-972138456.html），如下描述，当前电路连接方式为输出高电平有效、同步模式。 信号名 方向 管脚 端口说明 电平标准 sys_clk ...
2021-11-21 16:47:59
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原创 【工具应用笔记】ISE14.7开发基础流程 [FPGA章节]
硬件电路：黑金开发板（xilinx-S6）目的：点灯1.驱动对象led灯：简单的开（1）关（0）逻辑2.驱动管脚驱动逻辑：高（1）点亮，低（0）熄灭3.程序驱动module led_driver( input sys_clk, //50Mhz , 20ns output led0, output led1, output led2, output led3);reg [19:0] cnt = 'd0;r...
2021-10-17 22:47:25
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原创 xilinx基础篇Ⅱ（3）IBERT IP 使用
1.新建工程，选好芯片型号2. 选择IP核3. IP核设置速度设置3.125G，时钟125MHz4. 结合硬件设计，硬件引脚设置配置IP引脚配置IP时钟 5. IP配置概况6. 将已设置好的IP生成例程7. 生成bit文件8. bit文件生成完成，会弹窗如下，如果界面选项不需要，直接点击cancel...
2021-10-14 22:31:12
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