数字电路——与或非逻辑门电路

本文介绍了门电路的基本原理,包括与门、或门、非门的工作方式及其真值表,并提供了警笛信号发生器和触摸键控电路的应用实例。

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门电路是数字电路中最基本的逻辑单元。它可以使输出信号与输入信号之间产生一定的逻辑关系。在数字电路中,信号大都是用电位(电平)高低两种状态表示,利用门电路的逻辑关系可以实现对信号的转换。

最基本的门电路有与门电路,或门电路,非门电路等。

一、与门电路

        概念:与门电路是指只有在一件事情的所有条件都具备时,事情才会发生。

        由二极管和电阻器构成的与门电路见下图

图中A,B为两个输入变量,F为输出变量,当A,B均为高电平,F为高电平,A,B只要有一个为低电平,F就为低电平。 

       与门电路的真值表见下图。

二、或门电路

        或门电路是指只要有一个或一个以上条件满足时,事情就会发生。

        同与门电路一样,最简单的或门电路也是由二极管和电阻器构成的。见下图

        图中A,B为两个输入变量,F为输出变量。当A,B均为低电平,F才为低电平,A,B只要有一个为高电平,或两个都为高电平,F为高电平。

        或门电路真值表见下图

三、非门电路

        非门电路又叫“否”运算,也称求“反”运算,因此非门电路又称为反相器。

        最基本的非门电路是利用晶体三极管的开关特性构成的。可以实现非逻辑关系。

        由晶体三极管和外围元件组成的非门电路如下。

        上图中,A为输入变量,Y为输出变量,利用晶体三极管的反相放大特性,当A为低电平,三极管截止,输出端Y为高电平。当输入高电平,三极管处于饱和区,输出端Y为低电平。

        非门电路的真值表见下图。

 

        非门电路构成的反相器主要有三种,有DTL型,TTL型和C-MOS等。DTL是Diode Transistor Logic(二极管晶体逻辑)的简称;TTL是Transistor Transistor Logic(晶体管晶体管逻辑)的简称。这两种逻辑电路的区别是DTL电路采用二极管做为输入电路,TTL采用三极管作为输入电路,C-MOS是Complementary Metal OxidE Semiconductor的缩写,这种电路主要采用C-MOS场效应管组成的逻辑电路。

 门电路符号中,国家标准与国外标准的区别见下图:

与非门和或非门分别是由与门+非门;或门+非门组合而成,在数字电路中也很常见。

四、门电路应用实例

4.1 警笛信号发生器电路

        警笛信号发生器电路一般用于报警电路中,通过高音和低音的交换发声,起到警示作用。

由六个非门电路组成的警笛信号发生器电路如下图:

        非门1、2组成超低频脉冲振荡器,非门3、4组成高音振荡器,非门5、6组成低音振荡器。超低频脉冲振荡器的输出通过二极管VD1,VD2控制高、低音振荡器轮流发声,振荡信号分别经VD3,VD4由半导体三极管VT1放大后推动扬声器发声。

4.2 触摸键控电路

        触摸键控电路是一种利用人手触摸金属触摸键,从而起到控制电路通断的作用。

        见下图:

        该电路主要由触摸金属板M,与非门电路1-4,继电器K,电池等部分构成。

        触摸金属板用于输入指令,4个与非门电路用于将输入的指令识别和处理,继电器为指令输出控制端负载。

        当手触摸金属板时,C1上的充电电荷将通过人体电阻加到与非门2的输入端,使其成为高电平,最后使与非门3、4输出高电平,VT1,VT2导通,继电器吸和,控制负载工作。

        由于与非门1和与非门2之间通过电阻R2相连,所以由C1提供给与非门2输入端的高电平将保持下去,即使手离开金属板,电路仍会保持这一状态,直到金属板再次被触摸为止。

        继电器吸合时,与非门1的输入端为低电平,C1通过R1及与非门1放电到0V左右。

        当金属板再次受到触摸,C1上的0V电压经人体电阻加到与非门2的输入端,使电路又恢复到原来状态,即VT1,VT2截止,继电器断开。

<think>好的,我现在需要回答用户关于或非门电路原理图设计及工作原理的问题。用户提到了Cadence教程和CMOS门电路的相关引用,所以我应该结合这些内容来构建回答。 首先,我需要明确或非门的逻辑功能。或非门是组合逻辑门,通常由门、或门和非门组合而成。它的逻辑表达式是Y = NOT (A AND B OR C AND D),也就是先进行两个操作,再进行或操作,最后取反。接下来,我需要考虑CMOS实现的结构。根据引用[2],CMOS逻辑门非门、或非门等,所以或非门可以由这些基本门组合而成,或者直接通过CMOS晶体管搭建。 根据CMOS电路的特点,非门和或非门可以通过串联和并联的MOS管来实现。例如,非门的PMOS管是并联的,NMOS是串联的;或非门则相反。那么或非门可能需要组合这些结构。可能需要分步骤说明:首先设计两个门部分,然后将它们的输出连接到一个或门,最后接一个非门。或者是否有更高效的直接实现方式?比如合并某些晶体管结构以减少延迟和元件数量。 接下来,原理图设计部分需要结合Cadence软件的操作步骤,如引用[1]和[3]提到的创建库、添加元件、连线、设置仿真等。需要指导用户如何在Cadence中绘制原理图,包括选择PMOS和NMOS管,设置宽长比,连接输入输出引脚,以及进行仿真验证。 工作原理部分需要分真值表分析,不同输入情况下的MOS管导通状态,以及输出电平的变化。例如,当任一部分为真时,或的结果为真,经过非门后输出低电平;否则输出高电平。 验证部分需要说明如何设置输入信号(如A、B、C、D的不同组合),进行瞬态分析,观察输出波形是否符合预期。同时,可能需要检查功耗、延迟等参数,确保电路性能。 可能还需要提到优化方法,比如调整晶体管的尺寸来平衡上升和下降时间,或者使用更先进的CMOS结构来提高速度或降低功耗。 需要确保回答结构清晰,分步骤解释设计和原理,并且结合引用中的Cadence操作步骤和CMOS电路知识。同时,生成相关问题时要围绕设计步骤、工作原理、优化和应用场景展开。 最后,检查是否符合用户的要求,使用正确的中文表达,LaTeX格式正确,尤其是数学表达式用$...$,独立公式用$$...$$。例如,逻辑表达式可能需要用LaTeX表示,如$Y = \overline{AB + CD}$。</think>### 或非门电路原理图设计及工作原理 #### 一、电路结构解析 或非门(AOI, AND-OR-INVERT)是组合逻辑电路,其逻辑表达式为: $$Y = \overline{(A \cdot B) + (C \cdot D)}$$ 它通过**两级逻辑结构**实现功能: 1. **门层**:两组输入($A \cdot B$ 和 $C \cdot D$)分别进行逻辑运算 2. **或非门层**:将两组运算结果进行逻辑或,再取反输出[^2] #### 二、CMOS实现原理 典型的CMOS或非门结构包含**PMOS上拉网络**和**NMOS下拉网络**(见图1): - **PMOS网络**:两组并联的PMOS管(每组由两个PMOS串联,对应逻辑) - **NMOS网络**:两组串联的NMOS管(每组由两个NMOS并联,对应或逻辑) $$Y = \overline{(A \cdot B) + (C \cdot D)}$$ **输入组合输出关系**: - 当$A \cdot B = 1$或$C \cdot D = 1$时,输出$Y=0$ - 仅当所有条件均不满足时,输出$Y=1$ #### 三、Cadence原理图设计步骤 1. **创建库单元** - 按引用[3]方法新建`Library`并绑定`smic18mmrf`工艺库 - 创建新`Cellview`并命名(如`AOI_schematic`) 2. **绘制原理图** ```plaintext (1) 插入4个PMOS(宽长比W/L=8u/0.18u) - PM1,PM2串联构成A·B路径 - PM3,PM4串联构成C·D路径 (2) 插入4个NMOS(W/L=4u/0.18u) - NM1,NM2并联构成A+B路径 - NM3,NM4并联构成C+D路径 (3) 连接电源VDD地GND (4) 添加输入引脚A,B,C,D输出引脚Y ``` 3. **仿真验证** - 设置输入信号组合(00→11遍历) - 执行瞬态分析观察输出波形 - 验证真值表匹配逻辑功能[^3] #### 四、关键设计要点 1. **晶体管尺寸优化** - PMOS宽度通常为NMOS的2-3倍以平衡上升/下降时间 - 长沟道器件可降低漏电流但会增加延迟 2. **布局技巧** - 对称布局匹配信号路径延迟 - 电源轨线宽需满足电流密度要求 ####
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