FPGA初学者__个人学习笔记（四）_有符号数相加 溢出 问题

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在学习FPGA时，整理的一些问题，慢慢积累，期待自己的进步。
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两个8bit有符号数相加

有符号数溢出发生有两种情况：正正相加得负，负负相加得正（其实负负相加是各自的补码相加）。

module top_module (
    input [7:0] a,
    input [7:0] b,
    output [7:0] s,
    output overflow
); //
 
    assign s = a + b;
    assign overflow = ( a[7]