VIVDO18.3 ZYNQ7020的纯PL工程代码固化教程

原创

已于 2022-08-16 17:43:40 修改 · 3.3k 阅读

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#fpga开发

于 2022-08-11 14:35:33 首次发布

本文档详细记录了使用VIVADO18.3在ZYNQ7020上进行纯PL工程代码固化的全过程，包括固化逻辑配置、添加PS、例化、通过SDK生成固化代码以及下载步骤。通过连接时钟线，配置QSPI启动，并创建FSBL以实现Boot Image的生成，最终完成FPGA的编程下载。

【拒绝任何杠精，这只是我自己的小白学习操作过程记录】

用到的参考

https://blog.youkuaiyun.com/weixin_45526456/article/details/108049186
ZYNQ开发板资料

固化逻辑

ZYNQ固化必须用到PS块。
所以纯PL工程中需要新建一个block块，加入并配置PS。
配置完成后系统会新生成一个.v文件，再将自己原本要固化的代码例化进去编译生成新的bit文件。
启动一个PL编程从来用不到的辅助小程序SDK（vivado自带，启动即可），在SDK里生成固化代码及下载固化。
选用的固化启动方式为QSPI启动。

添加PS

新建BLOCK

自定义名称
添加IP

按+搜索选择zynq system双击
在这里插入图片描述

会看到多了一个块，再双击块，调出配置

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