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德州仪器平台开发套件 (PDK) 是一个可扩展的软件驱动程序包，可提供跨不同 TI 处理器的简化开发。PDK 包包含器件抽象层库和外设/板级示例/演示示例，这些示例演示了 TI 平台上的外设用于开发、部署和执行应用程序的功能。
以7.3版本的RTOS的SDK为例，安装完SDK后，在pdk_jacinto_07_03_00_29中，docs/userguide文件夹下，打开.html文件，即可在浏览器中看到如下资料索引目录：
芯片支持库构成了一组定义明确的 API，这些 API 抽象了底层 SoC 设备的低级细节，以便用户可以配置、控制（启动/停止等）以及对外围设备进行读/写访问，而无需担心寄存器位域的细节。CSL
《TDA4》专栏导航
TDA4》专栏主要介绍TI TDA4芯片的工程应用笔记，“授人以鱼不如授人以渔”，本专栏着眼于如何从零上手一款复杂的多核异构的芯片平台，其中包含了博主如何查找资料，如何寻求资源，如何实验测试，如何搭建环境等点点滴滴的过程，希望对TDA4感兴趣的小伙伴有帮助，也希望大家多多评论，多多转发！适用于 ADAS 和自动驾驶汽车的 TDA4VM Jacinto™ 处理器器件版本 1.0 和 1.1。
TDA4VM，SBL启动
本文记录TDA4VM的SBL启动修改。
modbus
从机地址 功能码 起始地址高位 起始地址低位 数量高位 数量低位 字节数 0001H高位 0001H低位 0002H高位 0002H低位 CRC高位 CRC低位。每个输入寄存器的长度为2个字节。其中，CDH对应线圈0013H到001AH的内容，01H对应线圈001B到001CH的内容，未使用位用0填充。从机地址 功能码 起始地址高位 起始地址低位 寄存器数量高位 寄存器数量低位 CRC高位 CRC低位。从机地址 功能码 起始地址高位 起始地址低位 寄存器数量高位 寄存器数量低位 CRC高位 CRC低位。
给IC设计新人的Tessent Scan入门指南：从RTL到ATPG的完整DFT流程解析
本文为IC设计新手提供Tessent Scan的完整DFT流程指南，从RTL代码检查到ATPG测试向量生成，详细解析扫描链配置、插入及验证的关键步骤。通过实战案例和工具命令示例，帮助工程师快速掌握Tessent工具链的应用技巧，提升芯片可测试性设计的效率和质量。
F28335 DSP ePWM模块实战：从基础配置到电机控制
本文详细解析了TI TMS320F28335 DSP的ePWM模块，从基础概念、寄存器配置到实战应用。通过代码示例，手把手教你如何配置定时中断、生成PWM波形、实现死区保护与故障联防，并最终完成一个可调速、可换向的直流电机控制项目，是掌握F28335电机控制核心技术的实战指南。
001-基础入门-Web演示源码&资源&工具箱等
小迪安全2023笔记
LLM评测框架Ragas:测试RAG的性能出现TimeoutError()的解决办法（Ragas+langchain+ollama）
无奈之下，自己找到了一个解决办法，在ragas支持的llm类库中加了一个如下的类，支持ollama、langchian_ollama使用ragas测试报错的问题。可以将如上的库放到你的ragas的系统库的llms目录下，然后修改__init__.py如下。最近用ragas测试rag的性能，发现老出现TimeoutError()的错误。这是一个临时的解决办法，具体等待官方给出最终的解决方案。后来发现官方也没有尽快支持的计划。然后就可以用如下代码进行一些验证。
实时多目标跟踪（MOT）：SORT与DeepSORT优化
实时多目标跟踪（MOT）：SORT与DeepSORT优化 ，人工智能，计算机视觉，大模型，AI，本文围绕实时多目标跟踪中的 SORT 与 DeepSORT 算法展开，阐述了两者原理、实现及优化。SORT 结合卡尔曼滤波和匈牙利算法，依赖目标检测，实时性好但复杂场景表现欠佳。DeepSORT 在其基础上引入外观特征，采用级联匹配，提升了跟踪精度和鲁棒性。还探讨了两种算法在检测、运动模型、外观特征等方面的优化方向，以及应用场景与选择建议，为相关应用和研究提供参考。
AD9613操作控制
输出250M时钟给AD9613，过FPGA ILA逻辑分析仪将AD9613采集的两个通道ADC数据250M数据显示出来。其中AD9613输出的是LVDS数据，通过select IO核转为并行数据。 一，搜索IP核：selectIO interface wizad ，并双击配置 配置为input，DDR模式，数据位宽为12bit，IO类型为差分，这里配置的是12对数据差分对。然后配置外部差分时钟。 将tap setting 设置为13，将时钟的边沿对准数据的中间，以免数据出错 二，
改进的U-Net在视网膜血管分割上的应用
为了提高算法在血管边界的分割能力,在编码部分采用全局卷积网络（GCN）和边界细化（BR）替换传统的卷积层;在跳跃连接部分引入改进的位置注意模块（PA）和通道注意模块（CA）,目的是增加血管与背景之间的对比度,使网络更好地将血管与背景分割开;此外,为了提高网络的性能,在编码部分的最后一层使用密集卷积网络解决网络过拟合问题,同时为了在一定程度上解决梯度爆炸、梯度消失的问题,在解码部分的每一层使用卷积长短记忆网络提升网络获取特征信息的能力。替换传统的卷积操作来解决血管边界非血管像素误分为血管的问题。
OV9734 DATASHEET，完整规格书
OV9734完整规格书，包括电气参数，尺寸规格，寄存器配置表等
最新的sdio 4.0 spec 协议标准 带书签 高清完整PDF版
Part-E1-SDIO-Specification-Ver4.00-Final-120220.pdf：最新的sdio 4.0 spec 协议标准 带书签 高清完整PDF版，包括SDIO 接口的外设，SDIO 接口官方协议等。
IDEA的使用指南
IDEA基于java的使用手册,可以最快速的上手,在使用中不断的丰富自己的使用技巧.
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