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RSS订阅原创 【SDR课堂第19讲】AD9361在fast_attack模式下增益过低
接收外部噪声，接收通道在FastAGC和SlowAGC之间反复切换，每一次切换到FastAGC下时，接收增益都不相同，且相差很大，最大增益为满增益71dB，最小为-3dB。默认配置未使能"增益锁定后增加增益"，在增益快速锁定后，不会再次检查过了是否过低。再次反复切换FastAGC和SlowAGC，接收增益稳定为71dB，未出现低增益的情况。软件无线电_USRP_SDR_软件无线电平台_彬鸿科技。
2025-03-31 15:21:51
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原创 【SDR课堂第18讲】AGC在项目中的应用
● 总结3：AGC参数默认应用官方初始化参数，门限范围是-10~-12dBFs，这个范围并不适用于所有类型信号的接收，一些宽带、多载波、多通道等调制信号的接收时，信号也许会在-20dBFs甚至更低时发生饱和，必须根据实际应用调制AGC的参数。● 可以看出，能够正常解调的增益至少覆盖15dB范围，而MGC下的初始化增益几乎处于此范围的中心位置，这也是最合理的配置。为使AGC的调整结果与MGC初始化增益相同，需要调整AGC门限，修改设备树，将AGC的门限值统一下调10dB。AGC下的自动调整增益。
2025-03-26 11:25:38
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原创 【SDR课堂第17讲】AD9361使能FIR滤波器报错原因及解决方法
b9361_dig_tune()函数部分代码如下，可以看到，如果skip_mode!= SKIP_ALL，驱动将去调用9361_bist_loopback等函数，这些函数需要ADI AD9361官方IP支持才行，如果项目中没有使用AD9361的IP，则会出现AXI地址空间访问失败导致系统报错的问题。彬鸿科技（Binhong）致力于从事国产软件无线电仪器与装备的研发与生产，公司产品在多个国家重点型号中得到了应用，同时进一步在仪器仪表、5G/6G通信、毫米波与太赫兹等行业广泛推广及应用。
2025-03-25 17:23:23
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原创 【SDR课堂第16讲】AD9361接收基带直流校准对FM正交解调的影响
本文所描述的所有现象、所有测试过程均基于产品，其主要工作原理如图1所示。是基于ZYNQ+AD9361的通用SDR平台，支持2T2R的TDD、FDD模式，覆盖70MHz~6GHz射频工作频段，带宽在200kHz~56MHz范围内可调。可通过网口或USB与上位机进行数据交互。
2025-03-19 15:48:06
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原创 bhSDR Matlab-通用软件无线电平台
MATLAB是一种用于算法开发、数据分析、可视化和数值计算的程序设计环境。使用 MATLAB，可以较使用传统的编程语言（如 C、C++ 和 Fortran）更快地解决技术计算问题。Simulink是一个用于对动态系统进行多域建模和模型设计的平台。它提供了一个交互式图形环境，以及一个自定义模块库，并可针对特定应用加以扩展。它提供了一个交互式图形环境和一组可自定义的模块库，可用来设计、仿真、实现以及测试各种时变系统，包括通信、控制、信号处理、视频处理和图像处理。
2025-03-12 18:17:29
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原创 bhSDR VSG-矢量信号源软件
bhSDR VSG连接上SDR硬件平台后，对平台本振频率进行设置，可以通过“Frequency”编辑框进行频率编辑设置，或者通过上下箭头，根据步进Step对本振频率进行调整。
2025-03-12 17:52:10
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原创 bhSDR Studio-调测与采集软件
即bhSDR调测与采集软件，是彬鸿科技公司推出的基于bhSDR系列硬件平台，可以对其进行直观的调试，可进行无线数据的多通道采集与回放。在SDR的开发中，该软件主要用于简化过程；同时也可以直接面向数据采集领域。的产品特性：● 设备射频参数的直接控制，包含本振、增益、带宽以及采样率等● 射频基础时域图/瀑布图及频谱图展示● IQ数据多通道记录与回放● 多通道并行观测及对比● 支持多种数据接口：USB、网口、万兆网、PCIe等2、该软件目前支持和。
2025-03-12 16:46:11
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原创 【SDR课堂第15讲】AD9361多片相位同步原理与实现（二）
注意：这里可以看到I路的校准系数为cosφ和-sinφ，Q路的校准系数为sinφ和cosφ，而在软件里面Q路的校准系数却是cosφ和sinφ，根据邢老师解释，这是由于PL的IP core里面将这两个系数调换了一下位置导致的。首先，控制开关让其工作在校准链路，然后发送DDS，通过IIO SCOPE读取数据看到如下情况，两个信号的相位存在明显差异。可以用来求夹角θ，但我们直到cos（θ）=cos（-θ），所以这种方式计算相位差，会丢失超前滞后关系。可以看到两路的信号相位基本相同。
2025-03-10 16:54:37
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原创 【SDR课堂第14讲】AD9361多片相位同步原理与实现（一）
它的内部逻辑中st->have_slave_channels的数值由probe函数中1489行进行赋值，并从1088行得到其值为4个，对应FPGA core中的4个TX channel；在FPGA中的1个AD9361 IP core中有4个通道，每个通道包含1个DDS 模块，每个DDS模块中需要输入2路tone数据，故1个AD9361 IP core对应8路tone数据。其中dds_out数组存储的为iio_channel，含义为i=0，代表dev_tx_slave，1为dev_tx；
2025-03-05 14:45:25
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原创 【SDR课堂第13讲】基于AD9361的零中频架构发射性能的优化
可以看出，该三端EMIFIL对低频杂散的抑制并不强，对200kHz以下的杂散抑制在30dB以下，对100kHz以下的杂散抑制在20dB以下，不足以抑制低频杂散。零中频架构的发射机相较于传统的超外差发射机，在尺寸、成本、设计难度上都具有很大的优势，在工作参数的配置上，零中频发射机绝大多数的配置都交由软件来完成，发射性能更加依赖软件配置的合理性。可以看出，这些杂散依旧存在，那么可以排除模拟中频带来该杂散的可能。可以看出，输出的频谱包含了很多杂散，这些杂散有些是不能避免的，有些是可以通过合理的配置有效的抑制。
2025-03-04 14:31:30
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原创 【SDR课堂第12讲】AD9361毛刺问题总结
所以，实际的数据总线时序不能完全满足上述要求，DATA_CLK与RX_D的上升沿或者下降沿不在RX_D数据中中心时（CLK提前了或者延迟了），就会导致采样时的数据值不正确。AD9361 LVDS模式下数据收发信号连接如下所示，对于数据接收，需要三种信号，DATA_CLK、RX_FRAME和RX_D[5:0]，分别对应采样时钟、接收有效信号和数据，这三种信号都是由AD9361提供。如上所示，寄存器6用于接收时序调整，高4位用于调整DATA_CLK的延时，即可以使DATA_CLK延迟一定时间；
2025-02-26 11:18:07
940
原创 【SDR课堂第11讲】AD9361发射通道正交校准优化
在测试10套低成本SDR平台（USRP-4120）性能指标时发现，发射通道在4GHz附近频点的镜像抑制指标普遍较差，尤其是TX2通道。如表1所示，分别为002、005、008、010号板卡的测试数据。初步分析：零中频架构的镜像抑制（SSB抑制）指标取决于I、Q路幅度和相位的不平衡程度，通过校准过程可以补偿芯片内部链路的不平衡，降低镜像信号幅度。镜像一直插，大概率是内部校准失败或外部链路的幅、相失调导致。发射正交校准过程如图2所示。
2025-02-25 10:35:59
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原创 【SDR课堂第10讲】AD9361发射电路调试
这样的测试结果明显超出了正常范围。在测试低频段，70MHz~200MHz时，发现输出功率也很低，查看电路发现链路上的耦合电容为18pF（同官方原理图），可能是容值过小，对低频段的阻抗较大，使功率损耗导致，尝试在发射链路的耦合电容上并联一个1000pF，重新测试，低频段发射功率正常。电感的阻抗随频率先增大后降低，在自谐振频率处阻抗最大，电感LQM18NNR33K00D的自谐振频率为125MHz，在大于此频点处，阻抗会逐渐降低，当频率很高时，阻抗很低，使电感起不到扼流的作用，所以需要选择自谐振频率更高的电感。
2025-02-19 16:24:17
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原创 【SDR课堂第9讲】射频板卡发送接收信号功率损耗大，隔离度低
测试结果描述：NG-SDR-V2.0板卡与FCOMMS3板卡对比测试结果显示，NG-SDR-V2.0板卡的TX功率和RX功率相比官方板卡比较差。测试结果：NG-SDR-V3.0，TX功率与FCOMMS3板卡几乎一致，通道间隔离度也与FCOMMS3一致，满足甲方需求，对策有效。射频连接器型号为：SMA-KYWHD17，适用频率范围为DC-3G，当前板卡的频率范围为70M—6G.不能覆盖当前使用范围。射频连接器为插件，射频信号在连接器处，会有stub，存在阻抗不连续的情况，可能会影响射频性能。
2025-02-19 16:21:06
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原创 【SDR课堂第6讲】RFIC之 AD9361-基础RF特性（四）
9361的输入参考时钟频率Clk为40MHz，经过TX/RX Ref Divider分频、旁路或倍频，产生RF PLL所需的参考。TX Ref Divider和TX Ref Divider的配置寄存器为0x2AB、0x2AC：读取寄存器的值，0x2AB的值为0x7，0x2AC的值为0xFF，TX Ref Divider和TX Ref Divider对输入参考进行了2倍频，RF PLL的输入参考为80MHz。即Fref = 2*Clk。
2025-02-19 16:17:46
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原创 【SDR课堂第8讲】四通道信号接收机AD9361无数据
经排查，是由于PS侧使用SPI去控制AD9361的收发，而配置文件及配置教程是配的使用管脚控制，配置不匹配导致没有数据。AD9361没有数据，使用ILA抓信号，发现AD9361有给出时钟，但数据一直保持不变。配置前务必检查逻辑及PS的实现方法，并且以后可使用设备树进行配置。
2025-02-13 14:01:23
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原创 【SDR课堂第7讲】AD9361接收慢速AGC优化
本平台的Slow AGC所使用的增益表为官方默认增益表，使用频段范围为200MHz~1300MHz，当增益在30dB/31dB之间变化时，其增益变化量的标称值应为1dB，但是实际上，对于应用频点243MHz/406MHz，增益的变化量不只1dB（4-5dB）。所以，当输入幅度发生变化，使增益在30dB/31dB之间变化时，实际增益变化了4-5dB，使平均功率值直接跨过了目标窗口，然后就会使增益在30dB和31dB之间连续跳变，增益无法锁定。用户的要求为语音输出信号幅度变化范围不超过3dB。
2025-02-13 10:10:31
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原创 【SDR课堂第5讲】RFIC之 AD9361-基础RF特性（三）
本文是基于USRP-4120平台，对主要特性的阐述，由此引申出设计时需要注意的细节。
2025-02-05 17:59:15
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原创 【SDR课堂第4讲】RFIC之 AD9361-基础RF特性（二）
2、发射本文是基于USRP-4120平台，对AD9361主要特性的阐述，由此引申出设计时需要注意的细节2、发射2.4 中频谐波如下图中标记了LO-6MHz（LO-3IF）频率的信号，这是中频谐波信号，主要是由9361内部DAC输出产生，主信号与其的比值为中频谐波抑制。中频谐波抑制与DAC输入数字信号幅度有很大关系，发射衰减为10dB时，测试不同数字信号幅度对应的中频谐波抑制，如表2。2.5、PLL杂散调节频谱仪扫宽为3MHz，会发现近端有很明显的偏移187kHz左右的杂散，如图6所示。
2025-01-24 15:25:56
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原创 【SDR课堂第3讲】RFIC之 AD9361-基础RF特性（一）
本文是基于USRP-4120平台，对AD9361主要特性的阐述，由此引申出设计时需要注意的细节。
2025-01-24 14:56:13
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原创 【SDR课堂第2讲】RFIC之-零中频架构工作原理（二）
相较于超外差架构：零中频架构具有结构简单，成本低，集成度高等优点；零中频架构的本振信号处在信号带内，无法通过滤波器来抑制；零中频架构的镜像频率处在带内，无法通过滤波器来抑制，依赖于校准过程来降低I、Q路幅度与相位的误差。
2025-01-23 10:26:52
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原创 【SDR课堂第1讲】RFIC之 -零中频架构工作原理（一）
相较于超外差架构：零中频架构具有结构简单，成本低，集成度高等优点；零中频架构的本振信号处在信号带内，无法通过滤波器来抑制；零中频架构的镜像频率处在带内，无法通过滤波器来抑制，依赖于校准过程来降低I、Q路幅度与相位的误差。
2025-01-22 18:16:27
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原创 航空电子网络（ARINC429总线）
ARINC429接口仿真卡是一款高性能低功耗429总线协议处理板卡，符合ARINC429规范，支持16路接收和16路发送429总线接口，用于客户快速实现ARINC429接口终端。同时，该产品提供IRIG-B时标同步接口，可应用与多板卡协同工作环境，该板卡配套VxWork各版本、Windows版本标准驱动库，提供强大的配置应用软件，方便用户快速使用及产品二次开发。作为标准的IP Core，支持PMC、PCI、CPCI/VME/VPX、PCIe等嵌入式系统接口，以及用户定制的Local本地总线。
2023-06-26 17:25:08
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原创 航空电子网络（1553B总线）
MIL-STD-1553B总线接口卡可作为通讯或仿真测试板卡使用，支持USB，PCI，PXI，CPCI，以太网，RS422，RS485等计算机总线平台，单功能（1个BC、0-31个RT和1个BM，当前仅可单工作模式）、多功能（1个BC、0-31个RT和1个BM，当前可多工作模式），单通道、双通道、三通道、四通道选择，通讯速率支持标准1Mbps，以及4Mbps，-40℃～+85℃工业级工作温度设计，功能丰富，使用方便，利于二次开发。可满足装备、实验室、外场等对1553B总线的通信、测试和仿真需求。
2023-06-26 15:31:09
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原创 航空电子网络（AFDX总线）
ARINC664双端口终端网卡是一款高性能ARINC664网络接口板卡，支持ARINC664网络仿真、测试及数据分析功能。AES支持2个ARINC664端口，采用RJ45插件形式，可以作为2个独立端口使用，也可以作为1对冗余端口使用。航空电子总线通信产品测试、船舶数据传输总线通信产品测试、航天设备总线通信产品测试、以及各类地面总线通信验证与测试系统。支持ARINC664网络故障注入，生成错误帧，包括CRC错、数据帧长度错等故障。支持128个发送端口，128个接收端口。2路，2个端口互为冗余。
2023-06-26 15:22:33
1665
原创 航空电子网络（ARINC818总线）
ARINC818光纤视频转换器是针对航空电子数字视频总线协议（Avionics Digital Video BUS，ADVB）的高性能视频光纤转换测试设备，采用高集成度FPGA芯片实现ARINC818协议，实现和数字视频接口DVI（Digital Visual Interface）、HDMI的高速实时转换功能。1920 x 1080@60Hz/30Hz辨率支持640x480、800x600、1024x768、1280x720、1280x1024、1600x900、1600x1200、1920x1080。
2023-06-26 15:08:27
7042
1
原创 航空电子网络（FC总线）
FC-AE终端IP核是按照国际T11组织发布的光纤通信帧和信号FC-FS及FC-AE-ASM协议规范实现的FC终端数据通讯单元模块，采用Xilinx公司高性能FPGA，提供2路1、2、4、8Gbps速率的冗余光纤通道接口，可应用于快速实现FC终端网卡设计。IP Core通过逻辑硬件实现FC-AE-ASM，FC-AE-RDMA，FC-AE-1553，FC-AV协议，减少了CPU的负荷，从而满足了实时性、高可靠性及快速开发产品的要求。FC桥接设备是将以太网、CAN与FC网络融合的转接设备。
2023-06-26 14:32:56
4885
原创 通信与处理平台（全国产硬件平台）
龙芯2K1000核心板是一款基于LS2K1000的小型化核心板，且实现了器件全国产化，本产品参照PICMG COM Express规范，参考了COM Express Type10的pin脚定义,尺寸为MiniModule（84mm x55mm），是一款自主国产、高性能、高可靠性的COM-E计算机模块。每核心主频1.0GHz，单核可高达40GMACS和20GFLOPS，每核心32KB L1P、32KB L1D、512KB L2，4MB多核共享内存，8192个多用途硬件队列，支持DMA传输。
2023-06-26 11:19:14
3769
原创 通信与处理平台（数字信号处理）
数字信号处理模块基于6U VPX总线架构，为高性能、宽频段的数模混合信号处理平台。模块以6片ADI公司的RF捷变收发器AD9361作为射频收发核心，提供2路射频发射通道和10路射频接收通道，支持频段70MHz～6000MHz，发射链路添加射频放大器提高线性度，接收链路添加低噪声放大器，可有效的降低输入噪声和提高接收灵敏度，各片AD9361之间采用同源参考时钟设计，可满足多通道同步需求。
2023-06-25 18:08:43
1319
原创 通信与处理平台（存储与记录模块）
存储板网络存储模块，是以龙芯2K1000处理器为核心，基于CPCI形态设计的存储板卡。微型机载存储模块，是一款基于STM32的超微小型存储模块，该产品尺寸仅有24mm*20mm，FLASH容量为256Mb，通过邮票孔引出USB、UART、以及调试的接口，产品支持接入以太网数据自定义过滤，并用于以太网传输过程数据的储存，用于对现场通信过程的监控，可广泛用于固定台站、移动车载和野外环境。网络信息存储模块，是一款基于国产龙芯2K1000并搭载7K325T双网口的网络数据存储平台，该存储平台的总容量为1TB。
2023-06-25 18:02:44
223
原创 通信与处理平台（采集与回放模块）
77通道开关量输入模块，是一款基于ZC7045核心板的多通道开关量采集模块，该产品搭载两路千兆网口以及一路百兆网口实现77路开关量输入的采集功能，可用于工业控制、信号处理、数据通信等平台。32通道开关量输出模块，是一款基于ZC7045核心板构建的开关量采集模块，该产品搭载两路千兆网口以及一路百兆网口，实现32路继电器开关量输出功能，可用于工业控制、信号处理、数据通信等平台。工业控制、信息安全与存储、信号处理、数据通讯。一路DAC输出采集，125Msps采样位数14Bit。工业控制、信号处理、数据通讯。
2023-06-25 17:15:41
352
原创 通信与处理平台（万兆网）
万兆网卡（100%国产化）支持PCIex8模式，符合PCI Express 2.0规范，兼容PCI Express 1.1，板载冗余的2路SFP+光纤通道，适应于10G万兆以太网互联。万兆网卡采用光纤LC接口形式，可以作为2个独立端口使用，也可以作为1对冗余端口使用，支持最高10Gbps接口通信速率。或者作为标准网卡，取代市面上的Intel万兆网卡，尤其适合既需要万兆网标准SOCKET传输，又需要使用FPGA作为加速器的场景。HP BANK及HR BANK各1GB。时钟发生器提供多路时钟分配功能。
2023-06-25 16:46:43
302
原创 软件定义无线电（整机产品）
信号发射，接收话筒、线路输入的话音，对243MHz载波进行AM调制；信号接收，接收射频信号，进行AM解调，解调后的数字音频转换至模拟音频，经耳机或线路输出；音频接收，接收话筒、线路输入的模拟话音，对其数字化后，作为AM调制信息源；信标通话电台主要包括射频组件、AD/DA、基带三部分，射频组件包括天线、射频滤波、射频切换、接收机前置低噪放、发射机功率放大器等，射频预处理模块主要由模拟器件来实现，AD/DA主要完成模拟与数字信号的相互转换，接收机部分的ADC置于低噪放后级，发射机部分DAC置于功率放大器前级；
2023-06-25 16:41:27
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原创 软件定义无线电（射频组件）
二次航管设备（ATC）、空中交通防撞系统（ACAS）、测距设备（DME）、军用的有敌我识别系统（IFF）、空中战术导航系统即塔康（TACAN）、联合战术信息分发系统（JTIDS）功放模块集成了406MHz、243MHz、121MHz、156MHz信号的放大、243MHz信号的接收前端，包含收发切换、功率检测等功能。射频开关模块是某型定制化射频模块，核心部件是射频同轴开关，配合控制电路实现DC-4GHz频段的物理信道切换。可调范围≥30dB，步进0.5dB。≥30dB，步进0.5dB。
2023-06-25 16:16:35
303
原创 软件定义无线电(RFIC系列)
在软件定义无线电领域，公司以SoC、MPSoC、RFSoC、RFIC等系列器件为硬件核心，配合射频、功放、天线单元，适用于解决大规模阵列、多片与多通道同步、相控与波束成形、跳频加解密与抗干扰等关键技术。主要产品包括电台、接收机、信标机、干扰机、数据链、宽带频谱与仿真设备等。
2023-06-25 15:13:35
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