当在Vivado进行功能仿真时,经常会出现下方错误:
在谷歌之后发现解决办法并不是很好用。经过多次改正程序后发现,这个错误的主要原因是FPGA程序中有逻辑错误。
由于Vivado纠错能力较差,一般的语法错误会提示,但是逻辑错误一般不会提示,所以在进行仿真的时候会出现错误。
建议:
可以将Vivado与MODELSIM关联,然后应用MODELSIM进行逻辑纠错。
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在谷歌之后发现解决办法并不是很好用。经过多次改正程序后发现,这个错误的主要原因是FPGA程序中有逻辑错误。
由于Vivado纠错能力较差,一般的语法错误会提示,但是逻辑错误一般不会提示,所以在进行仿真的时候会出现错误。
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可以将Vivado与MODELSIM关联,然后应用MODELSIM进行逻辑纠错。