Quartus-II 全加器的设计

本文介绍了如何使用Quartus-II设计全加器,通过两个半加器和一个或门构成全加器的顶层文件。设计采用VHDL的层次结构,元件例化语句进行。文章详细阐述了设计步骤,包括建立工程、编写VHDL文件和仿真波形验证,其中全加器的设计参考了已有的半加器设计。

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Quartus-II 全加器的设计

一、全加器的实验原理

全加器可以由两个半加器和一个或门连接而成,这样得到的半加器电路称为顶层文件。

那么就要先设计好半加器和或门,全加器来调用半加器和或门就可以了。半加器的设计已经在前面提到过了。半加器设计过程链接:http://blog.youkuaiyun.com/zhengqijun_/article/details/53284245

下面全加器的设计采用层次结构的VHDL程序设计方法,采用元件例化语句。

二、全加器电路图


三、设计步骤

1. 建立工程。

2. 编写VHDL文件。

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