ARM9时钟

最新推荐文章于 2024-09-06 21:22:28 发布
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分类专栏： ARM硬件学习
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本文详细介绍了ARM9处理器的时钟特性，包括FLCK、HCLK和PLCK三种时钟源及其用途，并解释了两个PLL的作用。此外，还介绍了定时器的时钟源如何经过两次分频后进入定时器模块。

摘要生成于 C知道 ，由 DeepSeek-R1 满血版支持， 前往体验 >

一：ARM9时钟特点

有三个时钟源，特点如下

FLCK:用于CPU时钟

HCLK:用于AHB总线（高性能总线），用于连接CPU  DMA DSP

PLCK:用于APB总线，用于连接其他低速外围设备

有两个PLL,MPLL用于产生上面三个时钟源，UPLL专用于USB设备

二：定时器

定时器的的时钟源经过两次分频后才进入定时器模块。

ARM时钟体系（ARM9）及编程
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11-25 1534
ARM时钟体系（ARM9） 首先要明确一点，在编写带有时序性质的程序时，如果没有思路可以先了解其工作时的时序图，这一点是非常重要的。一个时序图能够清楚的描述其运行的整个过程，弄懂时序图会对编程思路有着明显的提升。 本次学习使用的开发板为：JZ2440 ARM版本为：AMR9 一、时钟框架概述 1.框架结构 在讲解如何通过程序改变芯片的运行时钟频率之前，先搞清楚ARM9时钟框架，如下图所示为S3C2440芯片手册上关于时钟框架的框架图。 通过观察上述的框架图可以发现，整个SOC被划分成了三部分，可以总结为：C
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03-20 1379
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FCLK、HCLK和PCLK的关系 摘自：http://blog.sina.com.cn/s/blog_4570e33b0100um14.html 三星官方搭载的wince系统的FLCK值为400MHz，HCLK值为100MHz、PCLK值为50MHz。那么这些值通过什么方法计算出来呢？大概过程如下，这些值在外部晶振12MHz的基础上通过PLL的作用倍频到我们需要的核心
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ARM系统时钟（S3C2440）
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S3C2440有三种时钟：FCLK HCLK PCLK FCLK: CPU HCLK :内存芯片，网卡等 PCLK :UART，定时器等 设置这三种时钟的方式：晶振通过PLL，达到一个很高的频率FCLK ，然后将FCLK 分频,以达到想要的HCLK PCLK; 下图是S3C2440CPU，系统刚上电时cpu运行的频率FCLK等于晶振OSC的频率,通过PLL设置，FCLK达到一个新的很高的频率。图中有一个锁定时间，在锁定时间内，cpu停止运行，当频率稳定后，CPU再次开始以新的频率运行。 通过上面的
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