FPGA电路逻辑的原理图方式设计与验证

最新推荐文章于 2024-12-24 14:20:57 发布
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本文介绍了如何使用FPGA进行电路逻辑的设计与验证，通过实验1展示了如何用2片3-8译码器拼接成4-16译码器，并通过仿真验证其正确性，关注输出信号的毛刺问题。实验2A和2B则分别阐述了设计M=12和M=20计数器的步骤，使用161计数器芯片，确保在特定计数值时溢出信号OV能准确输出。

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FPGA电路逻辑的原理图方式设计与验证

实验1：拼接 4-16译码器

  • 用2片3-8 译码器拼接成4-16 译码器
  • 仿真验证电路的正确性
  • 注意观察输出信号的毛刺（竞争冒险）
    在这里插入图片描述
    在这里插入图片描述
    实验2A ： 设计M=12的计数器
  • 用161计数器芯片，设计一个M=12的计数器
  • 上电后，对CLK信号，从0顺序计数到11，然后回绕到0
  • 当计数值为11的CLK周期，溢出信号OV输出一个高电平，其他周期OV信号输出0
  • 用波形仿真观察电路结果
    在这里插入图片描述
    在这里插入图片描述
    实验2B ： 设计M=20的计数器
  • 用161计数器芯片，设计一个M=20的计数器， 可以用多片
  • 上电后，对CLK信号，从0顺序计数到19，然后回绕到0
  • 当计数值为19的CLK周期，溢出信号OV输出一个高电平，其他周期OV信号输出0
  • 用波形仿真观察电路结果
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