在板子上电后自动运行程序

将自己的应用加在/etc/profile文件中
MSLIB_PATH=/vendor/lib

export LD_PRELOAD=$MSLIB_PATH/preloadable_libiconv.so
export LD_LIBRARY_PATH=$MSLIB_PATH:$MSLIB_PATH/utopia
export TERM=vt100
export TERMINFO=/terminfo

export GST_PLUGIN_PATH=$MSLIB_PATH/gstreamer-0.10
export GST_PLUGIN_SCANNER=$MSLIB_PATH/gstreamer-0.10/bin/gst-plugin-scanner
export GST_REGISTRY=$MSLIB_PATH/gstreamer.registry
export GST_REGISTRY_FORK=no
export GST_REGISTRY_UPDATE=no

ulimit -c unlimited >/dev/null 2>&1
#echo ""
#echo ""
#echo "Please press Ctrl-C TWICE to leave auto run mode."
#for i in 1 2 3 4 5 ; do
#    echo -e -n $i" "
#    sleep 1
#done

#udhcpc -t 1 -T 3 -n
ulimit -s 4196

#Skype run-time daemon
if [ -f /applications/Skype/linux-mipsel-skypekit-voicertp-videortp ];then
        echo "Start Skype daemon..."
        /applications/Skype/linux-mipsel-skypekit-voicertp-videortp &
fi

echo "cd to applications/bin"
cd /applications

./apm &

cd /applications/bin
./autorun &

echo "cd to applications/tv/bin"
cd /applications/tv/bin
./dvbt_board &
<think>嗯,用户之前问过关于Vivado的错误信息,现在他们想知道生成bit文件后如何在板子上调试。看起来他们已经解决了编译问题,现在进入了实际硬件调试阶段。我需要先理解他们的需求,可能他们是FPGA开发者,正在做项目,需要验证设计的功能。 首先,用户可能对硬件调试的流程不太熟悉,特别是刚接触Vivado和FPGA的人。他们可能已经生成了bit文件,但不知道下一步该怎么做。我需要分步骤介绍调试方法,确保覆盖主要工具和步骤。 常见的调试方法包括使用ILA(集成逻辑分析仪)、VIO(虚拟输入输出)、硬件管理器以及结合SDK/Vitis进行软硬件协同调试。这些工具各有优缺点,用户可能需要根据具体情况选择。例如,ILA适合实时抓取信号,而VIO适合动态修改输入值。 用户可能遇到的问题包括硬件连接不稳定、时钟配置错误、触发条件设置不当等。需要提醒他们检查这些方面。另外,可能还需要指导他们如何添加调试核,如何设置触发条件,以及如何分析捕获的数据。 还要考虑用户是否使用MicroBlaze或其他处理器,是否需要结合SDK或Vitis进行调试。如果是软核处理器,可能需要下载程序到内存,并监控运行情况。 需要确保语言简洁明了,步骤清晰,避免使用过多专业术语,但又要足够详细。可能用户需要从最基础的连接硬件开始,逐步引导他们完成整个调试流程。此外,提供一些常见问题的解决方法会更有帮助,比如如何解决ILA无法捕获信号的问题。 最后,总结关键点,帮助用户回顾整个流程,确保他们能够系统地完成调试工作。可能还需要建议他们在设计早期添加调试核,方便后续调试,以及提醒保存调试配置以便复用。</think>在Vivado中生成Bitstream文件(.bit)后,调试FPGA设计通常需要结合硬件调试工具(如ILA、VIO等)和实际硬件操作。以下是完整的调试流程及关键步骤: --- ### **1. 硬件准备** 1. **连接开发板** - 通过JTAG(如Xilinx Platform Cable USB II)连接FPGA开发板和脑。 - 确保源和时钟信号已正确配置。 2. **检查硬件识别** - 打开Vivado,进入 **Hardware Manager**。 - 点击 **Open Target** → **Auto Connect**,确认检测到FPGA设备(如xc7z020_1)。 --- ### **2. 调试工具配置(设计阶段)** 在生成Bitstream前,需在设计中插入调试核(Debug Core),常用方法: #### **2.1 使用ILA(Integrated Logic Analyzer)** - **标记信号**:在HDL代码中为需要调试的信号添加 `(* mark_debug = "true" *)` 属性。 ```verilog (* mark_debug = "true" *) reg [7:0] counter; ``` - **自动插入ILA**: - 在综合后,打开 **Synthesized Design** → **Set Up Debug**。 - 选择需要调试的信号,配置ILA参数(采样深度、触发条件等)。 #### **2.2 使用VIO(Virtual Input/Output)** - 在Block Design中添加VIO IP核,连接需要监控或控制的信号。 #### **2.3 生成含调试信息的Bitstream** - 确保在 **Generate Bitstream** 前完成调试核配置。 --- ### **3. 下载Bitstream并调试** 1. **下载Bit文件** - 在 **Hardware Manager** 中,右键设备 → **Program Device**,选择生成的.bit文件。 - 勾选 **Debug Probes File (.ltx)**(自动加载ILA/VIO配置)。 2. **使用ILA抓取信号** - 打开ILA控制窗口,设置触发条件(如 `counter == 8'hFF`)。 - 点击 **Run Trigger** 启动捕获,观察波形数据。 3. **动态控制信号(VIO)** - 在VIO控制界面,手动修改输入信号值(如复位信号)。 - 实时监控输出信号状态(如LED状态)。 4. **实时调试(Hardware Manager)** - 通过 **Refresh Device** 更新硬件状态。 - 使用 **Read/Write Registers** 直接读写寄存器值(需在设计中暴露AXI接口)。 --- ### **4. 高级调试技巧** #### **4.1 多时钟域调试** - 为不同时钟域的信号分配独立的ILA核,避免跨时钟域冲突。 #### **4.2 条件触发与分段捕获** - 使用逻辑表达式组合触发条件(如 `signal_a > 100 && signal_b == 0`)。 - 设置分段存储模式(Window Mode),分时捕获不同阶段的信号。 #### **4.3 与Vitis/SDK协同调试** - 若设计中包含软核(如MicroBlaze),结合Vitis IDE: 1. 在Vitis中下载软件程序(.elf文件)。 2. 使用调试器设置断点,监控CPU执行流程。 3. 通过AXI总线监控外设状态。 --- ### **5. 常见问题与解决** - **问题1:ILA未捕获数据** - 检查时钟是否正常工作(ILA时钟需与设计时钟一致)。 - 确认触发条件是否满足。 - **问题2:JTAG连接失败** - 重新插拔JTAG线缆,检查驱动安装。 - 尝试更换USB端口或JTAG调试器。 - **问题3:信号显示为未知(X)** - 确认信号在设计中未被优化(添加 `keep` 属性)。 - 检查是否未正确复位。 --- ### **6. 调试流程总结** 1. **设计阶段**:插入调试核 → 生成含调试信息的Bitstream。 2. **硬件阶段**:连接设备 → 下载Bit文件。 3. **调试阶段**:设置触发条件 → 捕获数据 → 分析问题 → 修改设计。 --- 通过以上步骤,可以高效定位FPGA设计中的逻辑错误或时序问题。建议在复杂设计中优先使用ILA+VIO组合调试,并保存调试配置(.ltx文件)以便复用。
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