ARM-A内核架构及指令集
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Cortex-A510——启动代码分析
小狼@http://blog.youkuaiyun.com/xiaolangyangyang。原创 2024-12-26 17:07:26 · 297 阅读 · 0 评论 -
Cortex-A510——内存屏障/壁垒（DMB/DSB/ISB）
小狼@http://blog.youkuaiyun.com/xiaolangyangyang原创 2024-07-25 17:01:02 · 877 阅读 · 0 评论 -
Cortex-A510——APB/AHB/AXI/ACE/CHI协议和NIC/NOC互联
小狼@http://blog.youkuaiyun.com/xiaolangyangyang原创 2024-07-19 11:57:54 · 680 阅读 · 0 评论 -
Cortex-A510——内核及汇编
小狼@http://blog.youkuaiyun.com/xiaolangyangyang原创 2024-07-02 15:33:49 · 451 阅读 · 0 评论 -
Cortex-A510——Cache
小狼@http://blog.youkuaiyun.com/xiaolangyangyang原创 2024-06-17 15:51:40 · 290 阅读 · 0 评论 -
Cortex-A510——GIC
小狼@http://blog.youkuaiyun.com/xiaolangyangyang原创 2024-06-21 10:34:46 · 343 阅读 · 0 评论 -
Cortex-A510——IOMMU
小狼@http://blog.youkuaiyun.com/xiaolangyangyang原创 2024-07-02 11:06:51 · 247 阅读 · 0 评论 -
Cortex-A510——MMU
小狼@http://blog.youkuaiyun.com/xiaolangyangyang原创 2024-06-21 10:36:26 · 99 阅读 · 0 评论 -
ARM内核架构（四）——RO、RW、ZI和.text .bss .data
RO/RW/ZI和.text/.bss/.data小狼@http://blog.youkuaiyun.com/xiaolangyangyangRO段包括只读代码段(code段/.text段)和常量段(RO Data段/.constdata段)RW段(.data段)指已被初始化成非0值的变量段ZI段(.bss段)指未被初始化或初始化为0的变量段http://blo原创 2016-06-28 10:13:10 · 961 阅读 · 1 评论 -
ARM内核架构（三）——MMU、Cache、TLB、流水线
MMU、Cache、TLB、流水线小狼@http://blog.youkuaiyun.com/xiaolangyangyangVM通过页表转换成PM，MMU、Cache、TLB在转换过程中发挥作用：（1）PTE和PA都在Cache或者Memory中：（2）将Cache和Memory拆开描述，PTE和PA是否在Cache中命中：（3）P原创 2015-04-02 10:38:25 · 2915 阅读 · 1 评论 -
ARM内核架构（二）——ARM处理器7种工作模式
ARM处理器7种工作模式小狼@http://blog.youkuaiyun.com/xiaolangyangyang原创 2016-06-27 14:29:47 · 22392 阅读 · 1 评论 -
ARM内核架构（一）
ARM内核架构（一）小狼@http://blog.youkuaiyun.com/xiaolangyangyang原创 2021-05-19 09:55:19 · 1575 阅读 · 0 评论