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1 数字逻辑电路设计与 Verilog 代码开发如果想用 Verilog 语言写出一个真正可以物理实现的电路，必须先进行电路设计再进行代码编写。1.1 面向硬件电路的设计思维方式核心：数据通路（Datapath）+控制逻辑(Control Logic)数据通路：数字系统中，各个子系统通过数据总线连接形成的数据传送路径称为数据通路。电路中各器件之间传递的是：电磁信号电路结构图：用来刻画电路中的数据通路##　1.2 行为描述的 Verilog 编程风格通常来说，使用 Verilog描述电

FPGA设计流程FPGA（Field Programmable Gate Array，现场可编程门阵列）特殊的集成电路可编程集成电路绝大多数都是集体管集成，比如CMOS晶体管集成电路。晶体管集成电路：通俗一点来说，就是用金属导线把许许多多由晶体管构成的逻辑门、存储单元连接成一个电路，具备 一定的逻辑功能。不过真正设计数字电路时，不需要真的用导线连晶体管，用硬件描述语言（比如 VerilogHDL）写代码运行综合软件（比如Vivado ）就可以生成电路图。FPGA 的一般设计流程有“五步骤”

第一章 CPU芯片研发过程概述1.区分处理器和处理器核处理器核包括运算器和控制器处理器不等于处理器核现在的处理器核只是处理器的一部分这就是所谓四核处理器，就是在一个处理器上拥有四个处理器核。核多有什么用？当然是快了，你有四个核同时工作比单核快多了so，make的时候不要忘了加上j4但是这可不是正比例关系，八核可不比四核再快两倍八核分两种：1.“双四核” 4+4的道理单纯是数目达到了8 性能可没有真八核好 虽然存在八个核心，但是无法同时工作，其中四个核心往往被应用在基