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好像期中考试后就没有更新计组了，最近这一个月的数据通路和指令控制搞得心态不行一看到这个提纲整笑了，没想到浮点数搞了那么久不考。。然后学了一个月的指令系统大部分不考先放期中考试大纲期中考试大纲_find it %%的博客-优快云博客L01（25 分）1. 定点数的加法运算，及定点数的表示范围---15 分计算机组成原理（第三章【2】）_find it %%的博客-优快云博客_单操作数和双操作数的区别第四章------运算方法和运算器_find it %%的博客-C.

我来看看大题涉及到我的博客吧定点数的加法/减法计算及定点数运算器的组成结构与工作过程 （单总线等等） 20 分（L1）第四单元--运算方法和运算器_inbSorryMaker的博客-优快云博客自定义浮点数加法运算 20分https://blog.youkuaiyun.com/weixin_51578598/article/details/120712880Cache 中主存地址格式的计算 20分计组---第五章（3）高速缓冲器 Cache_inbSorryMake...

Cache是指位于CPU和主存之间的一个高速小容量的存储器，一般由SRAM构成。Cache 的作用及实现提高访存速度的原理Cache功能：用于弥补CPU和主存之间的速度差异， 提高CPU访问主存的平均速度。cache/主存访问时间例题CPU执行一段时间时，Cache完成存取的次数为3900次，主存完成的存取次数为100次，已知cache的存储周期为40ns，主存的存储周期为240ns。求cache/主存系统的效率和平均访问时间？主存块在不同映射方式...

存储器芯片与CPU的连接1. 确定所需芯片的数量（可以通过计算得出）2. 确定每个芯片的分配地址 （区分最大地址还是最小地址，容量）3. 确定每个芯片片选信号CS的产生方式 (3-8译码器或者4-16译码器选择使用哪一片存储芯片)4. 完成CPU与存储芯片的连接：地址线(决定CPU访存： 空间的大小【相当于多少个的单元】) (Ax-A0)数据线（决定访存单元的大小）（Dx-D0）读/写（R/W#，只有SRAM可读可写，不用连ROM）控制线 （MREQ#，一般连上译码器，控制.

存储系统的概念（1）按存储介质分类 • 半导体器件：半导体存储器（RAM、ROM，用作主存）• 磁性材料：磁表面存储器（磁盘、磁带，用作辅存）• 光介质：光盘存储器（用作辅存）（2）按存取方式分类• 随机存取存储器：存储器中任何存储单元的内容都能被 随机存取，且存取时间和存储单元的物理位置无关（主 存）• 顺序存取存储器：存取时间和存储单元的物理位置有关 （磁盘、磁带）• 相联存储器：按内容访问。（3）按存储器的读写功能分类• 只读存储器（ROM）：.

目录补码加减法运算补码加减法求补运算[y]补~~~[-y]补补码运算溢出定点数阵列乘法无符号位乘法n*n位二进制乘法小结定点运算器组成定点运算器总线结构单总线（1）双寄存器单总线（2）一个寄存器双总线三总线浮点数加减法必备补充知识流程对阶，规格化右规​左规舍入、判溢出补码加减法运算补码加减法[x]补+[y]补=[x+y]补[x]补+[-y]补=[x-y]补特点：使用补码进行加减运算...

第一次作业总的来说，其实就是对定点整数掌握的不够熟悉，特别是范围问题第二次作业这次作业主要问题是在于阶码与尾数，IEEE754了解其规则，特别规格化编码的范围问题第三单元测试（7*分）挺糟糕的，感觉复习和知识掌握的地方不够深刻，短短的测试能发现自己很多问题；例如说考试答题最好是写多点过程，哪怕最后的结果错了也能捞点分；然后要阅读好题干问题，有一些细节问题也经常会忽略，就像是16进制后面的“H”等等原题写出下面8位机器数的真值（十进制...

规格化浮点数IEEE754标准尾数M：为定点小数，尾数的位数决定了浮点数有效数值的精度，尾数的符号代表了浮点数的正负，因此又称为数符。 尾数一般采用原码和补码表示。阶码E：为定点整数，阶码的数值大小决定了该浮点数实际 小数点位置与尾数的小数点位置（隐含）之间的偏移量。 阶码的位数多少决定了浮点数的表示范围。阶码的符号叫 阶符。阶码一般采用移码和补码表示。阶码的底R：一般为2、8或16 ，且隐含规定。定义：尾数用原码表示，且在尾数中 设置了一个缺省的1，即1.M形式；基数...

这个单元学习情况太差了，放些知识点了目录十进制转二、八、十六进制方法：机器数原码补码扫描法（补码）反码​移码原码、移码、补码、反码总结二进制、八进制、十进制、十六进制问题！十进制转二、八、十六进制方法：整数部分：除以R取余，先得低位，直到商为0。小数部分：乘R取整，先得高位，直到积为0或 者达到精度要求为止。下面的可供参考(5条消息) 十进制小数转二进制小数方法_kevin6216的专栏-优快云博客机器数在...