PCI Express 6.0 规范

PCI Express 6.0 规范

近二十年来,PCI Express® (PCIe®) 规范业已成为当之无愧的互连之选。PCIe 6.0 规范旨在使 PCIe 5.0 规范 (32 GT/s) 的带宽和电源效率翻倍,同时继续满足业界对于低时延高速互连的需求。PCIe 6.0 技术可提供经济实惠且可扩展的互连解决方案,旨在满足各类数据密集型市场的需求,如数据中心、人工智能、机器学习、高性能计算 (HPC)、汽车、物联网 (IoT) 以及军事/航空航天。 

PCIe 6.0 规范特点 

  • 原始数据速率为 64 GT/s,通过 x16 配置最高可达 256 GB/s
  • 4 级脉冲振幅调制 (PAM4) 信令,充分利用业界现有 PAM4
  • 轻量级的前向纠错 (FEC) 和循环冗余校验 (CRC),缓解 PAM4 信令相关联的误码率增加
  • 基于流量控制单元 (Flit) 的编码,支持 PAM4 调制,能搭配 FEC CRC 一起使用,使带宽加倍。
  • 更新了 Flit 模式下使用的数据包布局,提供额外的功能,并简化处理。
  • 保持与所有前几代 PCIe 技术的向后兼容性

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源文链接:PCI Express 6.0 Specification | PCI-SIG (pcisig.com)

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